发明公开
CN112037115A 计算成像管线
审中-实审
- 专利标题: 计算成像管线
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申请号: CN202010159172.9申请日: 2014-08-06
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公开(公告)号: CN112037115A公开(公告)日: 2020-12-04
- 发明人: 大卫·莫洛尼 , 理查德·里士满 , 大卫·多诺霍 , 布兰登·巴里 , 科马克·布里克 , 奥维迪乌·安德烈·韦萨
- 申请人: 大卫·莫洛尼 , 理查德·里士满 , 大卫·多诺霍 , 布兰登·巴里 , 科马克·布里克 , 奥维迪乌·安德烈·韦萨
- 申请人地址: 爱尔兰都柏林
- 专利权人: 大卫·莫洛尼,理查德·里士满,大卫·多诺霍,布兰登·巴里,科马克·布里克,奥维迪乌·安德烈·韦萨
- 当前专利权人: 大卫·莫洛尼,理查德·里士满,大卫·多诺霍,布兰登·巴里,科马克·布里克,奥维迪乌·安德烈·韦萨
- 当前专利权人地址: 爱尔兰都柏林
- 代理机构: 北京品源专利代理有限公司
- 代理商 王小衡; 胡彬
- 优先权: 1314263.3 2013.08.08 GB
- 主分类号: G06T1/20
- IPC分类号: G06T1/20 ; G06T1/60 ; G09G5/36 ; G09G5/397
摘要:
本申请总体上涉及并行处理装置。所述并行处理装置可包括多个处理元件、存储器子系统和互连系统。所述存储器子系统可包括多个存储器片,所述多个存储器片中的至少一个与所述多个处理元件中的一个相关联,并且包括多个随机存取存储器(RAM)图块,每个图块具有单独的读取和写入端口。所述互连系统被配置来耦接所述多个处理元件和所述存储器子系统。所述互连系统包括局部互连和全局互连。