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公开(公告)号：CN101884062A
公开(公告)日：2010-11-10
申请号：CN200880119250.X
申请日：2008-08-28
Applicant: 夏普株式会社
CPC classification number: G09G3/3677 , G09G3/3648 , G09G2300/043 , G09G2300/0876 , G09G2310/0286 , G09G2310/08 , G09G2320/0219
Abstract: 本发明的目的在于提供一种显示装置，所述显示装置包括：栅极驱动器(30)，该栅极驱动器包括多个与各行对应设置的移位寄存器级(31)，输出用于使该行的开关元件导通的栅极信号；以及源极驱动器，该源极驱动器输出与要显示的视频相对应的数据信号。位于栅极信号的扫描开始侧的最端部的行(第一行)设置有虚拟线(G0)，虚拟线(G0)由输入到第一行的移位寄存器(SR1)的栅极起始脉冲(GSP)进行驱动。
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公开(公告)号：CN1201195C
公开(公告)日：2005-05-11
申请号：CN02154313.5
申请日：2002-11-28
Applicant: 夏普株式会社
IPC: G02F1/1362 , G09G3/36
CPC classification number: G09G3/3648 , G09G3/3614 , G09G2320/0209 , G09G2330/08
Abstract: 液晶显示器件与排成矩阵状的多个象素一起，交叉形成施加扫描信号的扫描线和施加数据信号的信号线。在扫描线与信号线的各交叉部附近设置电连接这些扫描线和信号线的TFT，各TFT连接象素电极。最靠端部的象素列外侧相邻配置由伪信号线驱动的伪象素。由此，提供使全部信号线电容条件相等并且能防止特定部分显示不同而造成显示质量下降的矩阵型液晶显示器件。
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公开(公告)号：CN103703507B
公开(公告)日：2016-04-27
申请号：CN201280037108.7
申请日：2012-08-03
Applicant: 夏普株式会社
CPC classification number: G09G3/3611 , G09G3/3677 , G09G2330/027
Abstract: 提供能够在电源切断时迅速除去面板内的残留电荷的具备IGZO-GDM的液晶显示装置及其驱动方法。构成移位寄存器的各双稳电路具备：薄膜晶体管（TI），其用于基于第1时钟使输出端子的电位上升；区域（netA），其连接到薄膜晶体管（TI）的栅极端子；薄膜晶体管（TC），其用于使区域（netA）的电位下降；以及区域（netB），其连接到薄膜晶体管（TC）的栅极端子。在这样的构成中，电源切断次序包括显示截止次序和栅极截止次序，栅极截止次序至少包含栅极总线放电步骤（t14～t15）、netB放电步骤（t15～t16）、netA放电步骤（t16～t17）。
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公开(公告)号：CN104718568A
公开(公告)日：2015-06-17
申请号：CN201380053798.X
申请日：2013-10-11
Applicant: 夏普株式会社
CPC classification number: G09G3/3688 , G09G3/3648 , G09G3/3677 , G09G3/3696 , G09G2300/0819 , G09G2300/0876 , G09G2310/0251 , G09G2310/0286 , G09G2330/02 , G09G2330/021 , G09G2330/027 , G11C19/28
Abstract: 作为IGZO-GDM的栅极驱动器(24)和电平转换电路(13)经由第1～第5配线(OL1～OL5)相互连接。各配线(OL)与放电部(190)连接。在用于除去面板内的残留电荷的电源切断序列中，当电平转换电路(13)内的第1～第5输出电路(OC1～OC5)的电源低于动作下限值时，第1～第5输出电路(OC1～OC5)的输出成为高阻抗状态。此时，各配线(OL)的电位被放电部(190)拉到接地电位。从而，在电源被切断时能迅速且稳定地除去面板内的残留电荷。
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公开(公告)号：CN104254890A
公开(公告)日：2014-12-31
申请号：CN201380012540.5
申请日：2013-03-05
Applicant: 夏普株式会社
CPC classification number: G09G3/3677 , G09G3/3674 , G09G2310/0281 , G09G2310/0286 , G11C19/28 , G11C27/04
Abstract: 一种移位寄存器，在第1中间级和第2中间级中均设有：第1输入端子，其中输入时钟信号；第2输入端子，其中输入与上述时钟信号不同相位的时钟信号；输出端子，其通过输出晶体管连接到第1输入端子；以及设定电路，其连接到第2输入端子和输出晶体管，用于设定输出晶体管的控制端子的电位，在第2中间级中设有连接到上述设定电路并输入控制信号的控制电路，将在输入到初级的移位起始信号成为激活后直至末级的输出从激活变成非激活为止的期间设为动作期间，在输入到第2中间级的第1输入端子的时钟信号在动作期间开始后初次激活了时，输入到第2中间级的第2输入端子的时钟信号为非激活。由此，抑制各级中输入多个时钟信号的移位寄存器的误动作。
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Patent Agency Ranking
公开(公告)号：CN101933077B
公开(公告)日：2013-10-16
申请号：CN200880126145.9
申请日：2008-12-04
Applicant: 夏普株式会社
CPC classification number: G09G3/3677 , G11C19/28
Abstract: 本发明的目的在于提供一种显示面板驱动电路及显示面板的驱动方法。所述显示面板驱动电路包括由输出信号线选择信号(G1～Gm)的单位电路级联连接而构成的移位寄存器，向所述单位电路输入时钟信号(CK1、CK2)、和起始脉冲信号(GSP)或从其他级输出的信号线选择信号，所述时钟信号伴随激活上升的部分及倒钩部分是倾斜的。根据所述结构，能够实现在栅极导通脉冲信号中不易发生异常(例如，非激活时的电位波动)的显示面板驱动电路及显示面板驱动方法。
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公开(公告)号：CN101971242B
公开(公告)日：2013-04-10
申请号：CN200880128102.4
申请日：2008-12-17
Applicant: 夏普株式会社
CPC classification number: G09G3/3677 , G09G2310/0286 , G09G2330/025 , G11C19/184 , G11C19/28
Abstract: 本发明提供一种显示面板驱动电路，该显示面板驱动电路包括移位寄存器，该移位寄存器由生成信号线选择信号(G1～Gm)的单位电路级联连接而构成，并且从第一级到最后一级依次输出由所述信号线选择信号(G1～Gm)形成的脉冲，向所述各单位电路输入时钟信号(CK1、CK2)、基于来自所述显示面板驱动电路外部的同步信号(VSYNC)而生成的栅极起始脉冲信号(GSP)或由其它级生成的所述信号线选择信号(G1～Gm)、以及清零信号(CLR)，该清零信号(CLR)在所述同步信号(VSYNC)有异常的情况下被激活，之后到下一个垂直扫描期间开始之前，都不从所述移位寄存器输出脉冲。根据上述结构，能够实现一种可在所述同步信号(VSYNC)产生异常的情况下抑制显示混乱并且不增大对电源的负荷的显示面板驱动电路。
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公开(公告)号：CN102598145A
公开(公告)日：2012-07-18
申请号：CN201080049515.0
申请日：2010-07-15
Applicant: 夏普株式会社
CPC classification number: G11C19/28 , G09G3/3685 , G09G2310/0275 , G09G2310/0286 , G11C19/287
Abstract: 本发明的目的在于，实现一种能够抑制对电路面积的增大、消耗电流的增大和对像素电容的充电不足，并能够切换扫描信号线的扫描顺序的移位寄存器。构成移位寄存器(410)的各级包括：用于根据第一时钟(CKA)使扫描信号的电位上升的输出控制用的薄膜晶体管；用于根据从前一级/后一级输出的扫描信号使与该薄膜晶体管的栅极端子连接的第一节点的电位上升的2个薄膜晶体管；和用于根据从之后的第三个级/之前的第三个级输出的扫描信号使第一节点的电位降低的2个薄膜晶体管。移位寄存器(410)根据包括供给至第奇数级的2相时钟信号(GCK1、GCK3)和供给至第偶数级的2相时钟信号(GCK2、GCK4)的相位各偏差90度的4相时钟信号进行动作。
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公开(公告)号：CN101971242A
公开(公告)日：2011-02-09
申请号：CN200880128102.4
申请日：2008-12-17
Applicant: 夏普株式会社
CPC classification number: G09G3/3677 , G09G2310/0286 , G09G2330/025 , G11C19/184 , G11C19/28
Abstract: 本发明提供一种显示面板驱动电路，该显示面板驱动电路包括移位寄存器，该移位寄存器由生成信号线选择信号(G1～Gm)的单位电路级联连接而构成，并且从第一级到最后一级依次输出由所述信号线选择信号(G1～Gm)形成的脉冲，向所述各单位电路输入时钟信号(CK1、CK2)、基于来自所述显示面板驱动电路外部的同步信号(VSYNC)而生成的栅极起始脉冲信号(GSP)或由其它级生成的所述信号线选择信号(G1～Gm)、以及清零信号(CLR)，该清零信号(CLR)在所述同步信号(VSYNC)有异常的情况下被激活，之后到下一个垂直扫描期间开始之前，都不从所述移位寄存器输出脉冲。根据上述结构，能够实现一种可在所述同步信号(VSYNC)产生异常的情况下抑制显示混乱并且不增大对电源的负荷的显示面板驱动电路。
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公开(公告)号：CN101971241A
公开(公告)日：2011-02-09
申请号：CN200880128020.X
申请日：2008-12-04
Applicant: 夏普株式会社
Abstract: 本发明的目的在于提供一种显示面板驱动电路及显示面板的驱动方法。所述显示面板驱动电路包括由输出信号线选择信号(G1～Gm)的单位电路级联连接而构成的移位寄存器，向所述单位电路输入时钟信号(CK1、CK2)、和起始脉冲信号(GSP)或从其他级输出的信号线选择信号(G1～Gm)，所述时钟信号(CK1、CK2)激活后的倒钩部分包括斜坡状的第一区域和比所述第一区域更陡的第二区域。根据所述结构，能够实现可以抑制栅极导通脉冲信号的异常，并且可以提高像素充电率和使时钟信号高频化的显示面板驱动电路及显示面板驱动方法。
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