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公开(公告)号：CN115567075B
公开(公告)日：2024-08-13
申请号：CN202211166889.1
申请日：2022-09-23
申请人： 西安电子科技大学重庆集成电路创新研究院
摘要： 本发明涉及一种射频前端复用电路以及用于无线传感器网络的一体芯片，射频前端复用电路包括射频前端复用模块、RF‑DC整流器和WuRX自混频器。射频前端复用模块为RF‑DC整流器前四级整流器和WuRX自混频器前四级正向迪克森电荷泵的复用。本发明通过将无线传感器芯片中的天线、匹配网络以及射频前端进行复用，采用分时复用整流和解调策略、射频前端复用技术，实现射频能量获取功能和唤醒接收机功能芯片的一体化，节省一个天线和一个匹配网络，并减小芯片面积和功耗。本发明通过给射频前端复用电路添加AC耦合和DC耦合两种模式的栅偏置，实现唤醒接收机的灵敏度的提升，同时使得射频能量获取的功率转换效率也得到提升。
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公开(公告)号：CN117749205A
公开(公告)日：2024-03-22
申请号：CN202311757837.6
申请日：2023-12-19
申请人： 西安电子科技大学重庆集成电路创新研究院
摘要： 本发明公开了一种用于唤醒接收机的基于差分路径的直流失调消除环路，包括射频交流耦合电容器、差分包络检波器、双路径检波器开关、基带放大器、压控振荡器、差分输出开关和直流失调校准模块，差分包络检波器、双路径检波器开关、基带放大器、压控振荡器和差分输出开关依次相连，差分路径中产生的直流失调等效为等效失调，等效失调与基带放大器的正输入端连接，直流失调校准模块的输入端与压控振荡器的双输出端相连，输出端与差分包络检波器的直流输入端相连，射频交流耦合电容器跨接在差分包络检波器的射频输入两端，形成直流失调消除环路。本发明可以降低差分唤醒接收机中包括检波器、基带放大器和比较器的失调电压，增强唤醒接收机解调信号的准确性。
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公开(公告)号：CN117393559A
公开(公告)日：2024-01-12
申请号：CN202311391369.5
申请日：2023-10-24
申请人： 西安电子科技大学重庆集成电路创新研究院
IPC分类号： H01L27/02 , H01L23/544 , H01L29/78 , H01L21/336
摘要： 本发明涉及一种Trench VDMOS器件及其制备方法，Trench VDMOS器件中的元胞包括制作在同一衬底上的若干主体元胞、若干隔离元胞和若干采样元胞，其中：所述若干采样元胞成阵列方式设置，且所述若干采样元胞并联连接；所述若干隔离元胞围绕所述若干采样元胞的四周设置；所述若干主体元胞围绕所述若干采样元胞的四周设置，所述若干主体元胞并联连接；并且，所述采样元胞和所述主体元胞并联连接，所述主体元胞、所述采样元胞和所述隔离元胞的漏极相互连接在一起，所述主体元胞的源极相互连接在一起，所述采样元胞的源极相互连接在一起。本发明能够对流过器件的电流进行采样，从而实时监控整个主体器件的工作状态。
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公开(公告)号：CN117353569A
公开(公告)日：2024-01-05
申请号：CN202311246014.7
申请日：2023-09-25
申请人： 西安电子科技大学重庆集成电路创新研究院
摘要： 本发明公开了一种电荷泵，包括：充电开关模块、放电开关模块和充放电回路；其中，所述充电开关模块和所述放电开关模块的电路结构相同；所述充电开关模块，用于差分接收鉴频鉴相器输出的充电脉冲信号和充电反相脉冲信号，根据所述充电脉冲信号和所述充电反相脉冲信号生成充电电流；所述放电开关模块，用于差分接收鉴频鉴相器输出的放电脉冲信号和放电反相脉冲信号，根据所述放电脉冲信号和所述放电反相脉冲信号生成放电电流；所述充放电回路，用于根据所述充电电流输出第一电压，根据所述放电电流输出第二电压。本发明的提供的该电荷泵的噪声和抖动更低。
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公开(公告)号：CN117274625A
公开(公告)日：2023-12-22
申请号：CN202311175873.1
申请日：2023-09-11
申请人： 西安电子科技大学重庆集成电路创新研究院
IPC分类号： G06V10/44 , G06V10/34 , G06N3/0464 , G06N3/048 , G06N3/08
摘要： 本发明提供了一种基于背景对比的轻量化小目标特征增强方法及装置，通过特征增强模块对浅层特征图进行增强，在保持较低参数量的同时，扩大了感受野、捕捉更多上下文信息，并利用上下文信息加强小目标物体与背景的对比来增强特征的表达能力，有助于取得更优秀的小目标检测性能。通过通道膨胀卷积和通道注意力机制的巧妙设计，减少了网络的复杂度，使得网络轻量化，适用于移动设备和资源有限的场景。由于本发明采用通道膨胀卷积进行膨胀，相比普通膨胀卷积或者深度可分离膨胀卷积能大幅减少参数量，从而提高模型的计算效率，从而提升增强特征图的效果，进一步提升检测小目标的准确度。
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公开(公告)号：CN117254803A
公开(公告)日：2023-12-19
申请号：CN202311287247.1
申请日：2023-10-07
申请人： 西安电子科技大学重庆集成电路创新研究院
摘要： 本发明涉及一种应用于延迟锁相环的差分型电荷泵电路，包括：Cascode电流镜电路和开关电路，其中，Cascode电流镜电路包括：基本电流镜和改进Cascode电路，基本电流镜用于复制电流源的电流，并将复制得到的电流输入至改进Cascode电路；改进Cascode电路用于根据电流产生充电电流和放电电流，通过增加的串联MOS管增大开关电路输出的控制电压的摆幅；开关电路为差分型结构的开关电路，用于根据鉴频鉴相器输出的脉冲控制信号，控制Cascode电流镜电路的充电和放电，通过低通滤波器产生控制电压。本发明利用改进的Cascode电路结构降低充放电支路上的过驱动电压，产生一组低失配率的电荷泵充放电电流，经由一级滤波得到宽摆幅的控制电压。
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公开(公告)号：CN117254800A
公开(公告)日：2023-12-19
申请号：CN202311251871.6
申请日：2023-09-26
申请人： 西安电子科技大学重庆集成电路创新研究院
摘要： 本发明公开了一种鉴频鉴相器，包括：启动控制电路，用于基于外部使能信号的控制调整输入参考信号和待锁定信号的状态，并输出信号CLK_ref和CLK_fb；鉴频鉴相器电路，包括两个基于TSPC的D锁存器D1和D2、两条交叉耦合的复位支路R1和R2以及两个Latch锁存结构L1和L2；其中，锁存器D1、复位支路R1以及Latch锁存结构L1用于对输入的信号CLK_ref进行相位检测，并输出差分信号UP和UPb；锁存器D2、复位支路R2以及Latch锁存结构L2用于对输入的信号CLK_fb进行相位检测，并输出差分信号DN和DNb。该鉴频鉴相器的鉴相范围可以达到±2π，能够满足DLL对鉴相范围的设计要求。
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公开(公告)号：CN117118217A
公开(公告)日：2023-11-24
申请号：CN202310980845.0
申请日：2023-08-04
申请人： 西安电子科技大学重庆集成电路创新研究院
摘要： 本发明公开了一种应用于DC/DC转换器的软启动周期时间控制电路，包括：时钟信号产生电路，用于产生第一时钟信号；时钟周期扩展电路，用于对第一时钟信号的周期进行扩展得到第二时钟信号；软启动电路，用于在T内持续输出一固定电压；阶梯电压产生电路，用于根据固定电压在T内生成阶梯电压；在软启动时间内，DC/DC转换器响应于第一PWM信号控制其功率管的导通与关断实现软启动；在软启动时间之后，DC/DC转换器响应于第二PWM信号控制其功率管的导通与关断实现电压变换；第一PWM信号根据反馈电压与阶梯电压的比较结果生成。该软启动周期时间控制电路易于集成、软启动过程有效和稳定，且软启动结束后电压切换过程稳定。
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公开(公告)号：CN117055321A
公开(公告)日：2023-11-14
申请号：CN202311198911.5
申请日：2023-09-15
申请人： 西安电子科技大学重庆集成电路创新研究院
IPC分类号： G04F10/00
摘要： 本发明公开了一种两步多相时钟时间数字转换器的校正电路及校正方法，校正电路包括选择模块和校正模块；选择模块基于细量化信号翻转边沿所处的主时钟电平状态选择对应的正确时钟信号，选择模块将正确时钟信号输入校正模块；校正模块接收正确时钟信号进行校正并产生两组数字校准控制码，利用数字校准控制码对粗量化模块的粗量化计数值进行校正操作，校正操作包括：对粗量化计数值进行保持、加一、加二、减一或减二操作。本发明的校正方法基于上述校正电路。本发明解决了现有技术中D触发器的亚稳态和传输延时失配引起的误差，实现了D触发器的亚稳态误差和传输延时失配误差的校正。
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公开(公告)号：CN116583163A
公开(公告)日：2023-08-11
申请号：CN202310527890.0
申请日：2023-05-11
申请人： 西安电子科技大学重庆集成电路创新研究院
摘要： 本发明公开了一种采用柔性互连的半导体制冷器的制备方法，包括：提供第一基板和第二基板；对第一基板和第二基板进行刻蚀，形成第一导电结构和第二导电结构；提供第一N型半导体颗粒和第一P型半导体颗粒，将其装填在石墨工装中，将第一N型半导体颗粒和第一P型半导体颗粒与第一导电结构进行焊接；提供第二N型半导体颗粒和第二P型半导体颗粒，将其装填在石墨工装中，将第二N型半导体颗粒和第二P型半导体颗粒与第二导电结构进行焊接；在第一N型半导体颗粒与第二N型半导体颗粒之间、及在第一P型半导体颗粒与第二P型半导体颗粒之间焊接铜线。本发明能够保证半导体制冷器的制备品质。
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