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公开(公告)号：CN112468151B
公开(公告)日：2022-01-14
申请号：CN202011287799.9
申请日：2020-11-17
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司
IPC分类号： H03M1/38
摘要： 本发明涉及集成电路技术领域，提供一种DAC电容阵列，该DAC电容阵列对现有的第一电容阵列和第二电容阵列进行拆分以形成第一高段电容阵列、第一低段电容阵列、第二高段电容阵列和第二低段电容阵列；其中，第一高段电容阵列中各电容权重与第一低段电容阵列中各电容权重满足预设比例关系；第一高段电容阵列的上极板与第一低段电容阵列的上极板之间设置有第一连接开关；第二高段电容阵列中各电容权重与第二低段电容阵列中各电容权重满足所述预设比例关系；第二高段电容阵列的上极板与第二低段电容阵列的上极板之间设置有第二连接开关。本发明提供的技术方案，能够极大地缩短SAR型模数转换器在量化过程中电容电压的建立时间，有效提高其量化速度。
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公开(公告)号：CN112383291A
公开(公告)日：2021-02-19
申请号：CN202011248739.6
申请日：2020-11-10
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司 , 国网浙江省电力有限公司 , 国家电网有限公司
摘要： 本发明提供一种数字可控延迟链，属于集成电路技术领域。所述数字可控延迟链，包括：参考电压产生模块，用于将电源电压分压为多个参考电压；数字信号选通模块，用于从多个所述参考电压选择控制电压；时钟延迟模块，用于在所述控制电压的控制下对输入时钟进行延时。本发明提供的数字可控延迟链的时钟延迟模块基于MOS器件的背栅效应，在控制电压的控制下可实现对输入时钟的精确延时，同时具有较好的线性度。
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公开(公告)号：CN112383291B
公开(公告)日：2023-04-28
申请号：CN202011248739.6
申请日：2020-11-10
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司 , 国网浙江省电力有限公司 , 国家电网有限公司
摘要： 本发明提供一种数字可控延迟链，属于集成电路技术领域。所述数字可控延迟链，包括：参考电压产生模块，用于将电源电压分压为多个参考电压；数字信号选通模块，用于从多个所述参考电压选择控制电压；时钟延迟模块，用于在所述控制电压的控制下对输入时钟进行延时。本发明提供的数字可控延迟链的时钟延迟模块基于MOS器件的背栅效应，在控制电压的控制下可实现对输入时钟的精确延时，同时具有较好的线性度。
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公开(公告)号：CN112468151A
公开(公告)日：2021-03-09
申请号：CN202011287799.9
申请日：2020-11-17
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司
IPC分类号： H03M1/38
摘要： 本发明涉及集成电路技术领域，提供一种DAC电容阵列，该DAC电容阵列对现有的第一电容阵列和第二电容阵列进行拆分以形成第一高段电容阵列、第一低段电容阵列、第二高段电容阵列和第二低段电容阵列；其中，第一高段电容阵列中各电容权重与第一低段电容阵列中各电容权重满足预设比例关系；第一高段电容阵列的上极板与第一低段电容阵列的上极板之间设置有第一连接开关；第二高段电容阵列中各电容权重与第二低段电容阵列中各电容权重满足所述预设比例关系；第二高段电容阵列的上极板与第二低段电容阵列的上极板之间设置有第二连接开关。本发明提供的技术方案，能够极大地缩短SAR型模数转换器在量化过程中电容电压的建立时间，有效提高其量化速度。
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公开(公告)号：CN114257214A
公开(公告)日：2022-03-29
申请号：CN202111342282.X
申请日：2021-11-12
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司 , 国网浙江省电力有限公司 , 国家电网有限公司
IPC分类号： H03K3/012
摘要： 本发明实施例提供一种振荡器及芯片，属于电子电路技术领域。该振荡器包括：电流产生电路、比较器电路以及振荡电路，其中，所述电流产生电路用于产生第一基准电流和第二基准电流，并根据所述第一基准电流提供基准电压信号；所述振荡电路包括电容；所述比较器电路连接在所述电容和所述电流产生电路之间，并根据所述基准电压信号以及所述电容的电压信号的大小关系，输出高或低电平，以控制所述电容放电或由流经所述比较器电路的第二基准电流对所述电容充电。该振荡器及芯片可以减少电流支路，达到减少功耗的目的。
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公开(公告)号：CN112272026B
公开(公告)日：2022-01-14
申请号：CN202011262573.3
申请日：2020-11-12
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司
IPC分类号： H03M1/38
摘要： 本发明实施例提供一种逐次逼近式模拟数字转换器系统，属于芯片技术领域。该系统包括：引入抖动器和消除抖动器，其中，所述引入抖动器连接在所述第一电容组和所述数字控制电路之间，用于根据所述比较器的输出信号以及所述数字控制电路输出的第一随机信号，输出控制信号控制所述第一电容组的第K个电容的下极板，以在所述第一电容组的第K个电容处引入抖动；所述消除抖动器连接在所述第二电容组和所述数字控制电路之间，用于根据所述比较器的输出信号以及所述数字控制电路输出的第二随机信号，输出控制信号控制所述第二电容组的第K+1个电容的下极板，以在所述第二电容组的第K+1个电容处消除抖动。本发明可以更好提高无杂散动态范围。
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公开(公告)号：CN112367081A
公开(公告)日：2021-02-12
申请号：CN202011165074.2
申请日：2020-10-27
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司
IPC分类号： H03M1/10
摘要： 本发明实施例提供一种逐次逼近式模拟数字转换器的电容阵列校正系统和方法，属于芯片技术领域。该系统包括：第一比较器、数字逻辑控制器、采样开关组、第一开关组以及第二开关组，其中，采样开关组中的一个采样开关连接在第一电容组的上极板和地之间，另一个采样开关连接在第二电容组的上极板和地之间；第一开关组的一个开关连接在第一比较器的正端和第一电容组的上极板之间，另一个开关连接在第一比较器的负端和第二电容组的上极板之间；第二开关组的一个开关连接在第一比较器的正端和第二电容组的上极板之间，另一个开关连接在第一比较器的负端和第一电容组的上极板之间。本发明能够对逐次逼近式模拟数字转换器的电容阵列进行精确校准。
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公开(公告)号：CN112272026A
公开(公告)日：2021-01-26
申请号：CN202011262573.3
申请日：2020-11-12
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司
IPC分类号： H03M1/38
摘要： 本发明实施例提供一种逐次逼近式模拟数字转换器系统，属于芯片技术领域。该系统包括：引入抖动器和消除抖动器，其中，所述引入抖动器连接在所述第一电容组和所述数字控制电路之间，用于根据所述比较器的输出信号以及所述数字控制电路输出的第一随机信号，输出控制信号控制所述第一电容组的第K个电容的下极板，以在所述第一电容组的第K个电容处引入抖动；所述消除抖动器连接在所述第二电容组和所述数字控制电路之间，用于根据所述比较器的输出信号以及所述数字控制电路输出的第二随机信号，输出控制信号控制所述第二电容组的第K+1个电容的下极板，以在所述第二电容组的第K+1个电容处消除抖动。本发明可以更好提高无杂散动态范围。
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公开(公告)号：CN112367081B
公开(公告)日：2022-01-14
申请号：CN202011165074.2
申请日：2020-10-27
申请人： 北京智芯微电子科技有限公司 , 南开大学 , 国网信息通信产业集团有限公司
IPC分类号： H03M1/10
摘要： 本发明实施例提供一种逐次逼近式模拟数字转换器的电容阵列校正系统和方法，属于芯片技术领域。该系统包括：第一比较器、数字逻辑控制器、采样开关组、第一开关组以及第二开关组，其中，采样开关组中的一个采样开关连接在第一电容组的上极板和地之间，另一个采样开关连接在第二电容组的上极板和地之间；第一开关组的一个开关连接在第一比较器的正端和第一电容组的上极板之间，另一个开关连接在第一比较器的负端和第二电容组的上极板之间；第二开关组的一个开关连接在第一比较器的正端和第二电容组的上极板之间，另一个开关连接在第一比较器的负端和第一电容组的上极板之间。本发明能够对逐次逼近式模拟数字转换器的电容阵列进行精确校准。
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公开(公告)号：CN110263499B
公开(公告)日：2024-03-05
申请号：CN201910670946.1
申请日：2019-07-24
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网上海市电力公司
IPC分类号： G06F30/392 , G06K19/077
摘要： 本发明公开了一种射频标签芯片的版图结构，该版图结构包括：第1版图区、第2版图区、第3版图区、第4版图区、第5版图区、第6版图区、第7版图区和第8版图区，其中，第1版图区分别与第2‑8版图区电连接；第2版图区分别与第1和6版图区电连接；第3版图区分别与第1和6版图区电连接；第4版图区分别与第1和6版图区电连接；第5版图区分别与第1和6版图区电连接；第6版图区分别与第1‑5版图区以及第7‑8版图区电连接；第7版图区分别与第1和6版图区电连接；以及第8版图区分别与第1和6版图区电连接，并覆盖在第3和4版图区上。本发明的版图结构能够显著提升射频标签芯片的存储容量、灵敏度和可靠性。
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