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公开(公告)号：CN1493110A
公开(公告)日：2004-04-28
申请号：CN01822983.2
申请日：2001-03-06
Applicant: 夏普公司
Inventor： 岸野雅彦
CPC classification number: H03M13/3927 , G11B2220/2562 , H03M13/27 , H03M13/276 , H03M13/2957 , H03M13/2975
Abstract: 特播解码器中，为了进行细微的重复控制，在解码处理中，可在选择器/解码计算部(30)中采用前半部分的软判定解码器(10)中输入的上次似然信息(E)和来自用该似然信息E进行解码处理的软判定解码器的新似然信息(E1)，进行输入数据串X的解码处理。
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公开(公告)号：CN1272253A
公开(公告)日：2000-11-01
申请号：CN99800819.2
申请日：1999-05-17
Applicant: 索尼株式会社
IPC: H03M13/23
CPC classification number: H03M13/3972 , H03M13/3905 , H03M13/3911 , H03M13/3922 , H03M13/3927 , H03M13/6566
Abstract: 计算状态数目×舍项长度的Ⅰβ(βt～βt－D+1)之后,边计算此后续的舍项长度以外的Ⅰβ(βt－D～βt－2D+1)边依次对其舍项长度以外软输出进行计算,同时依次计算下一舍项长度的Ⅰβ。这样,解码器4通过以并行方式对舍项长度内的Ⅰβ和逆向舍项长度以上的Ⅰβ进行计算,这样每一时钟的Ⅰβ的计算便为状态数目×2,以很少的计算量即可完成,可以提高解码动作的速度。
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公开(公告)号：CN104052498A
公开(公告)日：2014-09-17
申请号：CN201410096588.5
申请日：2014-03-14
Applicant: 三星电子株式会社
CPC classification number: G11C29/50004 , G06F11/1048 , G06F11/1068 , G11C11/56 , G11C16/34 , G11C29/026 , G11C29/028 , H03M13/3927
Abstract: 提供了一种最优化用于纠正与存储在非易失性存储器设备中的数据有关的错误的对数似然比（LLR）的方法。在该方法中，监控包括在非易失性存储器设备中的多个存储器单元的阈值电压分布的变化，并且基于监控结果更新用于存储器单元的LLR。即使存储器单元的特性退化，LLR仍持续地维持在最优值。
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公开(公告)号：CN101098215A
公开(公告)日：2008-01-02
申请号：CN200710136447.1
申请日：2001-03-07
Applicant: 高通股份有限公司
Inventor： N·辛德伍沙雅那
CPC classification number: H04L1/005 , H03M13/2957 , H03M13/3927 , H03M13/3961 , H03M13/6325 , H03M13/6337 , H03M13/65 , H04L1/0066 , H04L25/067 , H04L27/22 , H04L27/38
Abstract: 一种用于计算turbo解码器的软判决输入度量的方法和装置，包括与8相移键控(8PSK)调制和16正交调辐(16QAM)相关联的电路。在两个实现中，把编码符号上的对数似然比(LLR)度量估计为各种常数值与所解调的软判决的同相和正交分量的各种组合的乘积。在与16QAM调制方案相关联的实现中，还使用载波信号干扰比(C/I)的估计来估计某些LLR度量。还可与例如64QAM、256QAM和16PSK的一般化的平方QAM和M PSK调制方案相结合，来获得所述LLR度量的估计。
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公开(公告)号：CN1302624C
公开(公告)日：2007-02-28
申请号：CN01816376.9
申请日：2001-09-26
Applicant: 英特尔公司
Inventor： J·萨多斯基
CPC classification number: H03M13/3922 , H03M13/2957 , H03M13/3905 , H03M13/3927 , H03M13/3961 , H03M13/41 , H03M13/4107 , H03M13/6502 , H03M13/6569
Abstract: 一种用于对信道比特流解码的系统和方法有效地执行基于格子的操作。所述系统包括蝶式协处理器和数字信号处理器。对于基于格子的编码器，该系统在数字信号处理器的指示下，通过在蝶式协处理器中执行并行运算来对信道比特流解码。所述操作用于实现MAP算法，维特比算法以及其它软或硬输出编码算法。DSP可执行存储器管理以及代表蝶式协处理器进行算法调度。蝶式协处理器可并行执行蝶式运算以增加吞吐量。该系统保持了适用于许多可能的解码环境中的灵活性。
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公开(公告)号：CN1429429A
公开(公告)日：2003-07-09
申请号：CN01809650.6
申请日：2001-03-12
Applicant: 因芬尼昂技术股份公司
CPC classification number: H03M13/3905 , H03M13/2957 , H03M13/3723 , H03M13/3927 , H03M13/3961 , H03M13/6577 , H03M13/658
Abstract: 一种用于解码通过扰动信道发射的数据信号()的增强解码器，具有一个码位估计器(MAP_DEC)和一个数字信号处理器(DSP)。在迭代增强解码的一个计算循环中，码位估计器(MAP_DEC)执行两个码位估计，DSP执行一个交织和反交织过程。双向接口(FMI)用于在码位估计器(MAP_DEC)和DSP之间传输数据。
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公开(公告)号：CN1429428A
公开(公告)日：2003-07-09
申请号：CN01809649.2
申请日：2001-03-12
Applicant: 因芬尼昂技术股份公司
IPC: H03M13/29
CPC classification number: H03M13/3905 , H03M13/2957 , H03M13/3922 , H03M13/3927 , H03M13/3961 , H03M13/3972 , H03M13/658
Abstract: 一种用于解码通过扰动信道发射的数据信号()的增强解码器，具有一个码位估计器(MAP_DEC)。后者包括一个计算装置，根据关于发射机端使用的防错码的知识，计算转换度量值、前向和反向度量值，并根据这些值，计算输出值(LLR)。计算装置包括至少一个由组合逻辑构成的硬件计算芯片(RB1/2/3)，用于产生这些值中的至少一种。
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公开(公告)号：CN107733446B
公开(公告)日：2019-06-07
申请号：CN201610665446.5
申请日：2016-08-12
Applicant: 华为技术有限公司
CPC classification number: H03M13/091 , H03M13/00 , H03M13/1108 , H03M13/13 , H03M13/2927 , H03M13/3927
Abstract: 本发明实施例提供一种译码方法及设备、译码器。该方法包括：接收待译码信号对应的N个LLR，根据先验LLR和/或后验LLR将K个译码比特划分为可靠比特和不可靠比特，根据N个LLR和预设规则生成M条译码路径，可靠比特的下一级路径为1条，不可靠比特的下一级路径为2条，根据M条译码路径的PM值筛选出每一级目标译码路径，得到每一级译码比特的译码结果，当有第一条译码路径的长度达到N时，对第一条译码路径中的K个译码比特进行CRC，若CRC通过，则译码成功；否则继续对下一条长度达到N的译码路径中的K个译码比特进行CRC，若对所有的长度达到N的译码路径中的K个译码比特进行CRC的结果都未通过，则译码失败。
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公开(公告)号：CN107086871A
公开(公告)日：2017-08-22
申请号：CN201710456980.X
申请日：2017-06-16
Applicant: 大连大学
CPC classification number: H03M13/1111 , H03M13/3927
Abstract: 本发明公开了一种码长自适应的LLR‑BP译码器，包括：初始数据缓冲模块、校验节点处理模块、中间信息存储模块、变量节点处理模块、控制模块、输出缓存模块、译码判决模块等。在Xilinx ISE14.7环境下，设计了部分并行LDPC译码器结构，该结构采用提前终止迭代译码策略，有效降低算法迭代次数；采用取极限方法实现LLR‑BP译码算法中复杂概率函数的运算，降低算法实现的复杂度。在保证误码率的前提下，本译码器有效提高了译码速度、降低了硬件逻辑资源占有率，并解决了多码长同时译码的问题。
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公开(公告)号：CN102171937B
公开(公告)日：2016-05-18
申请号：CN200980136319.4
申请日：2009-09-16
Applicant: 美国亚德诺半导体公司
CPC classification number: H03M13/2957 , H03M13/2975 , H03M13/3905 , H03M13/3927 , H03M13/3994 , H04L1/005 , H04L1/0055 , H04L1/0071
Abstract: 一种信道自适应迭代Turbo解码器系统，用于使用MAP解码器来计算所接收数据的窗口的一组分支度量，计算前向递归路径状态度量，计算反向递归路径状态度量，并且从前向递归路径状态度量和反向递归路径状态度量计算1和0的对数似然比，并且交织判决比特；并且，识别非收敛的那些MAP解码器判决比特，计算所接收的数据的一组分支度量，并且从前向和反向递归路径状态度量计算每一个非收敛判决比特的1和0的对数似然比，并且交织非收敛判决比特。
