摘要:
L'invention concerne un générateur (10) d'un signal (out) comprenant une mémoire (12) dans laquelle sont stockées des instructions, chaque instruction comprenant une portion de code (op_code) et une portion d'argument (arg) ; un moyen (20) de lecture successive d'instructions stockées dans la mémoire ; un moyen (14) de décodage adapté à recevoir, pour chaque instruction lue, la portion de code de l'instruction et à fournir un signal d'activation (set_val) qui dépend de la portion de code ; et un moyen (18) de fourniture dudit signal adapté à recevoir, pour chaque instruction lue, la portion d'argument de l'instruction et adapté, en fonction du signal d'activation, à mémoriser la portion d'argument et à fournir ledit signal égal à la portion d'argument ou à fournir ledit signal égal à la portion d'argument précédemment mémorisée.
摘要:
Dans un système sur puce comprenant en outre une CPU (11), une mémoire locale (12) et un module (13) de traitement de données, un contrôleur de DMA (15) comprend une interface (28, 22, 40) avec la mémoire locale (12) pour assurer des transmissions de données, vers et depuis la mémoire locale, associées à une indication à la mémoire locale d'une adresse en mémoire locale et est adapté pour effectuer des écriture et lectures de données dans la mémoire locale via cette interface. Le contrôleur de DMA comprend une troisième (29) avec le module (13) de traitement pour lui transmettre des données lues, via la première interface, dans la mémoire locale, cette transmission n'étant pas associée à une indication au module de traitement, par le contrôleur de DMA, d'adresse.
摘要:
Dans un système sur puce comprenant en outre une CPU (11), une mémoire locale (12) et un module (13) de traitement de données, un contrôleur de DMA (15) comprend une interface (28, 22, 40) avec la mémoire locale (12) pour assurer des transmissions de données, vers et depuis la mémoire locale, associées à une indication à la mémoire locale d'une adresse en mémoire locale et est adapté pour effectuer des écriture et lectures de données dans la mémoire locale via cette interface. Le contrôleur de DMA comprend une troisième (29) avec le module (13) de traitement pour lui transmettre des données lues, via la première interface, dans la mémoire locale, cette transmission n'étant pas associée à une indication au module de traitement, par le contrôleur de DMA, d'adresse.