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    PROTECTION D'UNE TRANSACTION
    3.
    发明公开
    PROTECTION D'UNE TRANSACTION 审中-实审

    公开(公告)号：EP4395187A1

    公开(公告)日：2024-07-03

    申请号：EP23219640.2

    申请日：2023-12-22

    申请人： STMicroelectronics (Rousset) SAS ,  PROTON WORLD INTERNATIONAL N.V.

    发明人： VAN NIEUWENHUYZE, Olivier ,  CHARLES, Alexandre

    IPC分类号： H04B5/00 ,  H04B5/72 ,  H04B5/77

    CPC分类号： H04B5/77 ,  H04B5/72

    摘要： La présente description concerne un dispositif électronique (201) comprenant un processeur (2011) hébergeant une application (2014), un module de communication en champ proche (2012), et un élément sécurisé (2012) distinct du processeur (2011), dans lequel le module de communication en champ proche (2012) est configuré pour identifier le type d'un terminal (203) émettant une trame d'interrogation, à destination de ladite application (2014), que le module de communication reçoit en analysant le type de ladite trame d'interrogation, ledit dispositif (201) étant configuré pour comparer le résultat de ladite analyse avec au moins une commande reçue de la part dudit terminal (203) pendant la mise en oeuvre d'une transaction NFC.

    PROCÉDÉ D'AUTHENTIFICATION
    5.
    发明公开
    PROCÉDÉ D'AUTHENTIFICATION 审中-公开

    公开(公告)号：EP3699793A1

    公开(公告)日：2020-08-26

    申请号：EP20157587.5

    申请日：2020-02-17

    申请人： PROTON WORLD INTERNATIONAL N.V.

    发明人： PEETERS, Michael

    IPC分类号： G06F21/44

    摘要： La présente description concerne un procédé d'authentification d'un premier circuit (400) par un deuxième circuit (300), le deuxième circuit (300) stockant au moins une première donnée (A) et au moins une deuxième donnée (A'), l'image de la deuxième donnée (A') par une première fonction (f) étant égale à la combinaison de la première donnée (A) et d'une troisième donnée (rand), comprenant les étapes successives suivantes :
    - le deuxième circuit (300) envoie, au premier circuit (400), au moins ladite deuxième donnée (A') ;
    - le premier circuit (400) déchiffre ladite deuxième donnée (A') avec la première fonction (f) ; et
    - le premier circuit (400) envoie une quatrième donnée (R) représentative de la première donnée (A) au deuxième circuit (300) pour authentification.

    FONCTION CRYPTOGRAPHIQUE ET AUTHENTIFICATION DE COMPOSANT REMPLAÇABLE POUR IMPRIMANTE
    8.
    发明公开
    FONCTION CRYPTOGRAPHIQUE ET AUTHENTIFICATION DE COMPOSANT REMPLAÇABLE POUR IMPRIMANTE 审中-公开

    公开(公告)号：EP3512153A1

    公开(公告)日：2019-07-17

    申请号：EP19150830.8

    申请日：2019-01-08

    申请人： PROTON WORLD INTERNATIONAL N.V.

    发明人： DAEMEN, Joan ,  PEETERS, Michael

    IPC分类号： H04L9/00

    摘要： La présente description concerne une fonction cryptographique appliquée à un premier mot (a0), un deuxième mot (a1), un troisième mot (a2) et un quatrième mot (a3) comprenant : une multiplication du troisième mot (a2) par le quatrième mot (a3) ; une addition du résultat de la multiplication (31) ; une soustraction du résultat de l'addition au deuxième mot au résultat de l'addition (32) au premier mot ; une addition du résultat de la soustraction (34) ; une combinaison à une constante (Ci) du résultat de l'addition du troisième mot au résultat de la soustraction ; et une multiplication par deux du résultat de ladite combinaison et un décalage circulaire (41, 42, 43) des codes des résultats respectifs de l'addition (36) du quatrième mot au résultat de la soustraction, de l'addition (33) du deuxième mot au résultat de la multiplication, et de l'addition du premier mot au résultat de la multiplication.

    LOGICAL MEMORY UNIT FOR FLASH MEMORY
    9.
    发明公开
    LOGICAL MEMORY UNIT FOR FLASH MEMORY 审中-公开

    公开(公告)号：EP3470989A1

    公开(公告)日：2019-04-17

    申请号：EP18198049.1

    申请日：2018-10-01

    申请人： PROTON WORLD INTERNATIONAL N.V.

    发明人： AHSSINI, Youssef ,  RESTIAU, Guy

    IPC分类号： G06F12/02

    摘要： The invention concerns a Flash memory interface comprising: a memory management unit (302) including a comparator (306) configured to determine whether an address of a Flash memory access operation corresponds to logical or physical address by comparing the address with one or more address ranges; a logical memory unit (304) configured to convert logical addresses into physical addresses and to provide the physical addresses to the Flash memory; wherein the memory management unit (302) is configured to direct physical addresses to the Flash memory and to direct logical addresses to the logical memory unit (302) for conversion into physical addresses.