Invention Application
- Patent Title: ドライエッチング方法および半導体装置の製造方法
- Patent Title (English): Dry etching method and semiconductor device manufacturing method
- Patent Title (中): 干蚀刻方法和半导体器件制造方法
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Application No.: PCT/JP2013/067129Application Date: 2013-06-21
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Publication No.: WO2014203400A1Publication Date: 2014-12-24
- Inventor: 岡本 圭司 , 大関 和之 , 新井 宏征
- Applicant: ルネサスエレクトロニクス株式会社
- Applicant Address: 〒2118668 神奈川県川崎市中原区下沼部1753番地 Kanagawa JP
- Assignee: ルネサスエレクトロニクス株式会社
- Current Assignee: ルネサスエレクトロニクス株式会社
- Current Assignee Address: 〒2118668 神奈川県川崎市中原区下沼部1753番地 Kanagawa JP
- Agency: 筒井 大和
- Main IPC: H01L21/3065
- IPC: H01L21/3065
Abstract:
エッチングマスク開口率とエッチング対象膜のエッチングレートとの相関関係を取得し、第1ウエハに形成した第1導電膜を第1ドライエッチングすることにより、第1導電膜の第1エッチングレートを算出する。次に、第2ウエハに形成した第2導電膜の上に第2エッチングマスクを形成して、第2導電膜を時間制御エッチングで第2ドライエッチングする際に、開口率とエッチングレートとの相関関係と、第1エッチングレートと、第2導電膜の膜厚から第2導電膜のエッチング時間を決めるものである。
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