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公开(公告)号：CN104239252A
公开(公告)日：2014-12-24
申请号：CN201310250186.1
申请日：2013-06-21
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F13/38
CPC classification number: G06F13/1694
Abstract: 本发明实施例提供一种数据存储系统的数据传输方法、装置及系统。该数据传输方法包括：通过数据传输设备上配置的中央处理器接口接收中央处理器发送的数据传输指令，获得与地址前置码对应的目标存储介质，将数据传输指令通过与目标存储介质连接的目标存储介质接口发送到目标存储介质，在目标存储介质中执行数据传输指令，其中，每一个地址前置码分别对应至少两个不同类型的存储介质中的一个。中央处理器可以通过数据传输设备上设置的一个中央处理器接口相连，从而完成中央处理器与不同存储介质的连接，进而节省了中央处理器针脚资源，提高了中央处理器针脚资源的利用率。
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公开(公告)号：CN104166647A
公开(公告)日：2014-11-26
申请号：CN201310181769.3
申请日：2013-05-16
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
CPC classification number: Y02D10/45 , G06F13/1668
Abstract: 本发明公开了一种数据拷贝的方法、装置和系统，该方法采取控制与第一记录介质、第二记录介质分别对应的第一地址命令总线和第二地址命令总线上的读写时序，即通过第一地址命令总线向第一记录介质发送读命令和通过第二地址命令总线向第二记录介质发送写命令，使得第二记录介质从数据总线上接收第一记录介质发送的数据，从而快速直接地完成数据的拷贝，解决了现有拷贝方法中步骤繁琐、路径冗长的问题，减少了数据拷贝对内存带宽的占用，同时可降低功耗。
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公开(公告)号：CN104133780A
公开(公告)日：2014-11-05
申请号：CN201310159064.1
申请日：2013-05-02
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/08
CPC classification number: G06F12/0862 , G06F2212/1016 , G06F2212/1021 , G06F2212/602 , G06F2212/6026 , G06F2212/608
Abstract: 本发明实施例提供一种跨页预取方法、装置及系统，能够提高预取设备的预取命中率，进而使得访问内存的效率提高。其中，所述方法包括：接收高速缓存寄存器发送的物理地址缺失的指示消息，所述指示消息携带被映射的第一物理地址、所述第一物理地址所属的第一物理页的连续信息；根据所述第一物理地址和预取设备中存储的步长，获取预取地址；若所述预取地址所属的物理页与所述第一物理页的页号不同，且根据所述第一物理页的连续信息确定所述第一物理页连续，预取所述预取地址中的数据。本发明适用于计算机领域。
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公开(公告)号：CN103988186A
公开(公告)日：2014-08-13
申请号：CN201280001334.X
申请日：2012-10-12
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F13/00
CPC classification number: G06F13/1621 , G06F13/1684 , G06F13/1689 , G11C5/04 , G11C5/06 , G11C7/1003 , G11C8/12
Abstract: 本发明实施例提供一种内存系统、内存模块、内存模块的访问方法以及计算机系统，通过在内存模块中增加一个或多个内存模块间互连接口，使内存系统中分属于不同内存通道的多个内存模块能够通过该内存模块间互连接口建立通信连接，进而使得该内存系统中的内存模块可以同时被多个内存通道所访问，从而在某一内存通道负载过大的时候，实现通过另一负载较轻的内存通道对该负载过大的内存通道上的内存模块的访问，一定程度上解决了内存通道负载不均衡的情况，有效提高了内存通道的利用率。
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公开(公告)号：CN103902632A
公开(公告)日：2014-07-02
申请号：CN201210590105.8
申请日：2012-12-31
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
CPC classification number: G06F17/30914 , G06F17/30067 , G06F17/30091 , G06F17/30233 , G06F17/30094
Abstract: 本发明涉及数据存储领域，特别是涉及一种键值存储系统中构建文件系统的方法、装置及电子设备。在本发明所公开的键值存储系统中构建文件系统的方法，首先获取各级目录的目录路径对应的目录编号，再根据所述目录编号以及各级目录下所存储的文件，构建目录和文件相应的关键字Key，这种情况下，由于所述关键字Key中的目录编号所占的空间较小，且各个目录编号为唯一的，不存在重复的现象，有效节省了存储空间；另外，根据所述目录编号构建了与所述目录相对应的目录关键字Key，在需要对目录进行操作时，可直接根据目录的关键字Key获取待操作的目录，操作过程得到简化。
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Patent Agency Ranking
公开(公告)号：CN103902469A
公开(公告)日：2014-07-02
申请号：CN201210571705.X
申请日：2012-12-25
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/08
Abstract: 本发明公开了一种数据预取的方法和系统。本发明实施例采用预先对本地终端和与本地终端相连的远端终端设置不同的预取深度值，当预取系统接收到处理器发送的访存地址时，对该访存地址所属的终端进行区分判断，从而得到相应的预取深度值。本发明可在不增设额外预取系统情况下提高高速缓存命中率，降低访问远端内存的时延，降低了成本。同时提供软件编程接口，可在运行时动态修改各终端对应的预取深度值。
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公开(公告)号：CN103902352A
公开(公告)日：2014-07-02
申请号：CN201210587126.4
申请日：2012-12-28
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
Abstract: 本发明实施例提供一种多核虚拟机系统获取请求数据的方法和装置，该方法包括：当根据数据读取请求在本地缓冲存储器中发生访存读取失败时，识别数据读取请求的请求数据是否为客户虚拟机与管理虚拟机的共享数据；当请求数据为共享数据时，确定管理虚拟机所对应的缓冲存储器；在确定的缓冲存储器中查询获取请求数据。缩小了获取请求数据的查询范围，提高了在多核虚拟机系统中获取请求数据的效率。
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公开(公告)号：CN103647722A
公开(公告)日：2014-03-19
申请号：CN201310585237.6
申请日：2013-11-19
Applicant: 中国科学院计算技术研究所
IPC: H04L12/801
Abstract: 一种基于信誉的链路拥塞控制方法，在链路的每一跳间将拥塞控制和信誉流控相融合，通过接收方信誉值调节发送方发送速率，以避免链路的拥塞，包括如下步骤：发送方初始化自身维护的初始信息，所述初始信息包括发送计数、接收方信誉值和当前发送窗口大小；计算并维护发送阈值，根据接收方的可接收缓存数量确定一发送阈值，并以该发送阈值作为发送方调节发送速率的依据；根据该发送阈值调节发送方发送速率，根据所述发送阈值，自动调节该发送窗口大小，避免接收方缓存溢出产生丢包。
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公开(公告)号：CN103647625A
公开(公告)日：2014-03-19
申请号：CN201310584995.6
申请日：2013-11-19
Applicant: 中国科学院计算技术研究所
Abstract: 一种基于链路的数据可靠传输方法，包括如下步骤：主动请求和应答，发送方发送请求消息并接受接收方的初始确认消息，该初始确认消息包括初始的数据包信息和接收方的初始信誉信息；数据正确传输与确认，当接收方收到所述发送方继续发送的请求消息时，回复确认消息，所述确认消息中包括数据接收的确认信息和此时所述接收方的信誉信息，发送方根据收到的该确认消息释放已确认的数据包缓存，并对应更新该发送方的信誉信息；数据错误传输下的重传，当接收方发现所述数据传输错误或丢包时，回复重传确认消息，所述重传确认消息包括重传标志位置位信息，发送方收到该重传确认消息后，从该重传标志位置位开始重传数据包。
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公开(公告)号：CN108415728B
公开(公告)日：2020-12-29
申请号：CN201810170641.X
申请日：2018-03-01
Applicant: 中国科学院计算技术研究所
IPC: G06F9/302 , G06F9/312 , G06F1/3234
Abstract: 本发明提供一种用于处理器的扩展浮点运算指令执行方法，包括下列步骤：1)取出扩展浮点运算指令，该指令中至少包括定点运算的操作数存放寄存器字段和定点运算结果存放位置字段；2)对扩展浮点运算进行译码，分解成对应于一系列微操作的控制信号；3)将步骤2)所得的控制信号派发至浮点寄存器、定点运算逻辑单元以及存放运算结果的目标寄存器；4)基于被派发的控制信号，处理器寻址到存放定点运算的操作数的浮点寄存器并将操作数取出；5)通过扩展路径将操作数从浮点寄存器传输到定点运算逻辑单元；6)定点运算逻辑单元将运算结果传输到扩展浮点运算指令中的运算结果存放位置。本发明还提供了相应的用于处理器的扩展浮点运算指令执行装置。
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