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公开(公告)号:CN105144082B
公开(公告)日:2020-02-14
申请号:CN201280077266.5
申请日:2012-12-28
申请人: 英特尔公司
发明人: D·R·萨巴瑞迪 , G·N·斯里尼瓦萨 , D·A·考法蒂 , S·D·哈恩 , M·奈克 , P·纳凡兹 , A·帕拉哈卡兰 , E·高巴托夫 , A·纳韦 , I·M·索迪 , E·威斯曼 , P·布莱特 , G·康纳 , R·J·芬格
IPC分类号: G06F9/06 , G06F1/3293 , G06F9/46 , G06F9/44
摘要: 处理器包括支持不同的核类型的多个逻辑核的多个物理核,其中核类型包括大核类型和小核类型。多线程应用程序包括由逻辑核的第一子集在第一时隙并发地执行的多个软件线程。基于从监测在第一时隙执行收集到的数据,处理器选择逻辑核的第二子集,用于软件线程在第二时隙的并发执行。第二子集中的每一个逻辑核都具有匹配软件线程中的一个的特征的一种核类型。
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公开(公告)号:CN105103122B
公开(公告)日:2018-09-18
申请号:CN201380062284.0
申请日:2013-06-25
申请人: 英特尔公司
发明人: P·纳凡兹 , G·N·斯里尼瓦萨 , E·高巴托夫 , D·R·萨巴瑞迪 , M·奈克 , A·纳韦 , A·帕拉哈卡兰 , E·威斯曼 , D·A·考法蒂 , P·布莱特 , S·D·哈恩 , A·J·赫德瑞奇 , G·康纳 , R·J·芬格 , B·E·贝格比 , A·D·亨罗伊德
摘要: 描述了异构处理器架构。例如,根据本发明的一个实施例的处理器包括:两个或更多小型物理处理器核的集合;至少一个大型物理处理器核,具有相对于小型物理处理器核的相对较高性能的处理能力和相对较高的功率使用;虚拟到物理V‑P映射逻辑,用于通过虚拟核的对应集合将两个或更多小型物理处理器核的集合暴露给软件并且对该软件隐藏至少一个大型物理处理器核。
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公开(公告)号:CN105144086B
公开(公告)日:2018-03-09
申请号:CN201380062283.6
申请日:2013-06-27
申请人: 英特尔公司
发明人: P·纳凡兹 , G·N·斯里尼瓦萨 , E·高巴托夫 , D·R·萨巴瑞迪 , M·奈克 , A·纳韦 , A·帕拉哈卡兰 , E·威斯曼 , D·A·考法蒂 , P·布莱特 , S·D·哈恩 , A·J·赫德瑞奇 , I·M·索迪 , G·康纳 , R·J·芬格 , B·E·贝格比 , A·D·亨罗伊德
CPC分类号: G06F9/3891
摘要: 描述了异构处理器架构。例如,根据本发明的一个实施例的处理器包括:大型物理处理器核的集合;小型物理处理器核的集合,这些小型物理处理器核具有相对于大型物理处理器核的相对较低的性能处理能力和相对较低的功率使用;虚拟到物理(V‑P)映射逻辑,用于通过虚拟核的对应集合将大型物理处理器核的集合暴露给软件,并且对该软件隐藏小型物理处理器核的集合。
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公开(公告)号:CN105103122A
公开(公告)日:2015-11-25
申请号:CN201380062284.0
申请日:2013-06-25
申请人: 英特尔公司
发明人: P·纳凡兹 , G·N·斯里尼瓦萨 , E·高巴托夫 , D·R·萨巴瑞迪 , M·奈克 , A·纳韦 , A·帕拉哈卡兰 , E·威斯曼 , D·A·考法蒂 , P·布莱特 , S·D·哈恩 , A·J·赫德瑞奇 , G·康纳 , R·J·芬格 , B·E·贝格比 , A·D·亨罗伊德
IPC分类号: G06F9/44
CPC分类号: G06F9/45558 , G06F9/3885 , G06F9/5077 , G06F2009/4557
摘要: 描述了异构处理器架构。例如,根据本发明的一个实施例的处理器包括:两个或更多小型物理处理器核的集合;至少一个大型物理处理器核,具有相对于小型物理处理器核的相对较高性能的处理能力和相对较高的功率使用;虚拟到物理(V-P)映射逻辑,用于通过虚拟核的对应集合将两个或更多小型物理处理器核的集合暴露给软件并且对该软件隐藏至少一个大型物理处理器核。
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公开(公告)号:CN104823129A
公开(公告)日:2015-08-05
申请号:CN201380062332.6
申请日:2013-06-24
申请人: 英特尔公司
CPC分类号: G06F9/44 , G06F1/324 , G06F1/329 , G06F1/3296 , G06F9/5094 , G09G5/363 , G09G2330/021 , Y02D10/126 , Y02D10/172 , Y02D10/22 , Y02D10/24
摘要: 一种用于处理器的智能功率分配架构。例如,处理器的一个实施例包括:多个处理器组件,用于执行对应的多个处理器功能;多个功率平面,每一个功率平面与多个处理器组件中的一个相关联;以及功率控制单元(PCU),用于基于针对处理器的当前使用的用户体验度量、工作负荷特性和功率约束来动态地调节去往多个功率平面中的每一个功率平面的功率。
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