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公开(公告)号：CN103795345B
公开(公告)日：2016-08-17
申请号：CN201410050499.7
申请日：2014-02-13
申请人： 深圳市汇顶科技股份有限公司
发明人： 王光耀
IPC分类号： H03B28/00
CPC分类号： G06F1/0321 , G06F1/022 , G06F1/03 , G06F1/0328 , G06F1/035 , H03K3/012
摘要： 本发明提出一种正弦波生成装置和方法。其中该装置包括：相位累加模块，用于获取正弦波的配置信息，并根据配置信息生成正弦波的地址信息，其中地址信息包括整数地址信息和小数地址信息；查值模块，用于根据整数地址信息查找正弦波的第一和第二数据信息；插值模块，用于根据小数地址信息的位宽在第一和第二数据信息之间进行插值，并根据小数地址信息获取正弦波的插值原始数据信息；随机截位模块，用于根据小数地址信息的位宽和伪随机序列输出值对插值原始数据进行截位处理，以获取正弦波的最终插值数据信息；以及正弦波生成模块，用于生成正弦波的图像信息。本发明实施例的装置，利用面积更小的数字电路，可产生频率更加丰富和精准的正弦波。
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公开(公告)号：CN103580653A
公开(公告)日：2014-02-12
申请号：CN201310320613.9
申请日：2013-07-26
申请人： 特克特朗尼克公司
发明人： R.萨凯
IPC分类号： H03K3/02
CPC分类号： G06F1/0321
摘要： 波形发生器具有波形产生电路，其存储具有死时间期的模拟波形信号的波形数据而不需要存储关于死时间的数据。具有序列存储器的定序器存储序列数据，其控制模拟波形信号的一个或多个信号分量以及关联的死时间的定序。死时间的定时由采样时钟和等待时间计数器控制。信号分量的产生由对存储采样分量的数字数据的波形存储器控制地址的产生的采样时钟控制。波形存储器数字数据被转换成模拟波形信号。
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公开(公告)号：CN103346791A
公开(公告)日：2013-10-09
申请号：CN201310226152.9
申请日：2013-06-07
申请人： 香港应用科技研究院有限公司
IPC分类号： H03L7/24
CPC分类号： G06F1/0321 , G06F1/0328 , G06F1/0353 , G06F1/0356
摘要： 本发明披露了一种用于直接数字频率合成器（DDS）的正弦波发生器，其将数字相位输入转换成数字正弦波输出。只读存储器（ROM）存储第一象限中较高粗值相位所对应的正弦值和斜率。其它三个象限的幅值通过象限折叠和分相器将第一象限的值镜像或者反转得到。只读存储器（ROM）所存储的每个正弦值和斜率对应一定范围内的较低相位比特。Delta值有条件地反转较低相位比特、正弦值、和最终极性。简化的AND逻辑阵列将斜率和有条件地反转的较低相位比特相乘。然后重建ADD逻辑阵列再将有条件地反转的正弦值加上。再添加上有条件地反转的极性，就得到最终正弦值。基于Delta值的有条件的反转，极大的精简以及优化了正弦产生逻辑。
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公开(公告)号：CN100350742C
公开(公告)日：2007-11-21
申请号：CN200480001585.3
申请日：2004-01-23
申请人： 阿纳洛格装置公司
发明人： 唐纳尔·P.·加拉蒂 , 阿伯特·C.·奥格拉迪 , 都多·M.·维内拉纽
IPC分类号： H03K4/02
CPC分类号： G06F1/025 , G06F1/0321 , H03K4/026
摘要： 一种用于产生方波波形的模拟电压输出信号的信号发生器(1)包括一个在输出终端(5)输出模拟电压信号的芯片级DAC(12)。芯片级第一和第二可编程寄存器(9、10)保存对应于模拟输出信号的最大和最小电压值的第一和第二数码字。一个芯片级开关电路(15)选择性和交替地将所述第一和第二寄存器(9、10)切换至一个芯片级DAC寄存器(17)，从其上响应于一个由控制电路(14)产生的加载DAC信号将所述第一和第二数码字加载进DAC(12)。所述加载DAC信号响应于一个施加给LDAC终端(22)的时钟信号形式的外部产生的LDAC信号而产生。响应于加载DAC信号，触发器(19)在控制线(25)上输出控制信号，以交替地向DAC寄存器(17)切换第一和第二寄存器(9、10)。模拟输出信号的频率由LDAC信号的频率来确定，并且是LDAC信号频率的一半。
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公开(公告)号：CN1253332A
公开(公告)日：2000-05-17
申请号：CN99123176.7
申请日：1999-10-27
申请人： 朗迅科技公司
发明人： 罗伯特·伊沃里斯特·约翰森
IPC分类号： G06F7/46
CPC分类号： G06F1/0321
摘要： 一种数字综合器包括:含有代表诸如正弦波之类的信号的波形值的存储器;用于变换来自存储器的输出为模拟信号的数模变换器;和用于通过预定的固定增量进行计数的计数器,该计数器工作在高频率,能够产生非常精确的波形。该数字综合器具有许多实际的应用,包括从输入射频信号提取信息的精确信号的产生,从低成本时钟获得精确的频率,和用作FSK调制器的一个部件,允许在多个频率的信号之间进行选择,而没有任何相位不连续。
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公开(公告)号：CN105450224B
公开(公告)日：2018-07-27
申请号：CN201410340412.X
申请日：2014-07-16
申请人： 无锡华润上华科技有限公司
发明人： 吴骅刚
IPC分类号： H03L7/24
CPC分类号： G06F1/0321 , G06F1/022 , H03L7/16
摘要： 本发明公开种直接数字频率合成方法,包括以下步骤:相位累加模块根据频率合成字计算得到第相位;根据所述第相位,通过预设的正弦查找表查找得到幅度值;根据所述幅度值,通过预设的相位查找表查找得到第二相位;若所述第二相位小于第相位,则对所述幅度值进行调整后输出;否则输出原幅度值;数模转换器根据输出的幅度值进行数模转换得到正弦波输出;其中,对于N位的相位累加模块和D位的数模转换器,所述预设的相位查找表包含2‑1个对应于0~2‑2幅度的相位边界值记录,每个相位边界值采用N‑2位存储。还公开种应用上述方法的直接数字频率合成器。上述方法和合成器可以以较低的成本提高频率调节精度。
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公开(公告)号：CN103580653B
公开(公告)日：2017-09-29
申请号：CN201310320613.9
申请日：2013-07-26
申请人： 特克特朗尼克公司
发明人： R.萨凯
IPC分类号： H03K3/02
CPC分类号： G06F1/0321
摘要： 波形发生器具有波形产生电路，其存储具有死时间期的模拟波形信号的波形数据而不需要存储关于死时间的数据。具有序列存储器的定序器存储序列数据，其控制模拟波形信号的一个或多个信号分量以及关联的死时间的定序。死时间的定时由采样时钟和等待时间计数器控制。信号分量的产生由对存储采样分量的数字数据的波形存储器控制地址的产生的采样时钟控制。波形存储器数字数据被转换成模拟波形信号。
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公开(公告)号：CN106774628A
公开(公告)日：2017-05-31
申请号：CN201611089823.1
申请日：2016-12-01
申请人： 中国电子科技集团公司第四十一研究所
IPC分类号： G06F1/03
CPC分类号： G06F1/0321
摘要： 本发明涉及测试技术领域，具体涉及一种多通道任意波形编辑装置，包括多路并行设置的DDS频率合成通道，每一路所述DDS频率合成通道包括参数配置计算单元、参数定点化及传递单元、波形编辑合成单元和信号调理单元。本发明采用软件无线电技术，在PC端编辑波形序列，在DSP中进行参数计算，FPGA中并行传输和波形控制，可以实现多种规则的和非规则的波形信号的发生，采用改进型的DDS技术，大大消除了频率和脉宽误差，解决了现有DDS技术下脉宽调节分辨率不高的问题。
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公开(公告)号：CN106647927A
公开(公告)日：2017-05-10
申请号：CN201611091553.8
申请日：2016-12-01
申请人： 合肥鼎驰仪器有限公司
IPC分类号： G06F1/03
CPC分类号： G06F1/0321
摘要： 本发明公开了一种基于DDS的高分辨率信号发生器。包括FPGA模块上集成有微处理器、PLL时钟、单片机扩展接口、存储器ROM和DDS组件模块；FLASH存储器和SDRAM存储器均用于存储输入信号，并将DDS组件模块处理后得到的输入信号的输出数据存入存储器ROM，从存储器ROM中读取函数ROM表中的数据，处理后将数据发送至DAC转换模块得到波形信号输出。本发明通过在FPGA的片上集成DDS组件、单片机扩展接口和PLL，得到较高的频率分辨率、较宽的频率带宽，提高波形频率的稳定性；实现宽带扫频信号输出，具有相位噪声低，杂散抑制好，跳频速度快；用于接入不同控制类型的单片机作为控制器件，使得该信号发生器具有高度的开发性。
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公开(公告)号：CN103125074B
公开(公告)日：2016-05-11
申请号：CN201080069318.5
申请日：2010-09-28
申请人： 三菱电机株式会社
CPC分类号： H03M1/66 , G06F1/0321 , G06F13/4059
摘要： 本发明中的D/A变换装置的特征在于，具有：波形数据列存储单元，其存储由多个数字值构成的波形数据列；波形输出形式数据存储单元，其对用于指定波形输出周期的波形输出形式数据进行存储；数字值输出单元，其每隔所述波形输出周期，从所述波形数据列存储单元依次读取所述数字值并输出所述数字值；以及D/A变换单元，其将所述数字值输出单元输出的所述数字值变换为模拟数据值。
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