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公开(公告)号:CN105408951A
公开(公告)日:2016-03-16
申请号:CN201480041614.2
申请日:2014-07-22
Applicant: 三星电子株式会社
IPC: G09G5/00
CPC classification number: G06F1/3265 , G06F1/3206 , G06F9/44 , G09G3/20 , G09G2320/0626 , G09G2330/021 , G09G2340/14 , Y02D10/153
Abstract: 本发明涉及一种用于控制电子设备的显示器的方法和装置。根据本发明的用于控制电子设备的显示器的方法可以包括步骤:识别电子设备的电力状态和至少一个应用的电力评级;基于识别的结果来确定至少一个应用的应用电力状态;以及根据所确定的应用电力状态来控制电子设备的显示器。
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公开(公告)号:CN113807493A
公开(公告)日:2021-12-17
申请号:CN202011402051.9
申请日:2020-12-02
Applicant: 三星电子株式会社
Abstract: 提供了执行浮点运算的神经网络设备及其操作方法。神经网络设备通过使用模拟交叉开关阵列执行针对块浮点格式的权重和输入激活的分数的乘积累加(MAC)运算,通过使用数字计算电路执行针对块浮点格式的权重和输入激活的共享指数的加法运算,和通过对MAC运算的结果与所述加法运算的结果进行组合来输出浮点输出激活的部分和。
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公开(公告)号:CN117742660A
公开(公告)日:2024-03-22
申请号:CN202310281360.2
申请日:2023-03-21
Applicant: 三星电子株式会社
IPC: G06F7/544
Abstract: 提供了一种计算存储设备和使用该计算存储设备的方法。该计算存储设备包括:存储体和权重存储块,存储体被配置为存储神经网络模型的权重数据,权重存储块被配置为响应于权重请求,提供来自存储体的至少一些权重数据;计算存储块,物理地堆叠在权重存储块上,使得计算存储块和权重存储块中的相应块的面彼此面对,该计算存储块被配置为通过使用包括比特单元的比特单元阵列来在至少一些权重数据和至少一些输入数据之间执行乘法累加(MAC)运算;以及通信接口,被配置为在权重存储块和计算存储块之间执行通信。
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公开(公告)号:CN117636956A
公开(公告)日:2024-03-01
申请号:CN202310943369.5
申请日:2023-07-28
Applicant: 三星电子株式会社
IPC: G11C11/419 , G06N3/063
Abstract: 提供存储器内计算(IMC)电路和设备、以及神经网络设备。所述存储器内计算(IMC)电路包括:多个存储器存储体,每个存储器存储体包括位单元和运算器,位单元被配置为存储权重值,运算器被配置为接收输入值,运算器与位单元连接,使得运算器在接收到输入值时输出输入值与权重值之间的逻辑运算结果;以及逻辑门,被配置为接收所述多个存储器存储体中的每个的逻辑运算结果。
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公开(公告)号:CN117742786A
公开(公告)日:2024-03-22
申请号:CN202310817771.9
申请日:2023-07-05
Applicant: 三星电子株式会社
Abstract: 提供通过存储器处理器执行的计算方法和存储器装置。所述存储器处理器被配置为执行包括多个第一元素的第一向量与包括多个第二元素的第二向量之间的运算,所述多个第一元素中的每个包括多个第一位,并且所述多个第二元素中的每个包括多个第二位,通过所述存储器处理器执行的所述计算方法包括:将所述多个第一元素的第一位和所述多个第二元素的第二位施加到多个单个位运算门;基于使用所述多个单个位运算门获得的多个位运算结果,获得所述多个第一元素和所述多个第二元素的多个位运算结果和值;以及基于所述多个位运算结果和值,获得第一向量和第二向量的运算结果。
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公开(公告)号:CN113837371A
公开(公告)日:2021-12-24
申请号:CN202011409845.8
申请日:2020-12-04
Applicant: 三星电子株式会社
Abstract: 提供了一种用于实现神经网络的神经形态装置和方法。所述神经形态装置包括:存储器,其中存储有至少一个程序;片上存储器,包括交叉开关矩阵阵列电路;和至少一个处理器,被配置为通过执行所述至少一个程序来驱动神经网络。所述至少一个处理器还被配置为:将二进制权重值存储在包括在交叉开关矩阵阵列电路中的突触电路中;从存储器获得输入特征图;将输入特征图转换成时域二进制向量。此外所述至少一个处理器还被配置为:将时域二进制向量作为输入值提供给交叉开关矩阵阵列电路;和通过执行二进制权重值与时域二进制向量之间的卷积计算来输出输出特征图。
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