一种应用于卫星平台的高速基带数据处理装置

    公开(公告)号:CN113364514A

    公开(公告)日:2021-09-07

    申请号:CN202110603731.5

    申请日:2021-05-31

    Abstract: 本发明公开了一种应用于卫星平台的高速基带数据处理装置,若干组帧机构用于接收外部数据并进行组帧;若干加密机构用于接收组帧机构组帧后的数据并进行加密;若干编码机构用于接收加密机构加密后的数据并进行编码。组帧机构之间经组帧交换网络模块实现数据互相传递,组帧机构经组帧交换网络模块将数据输送至加密机构。加密机构之间经加密交换网络模块实现数据互相传递,加密机构经加密交换网络模块将数据输送至编码机构。编码机构之间经加密交换网络模块实现数据互相传递,编码机构经编码交换网络模块将数据输送至外部。本发明基于分布式网络的可扩展算法阵列,可极大提高卫星平台上算法装置设计的灵活性,按载荷数据需求灵活配置处理能力和能效。

    一种扩频解调仿真验证系统

    公开(公告)号:CN114389719B

    公开(公告)日:2023-06-20

    申请号:CN202210003987.7

    申请日:2022-01-04

    Abstract: 本发明涉及一种扩频解调仿真验证系统,包括:仿数据信号源生成模块、仿正弦余弦波生成模块、仿码偏自适应调整的扩频码生成模块、仿扩频调制模块、仿解调数据接收模块、仿工作状态检测模块和记分板模块。本发明适用于卫星产品中扩频基带处理FPGA的地面仿真验证,可通过更改参数进行仿真环境的配置,从而模拟扩频调制系统在多普勒频偏为任意值情况下,尤其是在动态扫频情况下验证扩频解调模块FPGA各个模块工作的正确性。同时本发明还可根据FPGA输出的反馈AGC值调整FPGA输入的中频信号,为基带处理FPGA提供闭环的仿真环境。

    一种扩频解调仿真验证系统

    公开(公告)号:CN114389719A

    公开(公告)日:2022-04-22

    申请号:CN202210003987.7

    申请日:2022-01-04

    Abstract: 本发明涉及一种扩频解调仿真验证系统,包括:仿数据信号源生成模块、仿正弦余弦波生成模块、仿码偏自适应调整的扩频码生成模块、仿扩频调制模块、仿解调数据接收模块、仿工作状态检测模块和记分板模块。本发明适用于卫星产品中扩频基带处理FPGA的地面仿真验证,可通过更改参数进行仿真环境的配置,从而模拟扩频调制系统在多普勒频偏为任意值情况下,尤其是在动态扫频情况下验证扩频解调模块FPGA各个模块工作的正确性。同时本发明还可根据FPGA输出的反馈AGC值调整FPGA输入的中频信号,为基带处理FPGA提供闭环的仿真环境。

    一种应用于卫星平台的高速基带数据处理装置

    公开(公告)号:CN113364514B

    公开(公告)日:2022-08-26

    申请号:CN202110603731.5

    申请日:2021-05-31

    Abstract: 本发明公开了一种应用于卫星平台的高速基带数据处理装置,若干组帧机构用于接收外部数据并进行组帧;若干加密机构用于接收组帧机构组帧后的数据并进行加密;若干编码机构用于接收加密机构加密后的数据并进行编码。组帧机构之间经组帧交换网络模块实现数据互相传递,组帧机构经组帧交换网络模块将数据输送至加密机构。加密机构之间经加密交换网络模块实现数据互相传递,加密机构经加密交换网络模块将数据输送至编码机构。编码机构之间经加密交换网络模块实现数据互相传递,编码机构经编码交换网络模块将数据输送至外部。本发明基于分布式网络的可扩展算法阵列,可极大提高卫星平台上算法装置设计的灵活性,按载荷数据需求灵活配置处理能力和能效。

    一种异步多比特信号跨时钟域处理方法及装置

    公开(公告)号:CN113821075A

    公开(公告)日:2021-12-21

    申请号:CN202111134680.2

    申请日:2021-09-27

    Abstract: 本发明公开了异步多比特信号跨时钟域处理方法及装置,该方法包括:S100:获取基于第一时钟域的初始信号;S200:将所述第一时钟域下的初始信号依次基于第二时钟域进行一级、二级、三级同步处理,得到同步后基于第二时钟域下的二级同步信号和三级同步信号;S300:将基于所述第二时钟域时序逻辑下的二级同步信号与三级同步信号进行判断,若二级同步信号与三级同步信号的值相等,则输出三级同步信号的值,否则输出值保持上一时刻的值不变。本发明基于对异步多比特信号的三级同步后,对同步后的值进行判断,最终将一个周期的非预期值进行滤除,成功还原了原信号特性。该种方法简单易实现,且占用逻辑资源少。

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