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发明公开
一种精密同步时钟的实现方法无效

公开(公告)号：CN101114896A

公开(公告)日：2008-01-30

申请号：CN200710106948.5

申请日：2007-05-15

申请人： 北京东土科技股份有限公司

发明人： 张鸿雁 , 张国刚 , 王贵涛 , 陈凡民 , 马化一 , 薛百华

IPC分类号： H04L7/00 , H04L12/24

摘要： 本发明是一种精密同步时钟的实现方法，本发明传输同步时钟的精度可达到亚微妙级；本发明采用硬件FPGA检测精密同步时钟协议报文、维护时钟、软件(CPU)计算、校正的方法来实现。FPGA内部设计了五个模块：时钟管理模块(timer_manager)，smii接口模块(smii_interface)，报文解析模块(packet_check)，spi接口模块(spi_interface)，系统状态指示模块。来保证时间戳的正确获取、维护系统时钟；软件部分设计了七个模块：数据报文收发模块、定时器模块、Sync处理模块、Follow_Up处理模块、Delay_Req处理模块、Delay_Resp处理模块、管理模块，来保证精密同步时钟协议报文的发送、接收；系统时钟校正等。