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公开(公告)号：CN117896291A
公开(公告)日：2024-04-16
申请号：CN202410243723.8
申请日：2024-03-04
申请人： 北京智芯微电子科技有限公司 , 北京交通大学
IPC分类号： H04L43/0852 , H04L41/12
摘要： 本发明公开了一种端到端时延确定方法、装置、设备、介质及芯片。该方法包括：获取端到端对应的业务流集合；获取业务流集合中每个业务流对应的链路集合；基于业务流集合中每个业务流对应的链路集合构建有向图，其中，有向图的顶点为链路，有向图的边为链路之间的关系；对有向图的顶点进行拓扑排序，得到拓扑序列；根据拓扑序列计算链路上的业务流对应的转发时延；通过本发明的技术方案，能够直接应用到达曲线与服务曲线参数，对业务流端到端时延进行计算分析，为时间敏感网络的业务流时延分析提供了有效手段。
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公开(公告)号：CN117729162A
公开(公告)日：2024-03-19
申请号：CN202311767156.8
申请日：2023-12-21
申请人： 北京交通大学
摘要： 本发明公开了一种异步终端确定性接入机制的冲突解决方法，包括以下步骤：步骤1：冲突解决机制：基于异步终端传输确定性接入方法，在数据流进行发送时间点的调度之后，可以得到异步数据流fi以及其他所有路由中包含链路(Vn‑1，Vn)的数据流，记做Fo的发送时间点，将其作为输入，计算得到异步数据流fi在交换机Vn‑1上的发送时间点与Fo所有发送时间点之间的最小间隔fi.minGap；异步数据流fi的抖动范围如下所示：0≤fi.jitter≤fi.period‑fi.minGap通过此方法便可解决数据流的冲突，并将抖动控制在一定范围内；步骤2：最小间隔计算。本发明通过冲突解决机制和数据流最小间隔计算方法的设计，可以获得所有数据流的最小时间间隔，从而有效解决异步终端的传输确定性接入方法在时延适配阶段发生的冲突问题。
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公开(公告)号：CN111786897A
公开(公告)日：2020-10-16
申请号：CN202010548022.7
申请日：2020-06-16
申请人： 北京交通大学
IPC分类号： H04L12/801
摘要： 本发明提供了一种周期性流表的基于小根堆的时间有序访问控制方法。该方法包括：将时间敏感网络中的周期性流表调整为堆状态机形式，所述堆状态机中的一个节点对应周期性流表中的一个表项，所述堆状态机中的任一父节点的发送时间小于其左孩子和右孩子的发送时间，堆顶节点的发送时间最小；在所述堆状态机的堆顶节点的发送时间到达后，将所述堆顶节点对应表项的数据流发送出去。本发明的周期性流表的基于小根堆的时间有序访问控制方法解决了周期性流表重复表项的问题，该方法适合中、小规模的周期性流表进行时间有序的访问控制，比如1024条数据流以下的时间敏感网络。
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公开(公告)号：CN117997842A
公开(公告)日：2024-05-07
申请号：CN202410002297.9
申请日：2024-01-02
申请人： 北京交通大学
摘要： 本发明公开了一种异步流量整形器的轻量级硬件实现方法，包括以下步骤：步骤1：流过滤器模块的应用，流过滤器模块收到来自报文池报文摘要信息后以报文优先级为地址查询流过滤器表；步骤2：流门控模块的应用，流门控模块收到来自流过滤器的结果后会以Gate_id为地址查表，得到对应表项内容；步骤3：流调度器模块的应用，流调度器模块收到来自流门控的结果后会根据得到的Scheduler_id查表得到表项内容；步骤4：传输选择模块的应用，报文进入传输选择模块后根据优先级进入指定的队列。本发明将ATS实现于输入端，适用于输入端缓存报文的交换机架构，并给出了在交换机上实现ATS流量整形器的具体实现方式，包括ATS内部模块设计及与之搭配以实现报文交换的其他模块。
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公开(公告)号：CN117834562A
公开(公告)日：2024-04-05
申请号：CN202410023327.4
申请日：2024-01-08
申请人： 北京交通大学
IPC分类号： H04L49/111 , H04L49/9023 , H04L45/121 , H04L47/62 , H04L47/6275
摘要： 本发明公开了一种驻留时间机制的硬件实现方法，包括以下步骤：步骤1：驻留时间查询表模块的应用，报文进入交换机并存储在输入端口缓存池的过程中，会提取出报文的FlowID字段和到达时间ArrivalTime发送给驻留时间查询表模块；骤2：传输选择模块的应用，传输选择模块通过判断当前时间CurrentTime是否大于等于“报文的合格时间EligibilityTime－保护带长度ProtectBand”确定该报文是否有资格参与调度竞争；步骤3：FIFO模块的应用，当报文调度完成后，会通过CrossBar发往目的端口的FIFO模块。本发明着眼于驻留时间机制的硬件实现，给出了在交换机中的具体硬件实现方案，并提出了使用驻留时间机制的报文的调度方案，使用保护带机制来保证时间触发报文不被其他报文阻塞。
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公开(公告)号：CN111786900B
公开(公告)日：2022-04-29
申请号：CN202010544010.7
申请日：2020-06-15
申请人： 北京交通大学
IPC分类号： H04L47/22 , H04L47/6275 , H04L47/625
摘要： 本发明提供了一种基于时间队列的时态感知流量整形器。该方法包括：将进入时态感知流量整形器的报文存储在报文池中，通过报文的数据流标识查询调度表获取对应的发送窗口、相对发送时间信息，将报文的数据流标识、绝对发送时间、优先级和在报文池中的存储地址构成报文的摘要信息，将相同优先级的各个报文的摘要信息按照绝对发送时间从前到后的顺序进行排序，组成时间队列；在时间队列中的报文的发送时间到达后，打开对应优先级的时间队列的门控开关，将该报文发送出去。本发明保证了无论报文的入队顺序如何，都能确定地按照时间有序的方式进行发送，提高了缓存队列的利用率；调度表无需按照时间有序的方式进行组织，提高了调度表存储的可扩展性。
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公开(公告)号：CN111786900A
公开(公告)日：2020-10-16
申请号：CN202010544010.7
申请日：2020-06-15
申请人： 北京交通大学
IPC分类号： H04L12/815 , H04L12/863 , H04L12/865
摘要： 本发明提供了一种基于时间队列的时态感知流量整形器。该方法包括：将进入时态感知流量整形器的报文存储在报文池中，通过报文的数据流标识查询调度表获取对应的发送窗口、相对发送时间信息，将报文的数据流标识、绝对发送时间、优先级和在报文池中的存储地址构成报文的摘要信息，将相同优先级的各个报文的摘要信息按照绝对发送时间从前到后的顺序进行排序，组成时间队列；在时间队列中的报文的发送时间到达后，打开对应优先级的时间队列的门控开关，将该报文发送出去。本发明保证了无论报文的入队顺序如何，都能确定地按照时间有序的方式进行发送，提高了缓存队列的利用率；调度表无需按照时间有序的方式进行组织，提高了调度表存储的可扩展性。
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公开(公告)号：CN111585895A
公开(公告)日：2020-08-25
申请号：CN202010395528.9
申请日：2020-05-12
申请人： 北京交通大学
发明人： 李宗辉
IPC分类号： H04L12/721 , H04L12/841 , H04L12/885 , H04L12/947
摘要： 本发明实施例提供了一种无需时间同步的时间触发的数据传输方法。该方法包括：通过配置工具向交换机配置数据流的转发表和数据流在交换机本地的驻留时间，当数据流报文到达交换机时，所述交换机记录所述数据流报文的到达时间；所述交换机从数据流报文中提取数据流标识，并通过流标识查询本地存储的转发表，获取所述数据流标识对应的输出端口号和驻留时间；在所述到达时间加上所述驻留时间的时刻，所述交换机将所述数据流报文从所述输出端口发出。本发明实施例的时间触发的数据传输方法无需时间同步，配置数据流在交换机中的驻留时间，而不是配置数据流的发送时间点，克服了现有技术方法中的时间同步失效的问题。
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公开(公告)号：CN118116266A
公开(公告)日：2024-05-31
申请号：CN202410450411.4
申请日：2024-04-15
申请人： 北京交通大学
IPC分类号： G09B23/18
摘要： 本发明公开了一种面向高校的物联网实验教学平台，包括硬件平台和软件平台；硬件平台包括DC电压转换板、PDA模块和传感器模块，DC电压转换板和PDA模块之间通过引线连接，传感器模块嵌扣在PDA模块上；PDA模块上设有多个定义接口，传感器模块包括传感器感知元件模型库、MCU处理器、USB转接口模块、烧录/工作转换开关、传感器感知元件和MCU连接开关。软件平台在PC端，包括Arduino开发环境和实验代码库。本发明开发了PDA实验板、集成了传感器感知元件模型库和实验代码库并设计了实验任务。节省传感器选型、组网、原理图设计、物联网系统开发、测试验证的时间和成本，启发学生扩展出探索性和创造性的实验场景，激发学生的学习热情，提高学习效率。
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公开(公告)号：CN117641561A
公开(公告)日：2024-03-01
申请号：CN202311701786.5
申请日：2023-12-12
申请人： 北京交通大学
摘要： 本申请涉及一种用于5G+TSN融合网络的时间同步方法及系统，涉及网络通信技术的领域，该方法包括获取从节点处的同步报文接收状态；于同步报文接收状态与预设的到位状态一致时获取请求发送时间、请求接收时间、响应发送时间以及响应接收时间；根据请求发送时间、请求接收时间、响应发送时间以及响应接收时间进行计算以确定时钟补偿量；于PTP时钟内新增与预设的全局时钟计数器计数增量算法一致的本地时钟计数器；根据时钟补偿量进行计算以确定于本地时钟计数器中的计数值，并将计数值写入至全局时钟计数器内。本申请具有减少大规模节点同步行为会引发同步错误的情况发生的效果。
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