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公开(公告)号：CN102124470A
公开(公告)日：2011-07-13
申请号：CN200980131525.6
申请日：2009-07-30
申请人： 法国电信教育集团-巴黎电信学院
CPC分类号： G06F21/558 , G06F21/75 , G06F21/755
摘要： 本发明的主题是一种在由差分逻辑保护的电路中检测异常的方法，所述差分逻辑处理由一对分量(at，af)表示的逻辑变量，第一网络的单元(T)对第一对分量执行逻辑功能，第二网络的对偶单元(F)以互补逻辑对第二分量操作，所述逻辑功能由每对单元(T，F)在将变量置于已知状态的预充电阶段(21)对到所述单元的输入执行，随后是求值阶段(22)，其中由所述单元来执行计算，所述方法特征在于，通过在预充电阶段期间或在求值阶段发生的至少一个不一致状态来检测异常。本发明的主题还包括一种差分逻辑保护的电路，包括用于在电路的监控节点处，在预充电阶段或求值阶段期间检测逻辑变量的两个分量一致性的模块。
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公开(公告)号：CN102648600B
公开(公告)日：2014-12-24
申请号：CN201080056401.9
申请日：2010-11-08
申请人： 法国电信教育集团-巴黎电信学院
IPC分类号： H04L9/06
CPC分类号： H04L9/28 , H04L9/003 , H04L9/0618 , H04L2209/046 , H04L2209/12
摘要： 本发明的主题是由掩蔽保护的密码电路，所述电路包括用于使用至少一个密钥krc来加密二进制字的模块，用于将线性处理操作（216）和非线性处理操作（226）施加至所述字的模块以及用于掩蔽所述字的模块。通过使用掩码kri在所述非线性处理操作的上游解掩蔽（214）所述二进制字，并且通过使用掩码kr+1i在所述处理操作的下游掩蔽（215）所述二进制字，所述掩码kri和kr+1i选自特定于所述电路的每个实例的一组掩码。
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公开(公告)号：CN102762994A
公开(公告)日：2012-10-31
申请号：CN201180010046.6
申请日：2011-01-10
申请人： 法国电信教育集团-巴黎电信学院
发明人： J-L·当热
IPC分类号： G01R31/317 , G06F21/00
CPC分类号： H04L9/0861 , G01R31/31719 , G06F21/31 , G06F21/73 , G06F2221/2129 , G09C1/00 , H04L9/3278 , H04L2209/12 , H04L2209/26
摘要： 本发明的主题是硅集成电路，包括能生成专用于所述电路的签名的物理不可复制功能单元LPUF。所述功能单元包括：环形振荡器，其包括信号e所经过的回路（502），所述回路由互相串联连接的N个拓扑结构相同的滞后链（500，501）和反相门（503）形成，滞后链（500，501）包括互相串联连接的M个延迟元件（506,507）。所述功能单元还包括控制模块（505），其生成N个控制字（C1,C2），所述字用于配置由滞后链在经过滞后链的信号e上所引入的延迟的值。测量模块（504）在更新所述控制字之后，在最后一个滞后链（501）的输出处测量信号的频率，并且一装置使得可以从频率测量值推导构成电路的签名的位。本发明的主题还在于用于测试这种电路的方法和系统。
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公开(公告)号：CN102648600A
公开(公告)日：2012-08-22
申请号：CN201080056401.9
申请日：2010-11-08
申请人： 法国电信教育集团-巴黎电信学院
IPC分类号： H04L9/06
CPC分类号： H04L9/28 , H04L9/003 , H04L9/0618 , H04L2209/046 , H04L2209/12
摘要： 本发明的主题是由掩蔽保护的密码电路，所述电路包括用于使用至少一个密钥krc来加密二进制字的模块，用于将线性处理操作（216）和非线性处理操作（226）施加至所述字的模块以及用于掩蔽所述字的模块。通过使用掩码kri在所述非线性处理操作的上游解掩蔽（214）所述二进制字，并且通过使用掩码kr+1i在所述处理操作的下游掩蔽（215）所述二进制字，所述掩码kri和kr+1i选自特定于所述电路的每个实例的一组掩码。
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公开(公告)号：CN102119390A
公开(公告)日：2011-07-06
申请号：CN200980131328.4
申请日：2009-07-30
申请人： 法国电信教育集团-巴黎电信学院
摘要： 本发明的主题是用于保护可编程逻辑电路(100，200)的方法，其特征在于：用于配置所述电路的可编程资源的一个或多个数据文件在被加密(112)后存储在非易失性存储器(107，207)中，所述电路内部的解密模块(103，203)负责使用存储在所述电路中的秘密密钥(102，202)来解密所述一个或多个文件，通过配置至少一个对抗技术保护解密模块在解密操作期间不受目的为获取密钥的攻击。本发明的主题还可以是FPGA类型的可编程逻辑电路，通过使用根据前面权利要求中的一个的方法来保护其在解密操作期间不受通过观察和/或故障注入的攻击。
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公开(公告)号：CN102124470B
公开(公告)日：2015-04-08
申请号：CN200980131525.6
申请日：2009-07-30
申请人： 法国电信教育集团-巴黎电信学院
IPC分类号： G06F21/72
CPC分类号： G06F21/558 , G06F21/75 , G06F21/755
摘要： 本发明的主题是一种在由差分逻辑保护的电路中检测异常的方法，所述差分逻辑处理由一对分量(at，af)表示的逻辑变量，第一网络的单元(T)对第一对分量执行逻辑功能，第二网络的对偶单元(F)以互补逻辑对第二分量操作，所述逻辑功能由每对单元(T，F)在将变量置于已知状态的预充电阶段(21)对到所述单元的输入执行，随后是求值阶段(22)，其中由所述单元来执行计算，所述方法特征在于，通过在预充电阶段期间或在求值阶段发生的至少一个不一致状态来检测异常。本发明的主题还包括一种差分逻辑保护的电路，包括用于在电路的监控节点处，在预充电阶段或求值阶段期间检测逻辑变量的两个分量一致性的模块。
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公开(公告)号：CN102762994B
公开(公告)日：2016-02-10
申请号：CN201180010046.6
申请日：2011-01-10
申请人： 法国电信教育集团-巴黎电信学院
发明人： J-L·当热
IPC分类号： G06F21/31 , G01R31/317
CPC分类号： H04L9/0861 , G01R31/31719 , G06F21/31 , G06F21/73 , G06F2221/2129 , G09C1/00 , H04L9/3278 , H04L2209/12 , H04L2209/26
摘要： 本发明的主题是硅集成电路，包括能生成专用于所述电路的签名的物理不可复制功能单元LPUF。所述功能单元包括：环形振荡器，其包括信号e所经过的回路（502），所述回路由互相串联连接的N个拓扑结构相同的滞后链（500，501）和反相门（503）形成，滞后链（500，501）包括互相串联连接的M个延迟元件（506,507）。所述功能单元还包括控制模块（505），其生成N个控制字（C1,C2），所述字用于配置由滞后链在经过滞后链的信号e上所引入的延迟的值。测量模块（504）在更新所述控制字之后，在最后一个滞后链（501）的输出处测量信号的频率，并且一装置使得可以从频率测量值推导构成电路的签名的位。本发明的主题还在于用于测试这种电路的方法和系统。
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