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公开(公告)号：JP5681054B2
公开(公告)日：2015-03-04
申请号：JP2011152196
申请日：2011-07-08
Inventor： ダンテ・エム・ピエトラントーニ , ユファ・トン , マイケル・エス・レトカー
IPC: G03G15/20
CPC classification number: C09D5/24 , C01P2002/82 , C01P2004/62 , C01P2006/12 , C09C1/56 , C09D17/005 , Y10T428/25
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公开(公告)号：JP2020013990A
公开(公告)日：2020-01-23
申请号：JP2019115179
申请日：2019-06-21
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： カイル・ビー・トールマン , ジョナサン・エイチ・ヘルコ , マイケル・エス・レトカー , エイミー・キャサリン・ポーター , リン・マー , デイビッド・エム・スキナー , エリック・ロバート・ドゥデク , スコット・ジェイ・グリフィン
IPC: H05K3/28 , H01L27/11507
Abstract: 【課題】メモリセルを保護するため、印刷された電子デバイスの表面を保護材料で被覆するが、製造工程における要因は、デバイスの歩留まり低下に寄与し得る。 【解決手段】印刷された電子デバイス100は、各メモリセルが、複数の電極トレースのうちの一対の電極トレース106a〜106jの交差部108に位置し、下部電極トレース106f〜106jのうちの1つの領域から形成される下部電極層、上部電極トレース106a〜106eのうちの1つの領域から形成される上部電極層及び下部電極層と上部電極層との間の強誘電体層を含む、複数のメモリセルと、複数の電極トレースを覆う、アミン変性ポリエステル(メタ)アクリレート、(メタ)アクリル化アミンオリゴマー、(メタ)アクリレートモノマー、粘土鉱物及び光開始剤を含む硬化性組成物から形成された保護層116と、を備える。 【選択図】図1A
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公开(公告)号：JP5860751B2
公开(公告)日：2016-02-16
申请号：JP2012091957
申请日：2012-04-13
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： マイケル・エス・レトカー , フランシスコ・ジェイ・ロペス , カイル・ビー・トールマン , ジョナサン・エイチ・ヘルコ , デイヴィッド・ダブリュ・マーティン , スコット・ジェイ・グリフィン , マンダキニ・カナンゴ , ユーホワ・トン
IPC: G03G15/16
CPC classification number: G03G15/162 , B82Y30/00
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公开(公告)号：JP2020013988A
公开(公告)日：2020-01-23
申请号：JP2019115148
申请日：2019-06-21
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： ジョナサン・エイチ・ヘルコ , マイケル・エス・レトカー , カイル・ビー・トールマン , エリック・ロバート・ドゥデク , エイミー・キャサリン・ポーター , デイビッド・エム・スキナー , リン・マー , マーカス・アール・シルベストリ
IPC: H01L27/11502
Abstract: 【課題】被覆された印刷電子デバイス、製造方法を改善する。 【解決手段】被覆された印刷された電子デバイス100は、複数のコンタクトパッド104a〜104jと、、一組の下部電極トレース及び一組の上部電極トレースを含み、各電極トレースが、複数のコンタクトパッドのうちの関連付けられたコンタクトパッドと電気的に連絡する複数の電極トレース106a〜106jと、各メモリセルが、複数の電極トレースのうちの一対の電極トレースの交差部に位置し、下部電極トレースのうちの1つの領域から形成される下部電極層、上部電極トレースのうちの1つの領域から形成される上部電極層及び下部電極層と上部電極層との間の強誘電体層を含む複数のメモリセル108と、複数の電極トレースを覆い、かつ、各電極トレースの各縁部を越えて横方向に延在して各電極トレースを囲む緩衝帯を提供する保護層116と、を有する。 【選択図】図1A
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公开(公告)号：JP6246097B2
公开(公告)日：2017-12-13
申请号：JP2014166436
申请日：2014-08-19
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： マンダキニ・カナンゴ , マシュー・エム・ケリー , ヴァルン・サンバイ , デイヴィッド・ジェイ・ジェルヴァシ , サントク・エス・バデシャ , チャカラヴァーシー・チダンバレスワラパッター , マイケル・エス・レトカー
CPC classification number: B41J2/1606 , B41J2/165 , B41J2202/03
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Patent Agency Ranking
公开(公告)号：JP5715580B2
公开(公告)日：2015-05-07
申请号：JP2012003561
申请日：2012-01-11
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： ジン・ウー , ジョナサン・エイチ・ヘルコ , フランシスコ・ジェイ・ロペス , カイル・ビー・トールマン , ダンテ・エム・ピエトラントーニ , デイヴィッド・ダブリュ・マーティン , ユーホワ・トン , マイケル・エス・レトカー , スコット・ジェイ・グリフィン , マーカス・アール・シルベストリ
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公开(公告)号：JP6293615B2
公开(公告)日：2018-03-14
申请号：JP2014166429
申请日：2014-08-19
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： マンダキニ・カナンゴ , マシュー・エム・ケリー , ヴァルン・サンバイ , デイヴィッド・ジェイ・ジェルヴァシ , サントク・エス・バデシャ , チャカラヴァーシー・チダンバレスワラパッター , マイケル・エス・レトカー
IPC: C09D153/00 , C09D127/12 , C09D183/04 , C08J3/24 , C08G77/442 , C08G81/00
CPC classification number: C08G77/442 , C09D183/10
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公开(公告)号：JP6249902B2
公开(公告)日：2017-12-20
申请号：JP2014156949
申请日：2014-07-31
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： ジン・ウー , カイル・ビー・トールマン , チー・イン・リー , ジョナサン・エイチ・ヘルコ , マイケル・エス・レトカー , テリー・エル・ストリート
CPC classification number: G03G15/14 , G03G15/1685 , G03G15/165 , G03G2215/1628
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公开(公告)号：JP2021017057A
公开(公告)日：2021-02-15
申请号：JP2020108331
申请日：2020-06-24
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： ヴァルン・サンビー , カイル・ビー・トールマン , リン・マー , サントク・エス・バデシャ , マイケル・エス・レトカー
Abstract: 【課題】可変データリソグラフィのための画像形成ブランケット。 【解決手段】画像形成ブランケット100は、基材102を含む。発泡体層103が基材102上に配設される。エラストマー層104が発泡体層103上に配設され、エラストマー層104はシリコーンエラストマーを含む。エラストマー層104は、約50ショアA〜約100ショアAの範囲のショアA硬度を有する。 【選択図】図2
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公开(公告)号：JP2020013989A
公开(公告)日：2020-01-23
申请号：JP2019115165
申请日：2019-06-21
Applicant: ゼロックス コーポレイション , XEROX CORPORATION
Inventor： ジョナサン・エイチ・ヘルコ , マイケル・エス・レトカー , カイル・ビー・トールマン , スコット・ジェイ・グリフィン , エイミー・キャサリン・ポーター , デイビッド・エム・スキナー , リン・マー , エリック・ロバート・ドゥデク
IPC: H01L21/288 , H01L21/3205 , H01L21/768 , H01L23/522 , H01L21/822 , H01L27/04 , H01L21/82 , H01L27/11509
Abstract: 【課題】改善された歩留まりを示す印刷された電子デバイスを提供する。 【解決手段】印刷された電子デバイス100は、複数のコンタクトパッド104a〜104jと、一組の下部電極トレース106f〜106jおよび一組の上部電極トレース106a〜106eを含み、関連付けられたコンタクトパッドと電気的に連絡する、複数の電極トレースと、一対の電極トレースの交差部に位置し、下部電極トレースのうちの1つの領域から形成される下部電極層、上部電極トレースのうちの1つの領域から形成される上部電極層、および下部電極層と上部電極層との間の強誘電体層、を含む複数のメモリセルと、を備える。複数のコンタクトパッドは、少なくとも1つの未修正コンタクトパッドと、少なくとも1つの未修正コンタクトパッドと比較して、表面積が小さく、異なるサイズ、異なる形状、またはそれらの両方を有する少なくとも1つの修正コンタクトパッドをさらに含む。 【選択図】図1A
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