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发明授权
Logic nor circuit with speed-up capacitors having added series current limiting resistor to prevent false outputs 失效
标题翻译：具有加速电容器的逻辑或电路，增加了串联限流电阻，以防止误输出

公开(公告)号：US3027465A

公开(公告)日：1962-03-27

申请号：US72891258

申请日：1958-04-16

申请人： SYLVANIA ELECTRIC PROD

发明人： DI LORENZO BERNARD A , ANDERSON WALTER R

IPC分类号： H03K19/09

CPC分类号： H03K19/09