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公开(公告)号：WO2009116214A1
公开(公告)日：2009-09-24
申请号：PCT/JP2008/072931
申请日：2008-12-17
CPC classification number: G09G3/3677 , G09G2310/0286 , G09G2330/025 , G11C19/184 , G11C19/28
Abstract: 信号線選択信号（Ｇ１～Ｇｍ）を生成する単位回路が段状に接続されてなるとともに、前記信号線選択信号（Ｇ１～Ｇｍ）から形成されるパルスが初段から順に最終段まで出力されるシフトレジスタを備えた表示パネル駆動回路であって、前記各単位回路には、クロック信号（ＣＫ１・ＣＫ２）と、前記表示パネル駆動回路外からの同期信号（ＶＳＹＮＣ）に基づいて生成されたゲートスタートパルス信号（ＧＳＰ）あるいは他段で生成された前記信号線選択信号（Ｇ１～Ｇｍ）と、クリア信号（ＣＬＲ）とが入力され、該クリア信号（ＣＬＲ）は前記同期信号（ＶＳＹＮＣ）に異常があればアクティブとされ、それ以後次の垂直走査期間の開始時まで前記シフトレジスタからパルスが出力されない。上記構成によれば、前記同期信号（ＶＳＹＮＣ）に異常が生じた場合の表示乱れや電源への負荷増大を抑制しうる表示パネル駆動回路を実現することができる。
Abstract translation: 公开了一种显示面板驱动电路，包括移位寄存器，用于产生信号线选择信号（G1至Gm）的单位电路被逐步连接，用于从信号线选择信号（G1至Gm）顺序地输出由 初始阶段到最后阶段。 根据来自显示面板驱动电路的外部的同步信号（VSYNC）生成的门启动脉冲信号（GSP）或信号（CK1，CK2），输入到每个单位电路， 在另一级产生的行选择信号（G1〜Gm）和清除信号（CLR）。 在同步信号（VSYNC）异常的情况下，清零信号（CLR）被激活，随后从移位寄存器输出脉冲直到下一个垂直扫描期间开始。 由此，能够实现在同步信号（VSYNC）异常的情况下能够抑制显示干扰或电源负荷增加的显示面板驱动电路。
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公开(公告)号：WO2009116207A1
公开(公告)日：2009-09-24
申请号：PCT/JP2008/072041
申请日：2008-12-04
CPC classification number: G09G3/3677 , G11C19/28
Abstract: 信号線選択信号（Ｇ１～Ｇｍ）を出力する単位回路が段状に接続されてなるシフトレジスタを備えた表示パネル駆動回路であって、上記単位回路には、クロック信号（ＣＫ１・ＣＫ２）と、スタートパルス信号（ＧＳＰ）あるいは他段から出力された信号線選択信号とが入力され、該クロック信号は、アクティブ化に伴う立ち上がり部分および戻り部分が傾斜している。上記構成によれば、ゲートオンパルス信号に異常（例えば、非アクティブ時の電位ブレ）が生じ難い表示パネル駆動回路および表示パネルの駆動方法を実現することができる。
Abstract translation: 具有移位寄存器的显示面板驱动电路，其中输出信号线选择信号（G1〜Gm）的单位电路级联连接。 时钟信号（CK1，CK2）和起始脉冲信号（GSP）或从另一级输出的信号线选择信号输入到每个单位电路中。 由于激活，时钟信号的前沿和后沿是倾斜的。 通过使用上述结构，可以实现在栅极导通脉冲信号中几乎不发生异常（例如，无效状态下的电位波动）的显示面板驱动电路和用于驱动显示面板的方法。
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公开(公告)号：WO2009104307A1
公开(公告)日：2009-08-27
申请号：PCT/JP2008/069145
申请日：2008-10-22
CPC classification number: G09G3/3677 , G09G2300/0408 , G09G2300/0417 , G09G2310/0286 , G09G2310/08 , G11C19/28
Abstract: 縦続接続された各段は、各段の所定箇所（ｎｅｔＡ、Ｇｎ）を低電位側電源に接続する、ＴＦＴ（Ｔｒ１５、Ｔｒ１６、Ｔｒ１７）を用いた第１の回路を備えており、第１の種類のクロック信号は、各段によって各段の出力端子（Ｇｎ）に伝送されることにより出力される出力信号（ＯＵＴ）に用いられ、第２の種類のクロック信号は、第１の回路を駆動するのに用いられる。これにより、ＴＦＴの閾値電圧のシフト現象をより抑制することのできるシフトレジスタ回路を実現する。
Abstract translation: 级联连接的每个级包括使用TFT（Tr15，Tr16，Tr17）的第一电路，用于将每个级的预定节点（netA，Gn）连接到较低电压电源。 第一种类型的时钟信号由每一级发送到每级的输出端（Gn），从而输出用于输出信号（OUT）。 第二种类型的时钟信号用于驱动第一电路。 这提供了能够进一步抑制TFT的阈值电压偏移现象的移位寄存器电路。
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公开(公告)号：WO2009104306A1
公开(公告)日：2009-08-27
申请号：PCT/JP2008/068989
申请日：2008-10-20
CPC classification number: G09G3/3677 , G09G2310/0286 , G09G2310/08 , G11C19/28
Abstract: 第１のシフトレジスタ・第２のシフトレジスタの各段は、第１のクロック入力端子（ＣＫＡ）に入力されるクロック信号のクロックパルスを伝送することにより走査パルス（Ｑｎ－１）を出力し、第２のクロック入力端子（ＣＫＢ）に入力されるクロック信号がゲートに入力される、対応する走査信号線を走査パルスの低電位側電源に接続および遮断するように設けられた第１のトランジスタ（Ｔｒ２）を備えており、第１のシフトレジスタの２つのクロック信号と第２のシフトレジスタの２つのクロック信号とはクロックパルスのタイミングが互いにずれている。これにより、ゲートラインのＬｏｗ引きを行いながら、Ｌｏｗ引き用のトランジスタの閾値電圧のシフト現象を抑制することのできる表示装置を実現する。
Abstract translation: 在第一移位寄存器和第二移位寄存器的各级中，发送输入到第一时钟输入端子（CKA）的时钟信号的时钟脉冲，并输出扫描脉冲（Qn-1），将时钟信号输入到 第二时钟输入端子（CKB）被输入到栅极，提供了将扫描信号线与扫描脉冲的低电位电源连接/断开的第一晶体管（Tr2），并且提供两个时钟信号 第一移位寄存器和第二移位寄存器的两个时钟信号在时钟脉冲的定时中彼此不同。 因此，可以抑制将栅极线与低电位侧电源连接的显示装置，能够抑制将栅极线连接到低电位电源的晶体管的阈值电压的偏移现象。
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Patent Agency Ranking
公开(公告)号：WO2009093352A1
公开(公告)日：2009-07-30
申请号：PCT/JP2008/065449
申请日：2008-08-28
CPC classification number: G09G3/3677 , G09G3/3648 , G09G2300/043 , G09G2300/0876 , G09G2310/0286 , G09G2310/08 , G09G2320/0219
Abstract: 表示装置は、各行に対応して設けられる複数のシフトレジスタステージ（３１）を備え当該行のスイッチング素子をオンするためのゲート信号を出力するゲートドライバ（３０）と、表示すべき映像に応じたデータ信号を出力するソースドライバとを備える。ゲート信号の走査開始側に位置する最端部の行（第１行目）には、ダミーライン（Ｇ０）が設けられ、ダミーライン（Ｇ０）は、第１行目のシフトレジスタ（ＳＲ１）に入力されるゲートスタートパルス（ＧＳＰ）により駆動される。
Abstract translation: 一种显示装置，包括分别对应于行的多个移位寄存器级（31），用于输出用于导通该行的开关元件的栅极信号的栅极驱动器（30），以及用于输出数据信号的源极驱动器 到要显示的图像。 位于栅极信号的扫描起始侧的最远行（第一行）处设置虚线（G0），并且通过输入到与第一行对应的移位寄存器（SR1）的栅极起始脉冲（GSP）驱动 。
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公开(公告)号：WO2009116211A1
公开(公告)日：2009-09-24
申请号：PCT/JP2008/072079
申请日：2008-12-04
CPC classification number: G11C19/28 , G09G3/2096 , G09G3/3666 , G09G3/3677 , G09G2300/0417 , G09G2310/0286 , G09G2310/0289
Abstract: 信号線選択信号（Ｇ１～Ｇｍ）を出力する単位回路が段状に接続されてなるシフトレジスタを備えた表示パネル駆動回路であって、上記単位回路には、クロック信号（ＣＫ１・ＣＫ２）と、スタートパルス信号（ＧＳＰ）あるいは他段から出力された信号線選択信号（Ｇ１～Ｇｍ）とが入力され、クロック信号（ＣＫ１・ＣＫ２）は、アクティブ化した後の戻り部分が、スロープ状の第１の領域とこれよりも急峻な第２の領域とからなる。上記構成によれば、ゲートオンパルス信号の異常を抑制しつつ、画素充電率の向上とクロック信号の高周波化を可能とする表示パネル駆動回路および表示パネルの駆動方法を実現することができる。
Abstract translation: 具有移位寄存器的显示面板驱动电路，其中输出信号线选择信号（G1〜Gm）的单位电路级联连接。 时钟信号（CK1，CK2）和起始脉冲信号（GSP）或从另一级输出的信号线选择信号（G1〜Gm）之一输入到各单位电路。 激活的时钟信号（CK1，CK2）的每个后沿包括像斜率的第一部分和其斜率比第一部分的斜率更陡的第二部分。 通过使用上述结构，可以实现能够提高像素充电率的显示面板驱动电路，并且能够在避免异常导通脉冲信号的同时提高时钟信号的频率，并且可以实现用于驱动显示面板的方法 。
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公开(公告)号：WO2006132069A1
公开(公告)日：2006-12-14
申请号：PCT/JP2006/310058
申请日：2006-05-19
IPC: H04N5/202
Abstract: 本発明の映像信号処理方法は、ＲＯＭ（８）より映像補正データを読み出してＬＵＴ（２）に書き込み、ＬＵＴ（２）に書き込まれた映像補正データを用いて、外部から入力される映像信号をデータ補正する映像信号処理方法において、映像信号の水平ブランキング期間に、ＬＵＴ（２）に書き込まれた映像補正データを更新する。
Abstract translation: 一种视频信号处理方法，其中从ROM（8）读取并写入LUT（2）中的视频校正数据，并且写入LUT（2）的视频校正数据用于执行外部输入的视频信号的数据校正 。 写入LUT（2）中的视频校正数据在视频信号的水平消隐间隔期间被更新。
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公开(公告)号：WO2008047495A1
公开(公告)日：2008-04-24
申请号：PCT/JP2007/061171
申请日：2007-06-01
IPC: G09G3/20 , G02F1/133 , G02F1/1368 , G09G3/36
CPC classification number: G02F1/136259 , G02F2001/136272 , G02F2201/124 , G09G3/20 , G09G2330/08
Abstract: 簡易な構成で断線による表示不良を修正することができる表示装置を提供することを課題とする。表示制御回路（２００）に、データ補正部（２２）と、断線箇所を特定するためのアドレス情報を保持するアドレスレジスタ（２７）と、補正前後のデータ値の対応関係を格納するデータ補正用ＬＵＴ（２８）とを備える。断線が生じた際、当該断線ラインをその両端部で修正用ラインと接続し、アドレスレジスタ（２７）に断線箇所のアドレス情報を与える。表示装置の動作時には、データ補正部（２２）は、入力データが送られるタイミングとアドレス情報とに基づいて、入力データのうちの補正の必要なデータ（補正画素形成部のデータ）を特定する。入力データが補正画素形成部のデータであれば、データ補正部（２２）は、データ補正用ＬＵＴ（２８）に基づき、入力データのデータ値に対応付けられている出力データのデータ値を取得する。
Abstract translation: 提供了一种显示装置，其能够通过简单的结构来校正由于断裂引起的显示故障。 显示控制电路（200）包括数据校正单元（22），用于保存地址信息以指定断开部分的地址寄存器（27），以及数据校正LUT（28），用于存储之前和之后的数据值的对应关系 修正后。 当发生断线时，该虚线在其两端与校正线连接，使得地址寄存器（27）被给予断开部分的地址信息。 在显示装置的动作时刻，数据校正单元（22）根据输入数据发送定时和地址信息，确定输入数据的数据（校正像素形成单元的数据） 必须纠正。 如果输入数据是校正像素形成单元的数据，则数据校正单元（22）根据数据校正LUT（28）获取与输入的数据值对应的输出数据的数据值 数据。
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公开(公告)号：WO2007063620A1
公开(公告)日：2007-06-07
申请号：PCT/JP2006/312851
申请日：2006-06-28
CPC classification number: G09G3/3648 , G09G3/2003 , G09G3/3607 , G09G3/3614 , G09G3/3688 , G09G2300/0426 , G09G2300/0452 , G09G2300/0465 , G09G2320/0209 , G09G2320/0233 , G09G2320/0242 , G09G2340/06
Abstract: 偶数番目の信号線群（１１２Ａ）において、１番目と２番目の信号線（１１２）は表示領域（１０１）内と非表示領域（１０２）内とで配列順が逆転しており、３番目と４番目の信号線（１１２）も同様である。非表示領域（１０２）内の１番目～１６番目の信号線（１１２）の端部は１番目～１６番目の個別ドライバ（２１２）にそれぞれ接続されている。個別ドライバ（２１２）は奇数番目と偶数番目とで逆極性の駆動信号（Ｓ１２）を出力する。このため、第１方向Ｄ１（横方向）に並んだ同色のサブピクセル（１０３）の極性が、奇数番目の信号線群（１１２Ａ）に接続されたサブピクセル（１０３）と、偶数番目の信号線群（１１２Ａ）に接続されたサブピクセル（１０３）と、で異なる。すなわち、横方向に並んだ同色のサブピクセル（１０３）の全てが同じ極性を有さない。その結果、横シャドーを低減することができる。
Abstract translation: 在偶数信号线组（112A）中，第一和第二信号线（112）的布置顺序在显示区域（101）和非显示区域（102）之间相反。 第三和第四信号线（112）也以相同的方式颠倒。 非显示区域（102）中的第一至第十六信号线（112）的端部分别连接到第一至第十六个单独驱动器（212）。 奇数和偶数编号的单独驱动器（212）输出具有相反极性的驱动信号（S12）。 因此，连接到偶数和奇数信号线组（112A）的子像素（103）之间，在第一方向（D1）（横向）上排列并具有相同颜色的子像素（103）的极性不同， 。 也就是说，所有在横向上排列并具有相同颜色的子像素（103）不具有相同的极性。 结果，可以减小横向阴影。
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