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公开(公告)号：CN119396539A
公开(公告)日：2025-02-07
申请号：CN202411986886.1
申请日：2024-12-31
Applicant: 北京开源芯片研究院
Abstract: 本发明实施例提供一种协议处理方法、装置、电子设备及可读存储介质，涉及计算机技术领域。该方法中，获取目标片上系统的需求表征文件。将原始协议支持的事务作为待选事务，并根据需求表征文件，从待选事务中选择与需求表征文件相匹配的事务，作为目标事务。获取各目标事务的第一描述文件。基于第一描述文件为目标片上系统生成目标协议文件；其中，目标协议文件用于描述经过裁剪后的原始协议。这样，实现了为目标片上系统生成协议文件。同时，通过按照目标片上系统的需求表征文件选择的目标事务生成目标协议文件，使得最终得到的目标协议文件可以更适配目标片上系统的需求。
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公开(公告)号：CN119378461A
公开(公告)日：2025-01-28
申请号：CN202411986867.9
申请日：2024-12-31
Applicant: 北京开源芯片研究院
Abstract: 本发明实施例提供了一种片上网络的设计方法、装置、电子设备及可读存储介质，基于目标设计需求，构建目标行为模型；基于目标行为模型以及预设代码库，生成目标代码；在目标代码不满足预设约束目标的情况下，对目标行为模型进行优化并基于优化后的目标行为模型更新目标代码，直至目标代码满足预设约束目标；基于满足预设约束目标的目标代码，生成片上网络代码文件。通过对设计流程中的目标代码进行约束验证以及优化调整目标行为模型的方式，缩小了设计流程中代码优化调整的范围，减少了代码修改代价，在确保片上网络的目标设计需求以及预设约束目标均被验证满足预期的前提下，提高了片上网络的代码生成效率。
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公开(公告)号：CN119377030A
公开(公告)日：2025-01-28
申请号：CN202411986978.X
申请日：2024-12-31
Applicant: 北京开源芯片研究院
IPC: G06F11/263 , G06F11/22
Abstract: 本申请提供了一种片上系统验证方法、装置、电子设备及计算机可读存储介质，通过获取多个随机激励组件，以及与每个随机激励组件关联的标签，根据记录的标签获得基础激励组件和随机种子序列，并利用基础激励组件和随机种子序列进行验证失败信号的复现。本申请通过对多个随机激励组件关联标签，使用标签记录随机激励组件所使用的随机种子，根据记录的标签获得基础激励组件和随机种子序列通过对随机激励组件关联的标签的读取，获得组成随机激励组件中具体的随机种子，使得在复现过程中可以根据标签生成首次出现失败信号时相同的随机激励组件，并利用基础激励组件和随机种子序列进行验证失败信号的复现，使得复现失败信号较为容易，提升验证效率。
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公开(公告)号：CN118585357B
公开(公告)日：2024-10-15
申请号：CN202411055033.6
申请日：2024-08-02
Applicant: 北京开源芯片研究院
Inventor： 唐丹
IPC: G06F9/54 , G06F30/3308 , G06F115/02
Abstract: 本申请提供了一种验证环境中的组件通信方法、装置、电子设备及计算机可读存储介质，包括：响应于对发送端组件的注册请求，在预设的映射区域中声明发送端组件所占用的广播片区，并记录广播片区与发送端组件的标识的对应关系；响应于接收端组件的注册请求，获取接收端组件传入的接入标识，并根据对应关系，确定与接入标识对应的目标广播片区，将接收端组件与目标广播片区绑定；响应于报文获取请求，从目标广播片区中获取广播报文并发送给接收端组件。本申请的注册操作自动传入的参数包括了标识等较为简单参数，整个过程操作简单，在接收端组件数量较大的情况下，也无需一一进行接收端组件的连接代码的编写，从而降低了开发成本，提高了开发效率。
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Patent Agency Ranking
公开(公告)号：CN118642907A
公开(公告)日：2024-09-13
申请号：CN202411116825.X
申请日：2024-08-14
Applicant: 北京开源芯片研究院
IPC: G06F11/263 , G06F11/22 , G06F9/30
Abstract: 本发明实施例提供一种异常指令生成方法、装置、电子设备及可读介质，涉及计算机技术领域。该方法中，在指令流生成环节中，基于预设的指令流配置文件中的目标配置项，确定当前的待生成指令存在的异常指令形式，作为目标异常形式，以及，获取为待生成指令设置的异常概率；目标配置项是为待生成指令设置的配置项，异常指令形式为不符合预设指令架构规定的指令约束条件的指令形式。在异常概率表征将待生成指令作为异常指令生成的情况下，基于目标异常形式以及目标配置项，生成符合目标异常形式的待生成指令。这样，可以降低人工成本，提高实现效率，进而提高验证操作的整体效率。
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公开(公告)号：CN118626153A
公开(公告)日：2024-09-10
申请号：CN202411116740.1
申请日：2024-08-14
Applicant: 北京开源芯片研究院
Abstract: 本发明实施例提供了一种指令处理方法、装置、电子设备及可读存储介质。该方法包括：在验证指令流中存在跳转指令的情况下，获取所述验证指令流中的跳转地址不满足预设要求的跳转指令，作为待处理指令；对所述待处理指令所包含的跳转地址操作数进行调整，使得调整后的待处理指令的跳转地址满足所述预设要求，得到目标验证指令流。这样，通过从验证指令流中获取跳转地址不满足预设要求的跳转指令，可以得到可能触发跳转异常的待处理指令，进而通过对待处理指令的操作数进行跳转，使得跳转后的待处理指令的跳转地址满足预设要求，可以解决跳转指令跳转异常的问题，通过目标验证指令流可以大大提高验证测试效果。
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公开(公告)号：CN118605950A
公开(公告)日：2024-09-06
申请号：CN202411053488.4
申请日：2024-08-01
Applicant: 北京开源芯片研究院
IPC: G06F9/38
Abstract: 本申请提供了一种分支指令执行结果的预测方法、装置、设备及存储介质，涉及分支指令技术领域，由于第一分支目标缓冲器用于将新的分支指令的执行结果更新至新的分支指令对应的表项中，而在第一时间段（例如在处理器的流水线发生冲刷事件后的预设时长内），根据当前时钟周期待预测的第一分支指令的起始地址，获取预设的第一分支目标缓冲器中的第一目标表项，并将第一目标表项确定为第一分支指令对应的预测表项，然后根据预测表项，获取第一分支指令执行的预测结果，以根据预测结果，执行第一分支指令，无需等到未来的时钟周期再进行首次预测，减少了处理器的流水线出现空泡的时长。
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公开(公告)号：CN118474096A
公开(公告)日：2024-08-09
申请号：CN202410742951.X
申请日：2024-06-07
Applicant: 北京开源芯片研究院
IPC: H04L67/06 , H04L67/1008 , H04L45/02 , H04L47/125
Abstract: 本发明实施例提供了一种报文传输方法、系统、电子设备及可读存储介质。该方法包括：接收第一信号，并将发送所述第一信号的节点确定为过载节点；所述第一信号为节点在接收到的报文数量不小于所述节点对应的第一数量阈值的情况下发送的；响应于待传输报文的传输请求，在所述传输网络中为所述待传输报文生成目标传输路径，并使得所述待传输报文按照所述目标传输路径进行传输；所述目标传输路径所包含的过载节点的数量不大于目标数量阈值。保证待传输报文的传输效率，避免了网络拥堵所导致的报文传输效率较低的问题。
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公开(公告)号：CN118170435B
公开(公告)日：2024-07-26
申请号：CN202410599666.7
申请日：2024-05-15
Applicant: 北京开源芯片研究院
Abstract: 本申请提供了一种指令信息的处理方法、装置、电子设备及计算机可读存储介质，包括：获取指令的指令名称和指令详细信息；获取预先设立的结构体类型；结构体类型中包括与指令名称对应的第一变量以及与指令详细信息对应的第二变量；根据结构体类型，声明获得包括数组元素的关联数组，关联数组中的数组元素与指令一一对应；数组元素包括第一变量和第二变量的对应关系；将指令的指令名称和指令详细信息，分别赋值给关联数组中对应数组元素的第一变量和第二变量。本申请实现了灵活的指令信息记录方式，适用范围较宽，解决了相关技术中指令信息记录形式固定的问题。
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