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公开(公告)号：CN119322667A
公开(公告)日：2025-01-17
申请号：CN202411367000.5
申请日：2024-09-29
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提出一种面向OODAflow操作系统的容错调度方法和装置，包括：接收智能计算任务并将其拆分为单任务，将单任务与环境健康度监测进程封装成自持的容器，等候计算设备调度；将已封装成自持的容器的单任务部署到相应计算节点；在计算节点执行任务过程中，该环境健康度监测进程实时监测当前计算节点所属计算设备的健康情况，若健康情况有故障，则当前计算节点退出任务并保存checkpoint文件；若无故障，则将任务的执行结果写回共享存储区。本发明提出的容错调度系统实现了对OODAflow操作系统任务的容错机制与高效的容错调度，保障了OODAflow操作系统处理计算任务的实时性与可靠性。
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公开(公告)号：CN118586345A
公开(公告)日：2024-09-03
申请号：CN202410628587.4
申请日：2024-05-21
Applicant: 中国科学院计算技术研究所
IPC: G06F30/392 , G06F30/398
Abstract: 提供一种芯片系统，由多个芯粒互联构成，其中，每个芯粒包括一个芯粒间路由模块，每个芯粒与相邻芯粒通过各自的所述芯粒间路由模块连接通信；所述芯粒间路由模块包括：与第一方向相对应的第一端口，与第二方向相对应的第二端口，与第三方向相对应的第三端口以及与第四方向相对应的第四端口，其中所述第二方向与所述第一方向垂直，所述第三方向与所述第一方向相反，所述第四方向与所述第二方向相反；其中，所述芯粒间路由模块包括寄存器配置模块，用于动态配置数据路由方式和数据传输路径。
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公开(公告)号：CN118446265A
公开(公告)日：2024-08-06
申请号：CN202410526918.3
申请日：2024-04-29
Applicant: 中国科学院计算技术研究所
IPC: G06N3/063
Abstract: 本发明提供一种神经网络加速器的设计方法以及装置，所述方法包括：根据硬件模板和硬件设计约束生成硬件设计空间，该硬件设计空间包括多个硬件设计实例；其中，每个硬件设计实例包括用于处理不同的数据流的多个子加速器，每个子加速器由多个芯粒构成；以及针对硬件设计实例：根据确定输入的任务负载模型中每个算子在该硬件设计实例的单个子加速器上的最优调度策略；根据所述最优调度策略和所述任务负载模型，确定将任务负载模型中各个算子映射至该硬件设计实例的各子加速器的最优映射策略；评估各个硬件设计实例对应的最优调度策略和最优映射策略的性能代价，从中选出最优的硬件设计实例。本发明可以改善神经网络加速器的硬件设计效率。
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公开(公告)号：CN118311921A
公开(公告)日：2024-07-09
申请号：CN202311780776.5
申请日：2023-12-22
Applicant: 中国科学院计算技术研究所
IPC: G05B19/4097
Abstract: 本发明提供一种用于工件模型的路径转换方法及系统，所述方法包括：获取工件的三维点云数据和模型数据，并根据三维点云数据和模型数据，进行ICP点云精配准，得到精配准坐标变换矩阵；根据所述精配准坐标变换矩阵，确定所述三维点云数据相对于所述模型数据的最终坐标变换矩阵；利用所述最终坐标变换矩阵，将模型规划路径转换到工件的实际点云，进行路径转换。本发明实施例在离线编程的基础上，采用点云配准技术进行模型路径的转换，无需工装夹具，工件在作业台上可任意摆放，避免作业精度受到工装夹具固定误差的影响，从而提高作业定位精度，提高了作业效率，稳定作业质量和一致性，极大的降低了成本和能耗，适用工件多品种小批量的作业场景。
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公开(公告)号：CN118099127A
公开(公告)日：2024-05-28
申请号：CN202211505080.7
申请日：2022-11-28
Applicant: 中国科学院计算技术研究所
IPC: H01L23/528 , H01L23/522 , H01L23/538 , H01L25/04
Abstract: 本发明提出一种基于可重用有源硅中介层的芯片，包括：多个芯粒；基板，用于提供电源、时钟和芯片外部输入输出信号；由多个瓦片构成的可重用有源硅中介层，每个瓦片表面和底面均具有凸块，通过底面的凸块与基板电气连接，获取电源、时钟、外部输入输出信号；通过表面的凸块与芯粒电气连接；且每个瓦片内包含竖直方向的硅通孔，在部分瓦片表面的凸块与瓦片底面的凸块之间形成电气连接，为芯粒传送电源、时钟、芯片外部输入输出信号；每个瓦片内部还包含至少一个路由器，路由器与多个表面凸块形成电气连接，芯粒通过微凸块与路由器进行芯粒间数据传输。本发明能为不同的芯粒系统提供交互，且芯粒间互联网络性能更高、能够容忍导线与路由器故障。
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Patent Agency Ranking
公开(公告)号：CN118095189A
公开(公告)日：2024-05-28
申请号：CN202211505070.3
申请日：2022-11-28
Applicant: 中国科学院计算技术研究所
IPC: G06F30/392 , G06F30/33 , G06F111/04 , G06F119/08
Abstract: 本发明提出一种基于可重用硅中介层的2.5D芯片设计方法和系统，包括：通过对应用中所有任务在芯粒库中的可运行芯粒集合求并集，得到候选芯粒集合；根据应用和约束，生成候选芯粒集合中芯粒间互联网络拓扑；热量优化阶段根据互联网络拓扑构建满足预设系统温度指标的中间芯粒布局，整体优化阶段根据预设性能指标对中间芯粒布局进行优化，得到最终芯粒布局；获取芯片中可重用硅中介层的可配置芯粒间互联网络，将最终芯粒布局映射至芯片中可重用硅中介层的可配置组件，得到用于执行应用的2.5D芯片。本发明能够根据应用、约束与优化目标，生成最优的芯粒组合、芯粒间互联网络拓扑、芯粒布局以及可重用硅中介层配置。
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公开(公告)号：CN117313811A
公开(公告)日：2023-12-29
申请号：CN202311271368.7
申请日：2023-09-28
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提供一种用于图像处理的神经网络加速器装置，所述装置包括：乘累加运算模块，其配置有多个矩阵运算单元，用于进行连续乘累加运算；数据存储模块，其被配置为多级存储结构，用于对数据进行分层多级存储并进行数据共享；数据管理模块，用于进行运算数据的调用与存储空间的分配；通用处理器，用于进行外参矩阵求解运算；辅助运算模块，用于进行乘累加运算、外参矩阵求解运算以外的其他不能分解的运算。本发明将特征点匹配、深度预测以及深度融合三个运算载荷大的运算主体分配给三个矩阵运算单元，并对运算时间、算子比例进行合理分配，可使各单元运算互不干扰，达到三级流水线的并行处理效果，提升加速器针对图像处理的高效性与兼容性。
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公开(公告)号：CN112132272B
公开(公告)日：2023-09-12
申请号：CN202010999082.0
申请日：2020-09-22
Applicant: 中国科学院计算技术研究所
IPC: G06N3/063
Abstract: 本发明提供了一种神经网络的计算装置、处理器和电子设备，其中，计算装置包括：逻辑运算电路和通路选择模块；所述通路选择模块，用于根据接收的神经网络中的计算元素所占用的位宽控制所述逻辑运算电路包括的多个计算电路中的一个计算电路导通；所述逻辑运算电路，用于基于所述导通的计算电路对所述计算元素进行运算，获得所述计算元素对应的计算结果。通过根据计算元素占用的位宽不同，控制逻辑运算电路导通不同的计算电路，实现可对不同位宽的计算元素进行计算，应用到神经网络的计算中，可实现对二值神经网络和三值神经网络的计算，实现了对二值神经网络和三值神经网络的运算加速。
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公开(公告)号：CN114372264A
公开(公告)日：2022-04-19
申请号：CN202111635915.6
申请日：2021-12-27
Applicant: 华南理工大学 , 中国科学院计算技术研究所
Abstract: 本发明公开了一种基于任务迁移的片上热隐蔽信道攻击的防御方法，该防御方法步骤如下：建立误码率模型，对通信距离和误码率之间的关系进行建模；通过基于任务迁移的防御方法抑制热信号的传输。该方法可以增加这两个核心之间的通信距离，使热信号衰减从而破坏热隐蔽信道的传输。本发明提出的信道攻击检测与防御方法，平均包错误率高达84％以上，由任务迁移造成的时间开销和功耗开销相比动态调频调压和噪声干扰低，能够防御片上热隐蔽信道攻击，阻止信息泄露。
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公开(公告)号：CN111060115B
公开(公告)日：2022-03-22
申请号：CN201911199728.0
申请日：2019-11-29
Applicant: 中国科学院计算技术研究所
IPC: G01C21/32
Abstract: 一种基于图像边缘特征的视觉SLAM方法，包括如下步骤：通过视觉传感器获取图像；提取所获取图像的边缘特征进行位姿估计；根据位姿估计结果进行非线性优化；根据非线性优化结果进行闭环检测；根据闭环检测结果进行全局优化；构建全局地图。本发明的优势在于，首先，图像边缘是整个图像中重要的组成部分，往往能代表整幅图像，拥有更高的整体精度和信噪比，更加鲁棒。其次，边缘特征在稀疏纹理下也能鲁棒的运行，对光照变化的抗干扰能力也较强。最后，图像边缘特征是对真实场景的最朴素的表达，其建立的地图能很好的还原真实场景。
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