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公开(公告)号：CN105843776A
公开(公告)日：2016-08-10
申请号：CN201610212909.2
申请日：2016-04-07
申请人： 威盛电子股份有限公司
发明人： G.葛兰.亨利 , 泰瑞.帕克斯 , 布兰特.比恩 , 汤姆士.A.克里斯宾
CPC分类号： G06F15/7839 , G06F21/6209 , G06F2221/2107
摘要： 本发明涉及一种微处理器，其中加密的程序可变换不同片段解密用的解密密钥。该微处理器在面对加密的程序中一第一片段时解密且执行之，且解密并执行加密的密钥储存指令，以储存新一组的解密密钥。密钥储存指令执行后，微处理器用该新一组的解密密钥解密并执行加密的程序中的后续片段。执行中的密钥切换可能发生多次，对应相继的加密的密钥储存指令以及相继多组加密指令。
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公开(公告)号：CN105808484A
公开(公告)日：2016-07-27
申请号：CN201610184151.6
申请日：2012-06-21
申请人： 威盛电子股份有限公司
发明人： 达鲁斯.D.嘉斯金斯 , 詹姆斯.R.隆柏格
IPC分类号： G06F13/38
CPC分类号： G06F13/385
摘要： 一种提前同步选通传输的设备及其方法。该提前同步选通传输设备，用以补偿同步数据总线上的不对准，该设备包括一电阻电路、一核心时钟产生器以及一同步选通驱动器。该电阻电路用以提供一比例讯号，该比例讯号指示一提前量，以提前与一数据群组有关的一同步数据选通讯号。该核心时钟产生器，耦接于该比例讯号，该核心时钟产生器以该提前量提前一数据选通计时讯号。该同步选通驱动器用以接收该数据选通计时讯号，并根据该数据选通计时讯号产生该同步数据选通讯号，并以该提前量提前该同步数据选通讯号。
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公开(公告)号：CN105808483A
公开(公告)日：2016-07-27
申请号：CN201610182788.1
申请日：2012-06-21
申请人： 威盛电子股份有限公司
发明人： 达鲁斯.D.嘉斯金斯 , 詹姆斯.R.隆柏格
IPC分类号： G06F13/38
CPC分类号： G06F13/385
摘要： 一种提前同步选通传输的设备及其方法。该提前同步选通传输设备，用以补偿同步数据总线上的不对准，该设备包括一电阻电路、一核心时钟产生器以及一同步选通驱动器。该电阻电路用以提供一比例讯号，该比例讯号指示一提前量，以提前与一数据群组有关的一同步数据选通讯号。该核心时钟产生器，耦接于该比例讯号，该核心时钟产生器以该提前量提前一数据选通计时讯号。该同步选通驱动器用以接收该数据选通计时讯号，并根据该数据选通计时讯号产生该同步数据选通讯号，并以该提前量提前该同步数据选通讯号。
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公开(公告)号：CN103558907B
公开(公告)日：2016-05-11
申请号：CN201310524582.9
申请日：2013-10-30
申请人： 威盛电子股份有限公司
发明人： 黄振铭
IPC分类号： G06F1/32
CPC分类号： G06F1/324 , G06F1/3212 , Y02D10/126 , Y02D10/174
摘要： 本发明提供一种电子装置及降低电子装置功耗的方法。该电子装置，包括：一SATA实体层，用以连接一SATA装置，其中该SATA实体层以一第一时钟频率与该SATA装置进行数据传输；一时钟产生器，用以提供具有该第一时钟频率的一时钟信号至该SATA实体层；以及一控制单元，其中当该控制单元检测到至少一特定事件发生时，该控制单元控制该时钟产生器，使该时钟产生器提供具有一第二时钟频率的该时钟信号至该SATA实体层，藉以让该SATA实体层使用该第二时钟频率与该SATA装置进行数据传输，其中该第二时钟频率小于该第一时钟频率。
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公开(公告)号：CN103545286B
公开(公告)日：2016-05-11
申请号：CN201310484756.3
申请日：2013-10-16
申请人： 威盛电子股份有限公司
发明人： 宫振越
IPC分类号： H01L23/498 , H01L21/48 , H05K1/02
CPC分类号： H01L24/11 , H01L23/49811 , H01L23/49816 , H01L24/13 , H01L24/16 , H01L24/32 , H01L2224/131 , H01L2224/16225 , H01L2224/16227 , H01L2224/32059 , H01L2224/32225 , H01L2224/32238 , H01L2224/73204 , H01L2224/83385 , H01L2924/15311 , H01L2924/014 , H01L2924/00
摘要： 本发明公开一种线路基板、半导体封装结构及线路基板制作工艺。线路基板包括一线路叠构、一图案化导体层、一介电层及多个增厚导体层。线路叠构具有一表面。图案化导体层配置在表面上并具有多个走线。各走线具有一接合区段。介电层配置在表面上且覆盖图案化导体层。介电层具有多个接合开口。各接合开口暴露出对应的接合区段。各增厚导体层配置在对应的接合区段上。一种采用上述线路基板的半导体封装结构及一种线路基板制作工艺也提供于此。
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公开(公告)号：CN102611442B
公开(公告)日：2016-03-23
申请号：CN201210038764.0
申请日：2010-04-15
申请人： 威盛电子股份有限公司
发明人： 凡妮莎·S·坎尼克
IPC分类号： H03L7/085
CPC分类号： H03L7/07 , H03L7/0814 , H03L7/085
摘要： 一种侦测时脉信号之间峰值相位误差的方法及装置，峰值相位误差侦测电路包括相位误差逻辑电路以及延迟及暂存逻辑电路。相位误差逻辑电路提供相位差异脉冲信号，相位差异脉冲信号包含指示一对时脉信号的选择边缘之间的时差的至少一差异脉冲。延迟及暂存逻辑电路接收相位差异脉冲信号以及提供表示该对时脉信号之间的峰值相位误差的峰值相位误差值。延迟及暂存逻辑电路包括延迟线及暂存逻辑电路，延迟线包括多个延迟单元以及多个接头。每一接头提供对应的延迟单元的输出状态。暂存逻辑电路对应差异脉冲的持续时间暂存每一接头的状态以提供多个延迟位。每一延迟位维持设定直到被重置，所以最长的相位差异脉冲信号被暂存以提供此峰值相位误差。
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公开(公告)号：CN102684867B
公开(公告)日：2016-03-09
申请号：CN201210077543.4
申请日：2006-07-28
申请人： 威盛电子股份有限公司
IPC分类号： H04L7/033
CPC分类号： H04L7/0004 , H04L7/0062
摘要： 本申请提供一种时序恢复电路和方法。该时序恢复电路包括一转换器、一时序恢复控制器、和一初始相位产生器。转换器用一取样信号转换一输入信号到取样数据。时序恢复控制器耦接到所述转换器，并且决定所述取样信号。初始相位产生器耦接到所述转换器，只用所述取样数据检测一改变，根据所述改变产生一初始相位，以及控制所述取样信号。该初始相位产生器更计数在该改变的时间位置的该改变作为决定数据，且在该决定数据不小于一目标总和时重设该初始相位产生器。
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公开(公告)号：CN102306253B
公开(公告)日：2016-01-20
申请号：CN201110240081.9
申请日：2011-08-19
申请人： 威盛电子股份有限公司
CPC分类号： G06F12/1408 , G06F9/30076 , G06F9/30101 , G06F21/31 , G06F21/71 , G06F21/78 , G06F21/79
摘要： 微处理器、保密方法以及撤销第一密码的方法。该微处理器包括一密钥、一特别模块寄存器、多个保险丝以及一微码。密钥制造于微处理器的内部。特别模块寄存器具有由微处理器执行的指令所指定的地址。微码用以接收要求对特别模块寄存器进行存取的指令，其中指令用以指定特别模块寄存器的地址；执行所指定的特别模块寄存器的地址与读取自保险丝的数值的一函数运算，用以产生一第一结果；使用密钥对第一结果进行加密，用以产生一第二结果；比较第二结果与指令所指定的密码；以及只有第二结果与密码匹配时，才允许指令对特别模块寄存器进行存取。
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公开(公告)号：CN102937937B
公开(公告)日：2016-01-13
申请号：CN201210479571.9
申请日：2012-11-22
申请人： 威盛电子股份有限公司
发明人： 密瑞.罗曼尼-奥古斯汀 , 约翰.M.吉尔
IPC分类号： G06F12/0862
CPC分类号： G06F12/0862 , G06F9/3455 , G06F9/383 , G06F9/3832 , G06F12/08 , G06F2212/1016 , G06F2212/6024 , G06F2212/6026
摘要： 一种数据预取器及预取数据至高速缓存存储器的方法。该数据预取器，包括具有多已索引的储存元件的一序列，用以储存多个已排序的步幅，这些步幅相关于来自一相同存储器页面的多个暂时相邻的载入要求的一数据流；以及一逻辑单元，用以计算该数据流的一现行载入要求与一最新先前载入要求之间的一现行步幅。逻辑单元对比现行步幅以及序列中的一步幅M，并对比序列中的最新步幅以及已排序的一步幅M+1。当对比配对时，逻辑单元预取一高速缓存线，而该高速缓存线的偏移为该现行载入要求与该步幅M-1的总合。
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公开(公告)号：CN105183134A
公开(公告)日：2015-12-23
申请号：CN201510555362.1
申请日：2011-12-22
申请人： 威盛电子股份有限公司
发明人： 达鲁斯.D.嘉斯金斯 , G.葛兰.亨利
IPC分类号： G06F1/32
CPC分类号： G06F1/06 , G06F1/3296 , Y02D10/172
摘要： 多内核微处理器的共享电源的分布式管理。微处理器提供分布式逻辑并结合用来指示与操作状态相关的电源，如所欲电压和频率比的方法，以共享微处理器电源资源，如一调压器模块(VRM)及锁相回路(PLL)。每个内核产生一数值来指示内核的一所欲操作状态。每个内核也从彼此共享可用资源的内核接收一对应值，并计算出一符合每个共享可用资源的内核的最小需求量的综合值。基于内核是否为了控制或调节可用资源而被选为一主要内核，每个内核更有条件地将此综合值从内核送到可用资源，无须使用任何在多个内核外部的主动逻辑电路，便可将综合值提供给可用共享资源。
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