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公开(公告)号：CN107294531A
公开(公告)日：2017-10-24
申请号：CN201710474840.5
申请日：2017-06-21
申请人： 上海兆芯集成电路有限公司
摘要： 本发明提供了一种锁相回路和分频器。上述锁相回路中包括差异积分调制器、译码器以及分频器。上述译码器耦接上述差异积分调制器，以及产生中间分频比的整数位以及中间分频比的小数位。上述分频器耦接上述译码器，以接收上述中间分频比的整数位和上述中间分频比的小数位。上述分频器根据控制信号切换至整数分频模式或小数分频模式。
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公开(公告)号：CN111654281A
公开(公告)日：2020-09-11
申请号：CN202010521716.1
申请日：2020-06-10
申请人： 上海兆芯集成电路有限公司
IPC分类号： H03L7/113
摘要： 一种时数转换器，包括鉴频鉴相器，第一转换模块，门控环形振荡器以及计数模块。鉴频鉴相器依据第一时钟信号，第二时钟信号输出第一检测信号、第二检测信号。第一转换模块接收第一检测信号以及第二检测信号，以产生并输出第一控制信号以及第二控制信号。门控环形振荡器，接收并根据所述第一控制信号与所述第二控制信号的脉宽差输出多个时钟信号。计数模块，对多个时钟信号进行计数，以产生第一时钟信号及所述第二时钟信号的相位差。
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公开(公告)号：CN107294532B
公开(公告)日：2020-09-11
申请号：CN201710480456.6
申请日：2017-06-22
申请人： 上海兆芯集成电路有限公司
IPC分类号： H03L7/18
摘要： 本发明提供了一种防死锁电路系统和方法。防死锁电路系统中包括第一分频器、第二分频器、差异积分调制器以及检测电路。上述第一分频器产生第一分频时钟信号。上述第二分频器产生第二分频时钟信号。上述差异积分调制器耦接上述第一分频器，以及输出输出信号。上述检测电路耦接至上述差异积分调制器和上述第二分频器，且上述检测电路接收上述输出信号，并根据上述输出信号产生控制信号，以决定是否致能上述第二分频器。
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公开(公告)号：CN112234952B
公开(公告)日：2022-09-06
申请号：CN202011056227.X
申请日：2020-09-29
申请人： 上海兆芯集成电路有限公司
摘要： 一种振荡器电路，包括多个串联的差分放大器以及辅助启动电路。每一差分放大器的第一输出端耦接下一差分放大器的第一输入端，每一差分放大器的第二输出端耦接下一差分放大器的第二输入端，末个差分放大器的第一输出端耦接首个差分放大器的第二输入端，末个差分放大器的第二输出端耦接首个差分放大器的第一输入端。辅助启动电路依据第一差分放大器的第一输入端的信号状态，产生第一扰动信号至第二差分放大器的第一输入端，产生第二扰动信号至第二差分放大器的第二输入端。第一差分放大器为任一差分放大器，第二差分放大器为另一差分放大器。
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公开(公告)号：CN107294532A
公开(公告)日：2017-10-24
申请号：CN201710480456.6
申请日：2017-06-22
申请人： 上海兆芯集成电路有限公司
IPC分类号： H03L7/18
摘要： 本发明提供了一种防死锁电路系统和方法。防死锁电路系统中包括第一分频器、第二分频器、差异积分调制器以及检测电路。上述第一分频器产生第一分频时钟信号。上述第二分频器产生第二分频时钟信号。上述差异积分调制器耦接上述第一分频器，以及输出输出信号。上述检测电路耦接至上述差异积分调制器和上述第二分频器，且上述检测电路接收上述输出信号，并根据上述输出信号产生控制信号，以决定是否致能上述第二分频器。
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公开(公告)号：CN112234952A
公开(公告)日：2021-01-15
申请号：CN202011056227.X
申请日：2020-09-29
申请人： 上海兆芯集成电路有限公司
摘要： 一种振荡器电路，包括多个串联的差分放大器以及辅助启动电路。每一差分放大器的第一输出端耦接下一差分放大器的第一输入端，每一差分放大器的第二输出端耦接下一差分放大器的第二输入端，末个差分放大器的第一输出端耦接首个差分放大器的第二输入端，末个差分放大器的第二输出端耦接首个差分放大器的第一输入端。辅助启动电路依据第一差分放大器的第一输入端的信号状态，产生第一扰动信号至第二差分放大器的第一输入端，产生第二扰动信号至第二差分放大器的第二输入端。第一差分放大器为任一差分放大器，第二差分放大器为另一差分放大器。
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公开(公告)号：CN107294531B
公开(公告)日：2020-09-11
申请号：CN201710474840.5
申请日：2017-06-21
申请人： 上海兆芯集成电路有限公司
摘要： 本发明提供了一种锁相回路和分频器。上述锁相回路中包括差异积分调制器、译码器以及分频器。上述译码器耦接上述差异积分调制器，以及产生中间分频比的整数位以及中间分频比的小数位。上述分频器耦接上述译码器，以接收上述中间分频比的整数位和上述中间分频比的小数位。上述分频器根据控制信号切换至整数分频模式或小数分频模式。
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公开(公告)号：CN111641410A
公开(公告)日：2020-09-08
申请号：CN202010572229.8
申请日：2020-06-22
申请人： 上海兆芯集成电路有限公司
摘要： 一种数字锁相回路包括：时间数字转换器、数字滤波器、数字控制振荡器以及分频器。时间数字转换器将反馈时钟信号与参考时钟信号的相位差转换为数字信号。数字滤波器对数字信号滤波而产生滤波信号。数字控制振荡器根据滤波信号以及分频信号产生输出时钟信号，其中输出时钟信号具有输出频率。分频器根据分频信号，将输出时钟信号分频而产生反馈时钟信号，其中反馈时钟信号的反馈频率为输出频率除以分频信号。
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公开(公告)号：CN205430207U
公开(公告)日：2016-08-03
申请号：CN201520997382.X
申请日：2015-12-03
申请人： 上海兆芯集成电路有限公司
发明人： 王晓光
摘要： 一种处理电路和锁相回路。该处理电路包括一电压调节器、一转换单元以及一第一开关。电压调节器根据一输入电压，产生一输出电压。转换单元根据一操作电压产生一输出频率。第一开关耦接于电压调节器与转换单元之间，并根据一第一控制信号，将输出电压作为操作电压提供给转换单元。当第一开关提供操作电压时，转换单元产生输出频率。当第一开关未提供操作电压时，转换单元停止产生输出频率。
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公开(公告)号：CN205249185U
公开(公告)日：2016-05-18
申请号：CN201520969265.2
申请日：2015-11-27
申请人： 上海兆芯集成电路有限公司
发明人： 王晓光
IPC分类号： H03L7/18
摘要： 一种锁相环，包括降频单元、相位频率侦测单元、电荷泵、滤波单元以及压控振荡器单元。降频单元降低输入时钟的频率，用以产生参考时钟，并降低输出时钟的频率，用以产生回授时钟。相位频率侦测单元耦接降频单元，并根据参考时钟及回授时钟的相位差，产生侦测信号。电荷泵耦接相位频率侦测单元，并根据侦测信号调整控制电压。滤波单元耦接电荷泵，并滤除控制电压的高频噪声。压控振荡器单元耦接滤波单元，并根据控制电压产生输出时钟。
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