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公开(公告)号：CN114330184A
公开(公告)日：2022-04-12
申请号：CN202210249362.9
申请日：2022-03-15
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/331 , G06F111/04
摘要： 本申请提供了一种多层次分组方法及装置，先获取与芯片设计相匹配的初始适用组网，再调用分组引擎对芯片设计在适用组网上逐层进行分组以得到分组结果及性能表现报告，并在每层分组时先对通信成员进行标记，最后根据性能表现报告调整分组引擎和\或调整所述适用组网重新进行分组，通过迭代直至得到满足要求的分组结果。本申请的方案借助多叉树能够支持任意层次的分组，灵活方便，可扩展性强。通过反馈、迭代，可以逐步完善分组结果。同时，通过标记通信成员可以解决通信资源利用效率不高的问题，信号可通过富余的通信资源进行传递，避免了局域通信出现瓶颈，从而提高了整个验证系统的工作频率，进而大幅提升了验证系统的性能。
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公开(公告)号：CN114330173A
公开(公告)日：2022-04-12
申请号：CN202210217757.0
申请日：2022-03-08
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/323 , G06F30/327
摘要： 本发明提供了一种边界节点连接关系获取方法、装置、计算机设备和存储介质，属于集成电路芯片设计领域，方法包括解析携带有预设节点的设计文件，设计文件用于描述电路系统的各电路节点的结构以及电路节点之间的连接关系，并提取连接关系生成与电路节点对应的语法树图；采用边界寻找算法对所述语法树图进行寻找，得到与所述语法树图对应的分割边界；根据所述语法树图从顶部节点开始逐层获取所有所述电路节点之间的连接关系，直至获取到所述分割边界的边界节点与其他所述电路节点之间的连接关系，得到边界节点连接关系。通过本申请的处理方案，在不破坏实例树层级结构的条件下完成连接关系提取。
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公开(公告)号：CN113312865B
公开(公告)日：2021-11-02
申请号：CN202110867351.2
申请日：2021-07-30
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/3312 , G06F30/327
摘要： 本发明提供了一种分割时钟筛选方法、装置、计算机设备和存储介质，属于芯片设计领域，具体包括解析可编程逻辑验证阵列的设计文件，得到语法节点及语法节点信息；获取最小分割时钟数量以及预设时钟切割列表；根据语法节点信息确定第一分割时钟；对所有语法节点进行聚类合并；根据合并后的语法节点信息中各节点时钟出现的次数从预设时钟切割列表筛选第二分割时钟；根据最小分割时钟数量以及连线权重值将语法树结构分配到可编程逻辑阵列上，得到与可编程逻辑阵列对应的第三分割时钟；根据第一分割时钟、第二分割时钟和第三分割时钟生成分割时钟列表。通过本申请的处理方案，不仅减轻时序分析和TDM插入的难度，还能提高系统运行的性能与准确率。
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公开(公告)号：CN114781300B
公开(公告)日：2022-09-09
申请号：CN202210701034.8
申请日：2022-06-21
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/347 , G06F30/3953
摘要： 本发明提供了一种可编辑逻辑阵列布线方法、装置、设备和存储介质，属于集成电路芯片设计领域，方法包括解析组网布局文件，获取多组逻辑分组构成的第一布局；寻找第一布局的布局中心点，构建极坐标系；基于预设规则将所有逻辑分组按照它们的极坐标进行排序，得到组网布局文件的第一坐标数组；筛选器件布线数据库中所有与组网布局文件的坐标数组长度相同的参考布局；计算参考布局的理论坐标数组与第一坐标数组的差异度；根据差异度最小的参考布局的布线结果对组网布局文件进行布线，得到可编辑逻辑阵列的布线。通过本申请的处理方案，快速准确地得到可编辑逻辑阵列的布线。
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公开(公告)号：CN114781295A
公开(公告)日：2022-07-22
申请号：CN202210700998.0
申请日：2022-06-21
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/3308
摘要： 本申请实施例提供了一种逻辑电路规模缩减方法及装置，先对逻辑电路的实例树进行资源评估，即获取实例树中每个节点的资源量信息，得到实例树资源分布情况，再基于节点资源量与资源阈值区间的关系并结合节点内部紧密度，在实例树中自动确定一个或多个剪枝位置，然后在所述剪枝位置对实例树进行剪枝，从而完成逻辑电路规模缩减。本申请实施例中的方案借助节点资源量、资源阈值区间、节点内部紧密度等可以科学的计算出剪枝位置并进行自动剪枝，不但提高了规模缩减操作时的效率，而且剪枝位置更加合理、精准，从而改善了规模缩减操作的效果，进而可以有效降低后续分割等过程的处理难度和复杂度。
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公开(公告)号：CN114330184B
公开(公告)日：2022-07-15
申请号：CN202210249362.9
申请日：2022-03-15
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/331 , G06F111/04
摘要： 本申请提供了一种多层次分组方法及装置，先获取与芯片设计相匹配的初始适用组网，再调用分组引擎对芯片设计在适用组网上逐层进行分组以得到分组结果及性能表现报告，并在每层分组时先对通信成员进行标记，最后根据性能表现报告调整分组引擎和\或调整所述适用组网重新进行分组，通过迭代直至得到满足要求的分组结果。本申请的方案借助多叉树能够支持任意层次的分组，灵活方便，可扩展性强。通过反馈、迭代，可以逐步完善分组结果。同时，通过标记通信成员可以解决通信资源利用效率不高的问题，信号可通过富余的通信资源进行传递，避免了局域通信出现瓶颈，从而提高了整个验证系统的工作频率，进而大幅提升了验证系统的性能。
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公开(公告)号：CN113255265B
公开(公告)日：2021-09-28
申请号：CN202110628401.1
申请日：2021-06-07
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/331 , G06F30/327
摘要： 本说明书实施例提供一种分割及验证方法、装置、电子设备、存储介质，应用于电子设计自动化技术领域，其中分割方法包括：根据待分割设计对应的设计文件，按设计层级划分多个分割层级，并在各所述分割层级内按进行分割处理，以及将分割结果输出。通过基于设计层级进行多层级分割处理，可支持用户设计自定义分组，满足用户个性化分割验证需求，提高分割验证效率。
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公开(公告)号：CN113312865A
公开(公告)日：2021-08-27
申请号：CN202110867351.2
申请日：2021-07-30
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/3312 , G06F30/327
摘要： 本发明提供了一种分割时钟筛选方法、装置、计算机设备和存储介质，属于芯片设计领域，具体包括解析可编程逻辑验证阵列的设计文件，得到语法节点及语法节点信息；获取最小分割时钟数量以及预设时钟切割列表；根据语法节点信息确定第一分割时钟；对所有语法节点进行聚类合并；根据合并后的语法节点信息中各节点时钟出现的次数从预设时钟切割列表筛选第二分割时钟；根据最小分割时钟数量以及连线权重值将语法树结构分配到可编程逻辑阵列上，得到与可编程逻辑阵列对应的第三分割时钟；根据第一分割时钟、第二分割时钟和第三分割时钟生成分割时钟列表。通过本申请的处理方案，不仅减轻时序分析和TDM插入的难度，还能提高系统运行的性能与准确率。
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公开(公告)号：CN113255272A
公开(公告)日：2021-08-13
申请号：CN202110606072.0
申请日：2021-06-01
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/34 , G06F30/343 , G06F30/347 , G06F8/33
摘要： 本说明书实施例提供一种语句块封装方法、装置、电子设备及存储介质，应用于电子设计自动化技术领域，其中封装方法包括：根据RTL分割工具获得的分割边界确定若干待封装语句块；遍历每个所述待封装语句块，其中将当前所述待封装语句块所在的模块作为当前处理模块；扫描所述当前处理模块，确定所述当前处理模块是否包含黑盒信号，依据黑盒信号聚类子模块和语句块进行封装处理。通过以黑盒信号为纽带进行封装处理，使得RTL分割工具适用于对不同语法规则下的子模块和语句块进行封装处理，提高处理效率，实现快速布局规划。
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公开(公告)号：CN113255264A
公开(公告)日：2021-08-13
申请号：CN202110628384.1
申请日：2021-06-07
申请人： 上海国微思尔芯技术股份有限公司
IPC分类号： G06F30/331 , G06F30/327
摘要： 本发明提供了一种增量分割处理方法、装置、计算机设备和存储介质，属于分割算法领域，具体方法包括获取并解析初始设计文件的初始语法树结构以及修改设计文件的修改语法树结构；获取全流程运行所述初始设计文件的初始运行数据，设定第一可编程逻辑器件；比较初始语法树结构以及修改语法树结构之间的差异节点；根据差异节点识别第一可编程逻辑器件和第二可编程逻辑器件；计算得到在节点位置分布状态下的节点和第二可编程逻辑器件之间的最优分配，得到增量分割处理结果。通过本申请的处理方案，可以对发生少量修改的设计文件进行快速分割处理，节省时间提高效率。
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