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公开(公告)号：CN100547554C
公开(公告)日：2009-10-07
申请号：CN200710142027.4
申请日：2007-08-20
Applicant: 富士通微电子株式会社
Inventor： 笹崎勋
IPC: G06F11/00
CPC classification number: G06F11/10
Abstract: 本发明提供了一种错误处理方法和信息处理装置。错误处理方法通过以下步骤来对在CPU的总线上生成的错误进行处理：通过总线错误输入部分向CPU输入在CPU的指令总线和数据总线中的至少一个上生成的总线错误；通过CPU的总线错误计数器部分对总线错误计数；以及基于总线错误计数器部分的值来指定与CPU相耦合的存储器部分的区域。
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