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公开(公告)号：CN1084896C
公开(公告)日：2002-05-15
申请号：CN96107629.1
申请日：1996-06-17
Applicant: 株式会社东芝
IPC: G06F12/00
CPC classification number: G06F12/0831
Abstract: 总线接口与系统总线相连，监视表示处理器的高速缓冲存储器中数据更新的总线命令。如果高速缓冲存储器中数据更新，那么外部附加的存储设备存储表示数据更新的状态信息和对应于被更新数据的物理地址。当高速缓冲存储器中被更新数据存储在主存储器中时，外部附加的读出设备读出存储在外部附加存储设备中的状态信息。根据该状态产生从高速缓冲存储器向主存储器清空的总线命令。无效总线命令产生装置通过FIFO向系统总线输出无效总线命令。
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Patent Agency Ranking
公开(公告)号：CN102473140B
公开(公告)日：2015-05-13
申请号：CN201080031863.5
申请日：2010-03-08
Applicant: 株式会社东芝
CPC classification number: G06F3/0604 , G06F3/061 , G06F3/0631 , G06F3/0638 , G06F3/0653 , G06F3/0679 , G06F12/0223 , G06F12/0246 , G06F12/06 , G06F2212/1016 , G06F2212/1036 , G06F2212/205 , G06F2212/7201 , G06F2212/7202 , G06F2212/7208
Abstract: 本发明的一个例子的存储器管理装置(1)根据来自处理器(6a)的写入请求及读出请求，控制对包含非易失性半导体存储器(9)和易失性半导体存储器(8)的主存储器(2)的写入及读出。存储器管理装置(1)具备：保持基于在非易失性半导体存储器(9)和易失性半导体存储器(8)的至少一方中写入的写入对象数据的数据特性而生成的着色信息(14)的着色信息保持部(17)，以及参照着色信息(14)从非易失性半导体存储器(9)和易失性半导体存储器(8)中决定写入对象数据的区域的写入管理部(15)。
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公开(公告)号：CN1142634A
公开(公告)日：1997-02-12
申请号：CN96107629.1
申请日：1996-06-17
Applicant: 株式会社东芝
IPC: G06F12/00
CPC classification number: G06F12/0831
Abstract: 总线接口与系统总线相连，监视表示处理器的高速缓冲存储器中数据更新的总线命令。如果高速缓冲存储器中数据更新，那么外部附加的存储设备存储表示数据更新的状态信息和对应于被更新数据的物理地址。当高速缓冲存储器中被更新数据存储在主存储器中时，外部附加的读出设备读出存储在外部附加存储设备中的状态信息。根据该状态产生从高速缓冲存储器向主存储器清空的总线命令。无效总线命令产生装置通过FIFO向系统总线输出无效总线命令。
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公开(公告)号：CN101673245B
公开(公告)日：2016-02-03
申请号：CN200910002294.0
申请日：2009-09-09
Applicant: 株式会社东芝
IPC: G06F12/1027
CPC classification number: G06F12/0804 , G06F12/0246 , G06F12/08 , G06F12/0888 , G06F2212/1036 , G06F2212/2022 , G06F2212/205 , G06F2212/7201
Abstract: 本发明涉及包括存储器管理装置的信息处理装置，其具备：从处理器接收写入目的地逻辑地址和写入对象数据的部分，该写入目的地逻辑地址指定对混合存储器的写入位置，该混合存储器包括第1存储器和非易失性的第2存储器；以使得对上述第2存储器的存取次数少于对上述第1存储器的存取次数的方式，确定与上述写入目的地逻辑地址对应的写入目的地物理地址的部分；把使得上述写入目的地逻辑地址与上述写入目的地物理地址相关的地址变换数据，存储到存储部的部分；以及，把上述写入对象数据写入到上述混合存储器中的、由上述写入目的地物理地址所表示的位置的部分。
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公开(公告)号：CN102473140A
公开(公告)日：2012-05-23
申请号：CN201080031863.5
申请日：2010-03-08
Applicant: 株式会社东芝
CPC classification number: G06F3/0604 , G06F3/061 , G06F3/0631 , G06F3/0638 , G06F3/0653 , G06F3/0679 , G06F12/0223 , G06F12/0246 , G06F12/06 , G06F2212/1016 , G06F2212/1036 , G06F2212/205 , G06F2212/7201 , G06F2212/7202 , G06F2212/7208
Abstract: 本发明的一个例子的存储器管理装置(1)根据来自处理器(6a)的写入请求及读出请求，控制对包含非易失性半导体存储器(9)和易失性半导体存储器(8)的主存储器(2)的写入及读出。存储器管理装置(1)具备：保持基于在非易失性半导体存储器(9)和易失性半导体存储器(8)的至少一方中写入的写入对象数据的数据特性而生成的着色信息(14)的着色信息保持部(17)，以及参照着色信息(14)从非易失性半导体存储器(9)和易失性半导体存储器(8)中决定写入写入对象数据的区域的写入管理部(15)。
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公开(公告)号：CN101673245A
公开(公告)日：2010-03-17
申请号：CN200910002294.0
申请日：2009-09-09
Applicant: 株式会社东芝
IPC: G06F12/08
CPC classification number: G06F12/0804 , G06F12/0246 , G06F12/08 , G06F12/0888 , G06F2212/1036 , G06F2212/2022 , G06F2212/205 , G06F2212/7201
Abstract: 本发明涉及包括存储器管理装置的信息处理装置，其具备：从处理器接收写入目的地逻辑地址和写入对象数据的部分，该写入目的地逻辑地址指定对混合存储器的写入位置，该混合存储器包括第1存储器和非易失性的第2存储器；以使得对上述第2存储器的存取次数少于对上述第1存储器的存取次数的方式，确定与上述写入目的地逻辑地址对应的写入目的地物理地址的部分；把使得上述写入目的地逻辑地址与上述写入目的地物理地址相关的地址变换数据，存储到存储部的部分；以及，把上述写入对象数据写入到上述混合存储器中的、由上述写入目的地物理地址所表示的位置的部分。
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