局部斜坡缓冲器电路中的斜坡稳定辅助电路

    公开(公告)号:CN116915220A

    公开(公告)日:2023-10-20

    申请号:CN202310375788.3

    申请日:2023-04-10

    IPC分类号: H03K4/02 G06T1/20

    摘要: 本公开涉及一种局部斜坡缓冲器电路中的斜坡稳定辅助电路。斜坡缓冲器电路包含具有经耦合以接收斜坡信号的输入的输入装置。偏置电流源耦合到所述输入装置的输出。所述输入装置及所述偏置电流源耦合于电源线与接地之间。辅助电流源耦合于所述输入装置的所述输出与接地之间。所述辅助电流源经配置以仅在于所述斜坡信号中产生的斜坡事件期间将辅助电流从所述输入装置的所述输出传导到接地。

    用于图像传感器中的多条位线的列ASIL电路

    公开(公告)号:CN116896623A

    公开(公告)日:2023-10-17

    申请号:CN202310337415.7

    申请日:2023-03-31

    摘要: 本发明提供了一种用于图像传感器的故障检测电路以及一种用于检测位线中的故障的方法。用于图像传感器的故障检测电路包括第一输入节点、第二输入节点的阵列和输出级。第一输入节点耦合到参考电压。第二输入节点的阵列具有耦合成从包括像素的阵列的图像传感器中的位线阵列的位线接收信号的每个输入节点,其中每个像素耦合到位线阵列的至少一条位线。输出级被耦合成生成指示第二输入节点中的任何一个低于参考电压的输出电压。

    格雷码计数信号分布系统

    公开(公告)号:CN112087227B

    公开(公告)日:2022-08-26

    申请号:CN202010302645.6

    申请日:2020-04-13

    IPC分类号: H03K23/00

    摘要: 本申请案涉及一种格雷码计数信号分布系统。计数器分布系统包含N位计数器以接收第一计数时钟以生成多个数据位,所述多个数据位包含下部数据位线上的下部数据位和上部数据位线上的上部数据位。所述上部数据位包含至少一个冗余位以为所述计数器分布系统提供错误校正。多个锁存器耦合到所述N位计数器。所述下部数据位线中的每一个和所述上部数据位线中的每一个耦合到所述锁存器中的至少一个。所述锁存器经布置成多个锁存器分组。每一锁存器分组耦合到相应锁存器启用信号。每一锁存器分组中的每一锁存器经耦合以响应于所述相应锁存器启用信号而锁存所述多个数据位中的相应一个。

    用于本地斜波缓冲器电路中斜波稳定辅助电路的校准电路

    公开(公告)号:CN116915255A

    公开(公告)日:2023-10-20

    申请号:CN202310384481.X

    申请日:2023-04-11

    IPC分类号: H03M1/34 G01R19/25 H03M1/46

    摘要: 本申请涉及用于本地斜波缓冲器电路中斜波稳定辅助电路的校准电路。一种斜波缓冲器电路包含斜波缓冲器输入装置,所述斜波缓冲器输入装置具有经耦合以接收斜波信号的输入。电流监测器电路耦合到电力线及所述斜波缓冲器输入装置以响应于传导通过所述斜波缓冲器输入装置的输入电流而产生电流监测信号。拐角偏置电路耦合到所述电流监测器电路以响应于所述电流监测信号而产生辅助偏置电压。偏置电流源耦合到所述斜波缓冲器输入装置的输出。辅助电流源耦合到所述拐角偏置电路且耦合于所述斜波缓冲器输入装置的所述输出与接地之间以响应于所述辅助偏置电压而将辅助电流从所述斜波缓冲器输入装置的所述输出传导到接地。

    格雷码计数信号分布系统

    公开(公告)号:CN112087227A

    公开(公告)日:2020-12-15

    申请号:CN202010302645.6

    申请日:2020-04-13

    IPC分类号: H03K23/00

    摘要: 本申请案涉及一种格雷码计数信号分布系统。计数器分布系统包含N位计数器以接收第一计数时钟以生成多个数据位,所述多个数据位包含下部数据位线上的下部数据位和上部数据位线上的上部数据位。所述上部数据位包含至少一个冗余位以为所述计数器分布系统提供错误校正。多个锁存器耦合到所述N位计数器。所述下部数据位线中的每一个和所述上部数据位线中的每一个耦合到所述锁存器中的至少一个。所述锁存器经布置成多个锁存器分组。每一锁存器分组耦合到相应锁存器启用信号。每一锁存器分组中的每一锁存器经耦合以响应于所述相应锁存器启用信号而锁存所述多个数据位中的相应一个。

    具有冗余位的两级格雷码计数器
    6.
    发明公开

    公开(公告)号:CN111193508A

    公开(公告)日:2020-05-22

    申请号:CN201911100110.4

    申请日:2019-11-12

    摘要: 本申请涉及具有冗余位的两级格雷码计数器。一种N位计数器,其包含具有有M个位的第一输出的低位计数器,所述低位计数器在第一计数频率下操作。具有有N-M+L个位的第二输出的高位计数器在第二计数频率下操作。所述第二计数频率等于所述第一计数频率除以2(M-L)。误差校正控制器经耦合以接收所述第一及第二输出且执行操作,所述操作包含将所述第二输出的L个最低有效位LSB与所述第一输出的至少一个最高有效位MSB进行比较,及响应于所述比较校正所述第二输出的N-M个MSB。所述N位计数器的低位为所述第一输出的所述M个位,且所述N位计数器的高位为所述第二输出的经校正N-M个MSB。

    用于列ADC的动态电流控制
    7.
    发明公开

    公开(公告)号:CN118574021A

    公开(公告)日:2024-08-30

    申请号:CN202410172648.0

    申请日:2024-02-07

    IPC分类号: H04N25/40 H03M1/12 H04N25/78

    摘要: 本公开针对于用于列ADC的动态电流控制。一种比较器的尾电流源包含经配置以作为电流源操作的第一晶体管及第二晶体管,其中所述第一晶体管及所述第二晶体管耦合于所述比较器的尾节点与电压节点之间,且其中所述尾节点包括耦合到所述比较器的第一输入及第二输入的节点。所述尾电流源还包含经配置以选择性地将所述第二晶体管耦合于所述尾节点与所述电压节点之间的开关,以及耦合到所述第一晶体管及所述第二晶体管的栅极的偏置电压源。所述开关经配置以在模/数转换ADC复位信号周期及ADC图像信号周期期间接通,且所述开关经配置以在自动调零周期、所述ADC复位信号周期与所述ADC图像信号周期之间的周期以及所述ADC图像信号周期之后的周期期间关断。