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公开(公告)号:CN103250411A
公开(公告)日:2013-08-14
申请号:CN201080070327.6
申请日:2010-11-25
Applicant: 飞思卡尔半导体公司
IPC: H04N7/26
CPC classification number: H04N19/30 , H04N19/115 , H04N19/126 , H04N19/149 , H04N19/187 , H04N19/36
Abstract: 描述了一种用于可伸缩视频编码系统内的位速率控制的方法(500)。所述方法包括:对于可伸缩编码视频位流内的访问单元,确定可伸缩编码视频位流内的至少一个空间相关层的位预算(525);以及至少部分地基于所述至少一个空间相关层的所确定的位预算来计算用于编码所述至少一个空间相关层的量化参数(QP)值(530、560)。
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公开(公告)号:CN103250411B
公开(公告)日:2016-10-19
申请号:CN201080070327.6
申请日:2010-11-25
Applicant: 飞思卡尔半导体公司
IPC: H04N19/149 , H04N19/115 , H04N19/126 , H04N19/187
CPC classification number: H04N19/30 , H04N19/115 , H04N19/126 , H04N19/149 , H04N19/187 , H04N19/36
Abstract: 描述了一种用于可伸缩视频编码系统内的位速率控制的方法(500)。所述方法包括:对于可伸缩编码视频位流内的访问单元,确定可伸缩编码视频位流内的至少一个空间相关层的位预算(525);以及至少部分地基于所述至少一个空间相关层的所确定的位预算来计算用于编码所述至少一个空间相关层的量化参数(QP)值(530、560)。
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公开(公告)号:CN103069797A
公开(公告)日:2013-04-24
申请号:CN201080068785.6
申请日:2010-08-26
Applicant: 飞思卡尔半导体公司
IPC: H04N7/26
CPC classification number: H04N19/436 , H04N19/30
Abstract: 本发明属于用于视频处理的视频处理系统。视频处理系统被布置成将任务分配到能够并行处理任务的至少两个并行处理单元。视频处理系统还被布置成控制至少一个存储设备存储要处理的输入视频数据、处理后的视频数据和视频处理任务的任务列表。视频处理系统被布置成提供和/或处理具有分级增强结构的视频数据,该分级增强结构包括至少一个基本层和取决于基本层的一个或多个增强层和/或至少一个其他增强层。其还被布置成将任务列表的至少一个任务分配到并行处理单元中的一个,并且在并行处理单元已处理任务之后利用与涉及取决于处理后的任务的至少一个增强层的任务有关的信息来更新任务列表。本发明还属于用于并行处理视频数据的对应方法。
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