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公开(公告)号：CN105827238A
公开(公告)日：2016-08-03
申请号：CN201510993455.2
申请日：2015-12-25
Applicant: 飞思卡尔半导体公司
Abstract: 本公开涉及校准双端口锁相环路的系统及方法。本公开提供了锁相环路(PLL)，该锁相环路包括高端口校准控制模块(116)，该高端口校准控制模块被配置为：将压控振荡器(VCO)的输入调制值校准(208)到第一调制值，该第一调制值导致所述VCO的输出信号具相对于初始输出频率的正频率变化；以及在第一累积时间段之后捕获(210)所述输出信号的正频率值。所述高端口校准控制模块还被配置为：将所述VCO的输入调制值校准(212)到负调制值，该负调制值导致所述输出信号具有相对于所述初始输出频率的负频率变化；在第二累积时间段之后捕获所述输出信号的负频率值；以及基于正频率值和负频率值之间的差计算校准缩放因子。
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