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公开(公告)号：CN109347623B
公开(公告)日：2022-09-09
申请号：CN201811216775.7
申请日：2018-10-18
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L9/06 , H04L12/741 , H04L12/803 , H04L29/08
摘要： 本发明揭示了一种在链路负载均衡应用中进行会话保持的方法及装置，所述方法包括：基于报文内容产生第一哈希值和第二哈希值，根据第一哈希值查找负载均衡成员表得到对应的一个第一成员出口，同时根据第二哈希值查找聚合流表得到对应的一条流表；根据流表状态，选择第一或第二成员出口作为报文转发出口；或在选择的第二成员出口为down状态时，查找备份链路表，选取出一个备份成员出口，作为报文当前转发出口。本发明以简单的实现方案满足了会话保持的要求，方便硬件实现，且可支持高性能交换机在在高转发性能下进行部署。
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公开(公告)号：CN112822126A
公开(公告)日：2021-05-18
申请号：CN202011609386.8
申请日：2020-12-30
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L12/883 , H04L12/861
摘要： 本申请所提供了一种报文存储方法、报文出入队列方法及存储调度装置，报文存储方法包括：将报文依次划分为N个报文分片L0、L1、…、LN‑1，N＝int(L/W)，int为向上取整函数，报文分片L0携带sop标志位，报文LN‑1携带eop标志位；为待存入数据存储器的报文分片申请空闲地址ptr_X，链表控制模块的信息链表存储有：下一个报文的信息链表首地址、数据链表首地址以及数据eop标志位；数据链表存储有：下一个报文分片的数据分片地址和数据eop标志位。本发明所提供的出队列方法，在出队列操作时，通过信息链表和数据链表的融合设置，通过一次调度即可直接得到报文的分片地址，有效降低报文转发延时，同时减少了消息调度到数据调度之间的缓存信息，优化了芯片物理面积。
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公开(公告)号：CN112822112A
公开(公告)日：2021-05-18
申请号：CN202011640825.1
申请日：2020-12-31
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L12/743 , H04L12/753 , G06F3/06
摘要： 本发明提供了一种路由地址存储方法及装置，其中，该方法包括：通过静态随机存储器SRAM存储多个路由地址，其中，该SRAM的一个SRAM条目中存储一个或多个路由树，每个该路由树包括多个路由地址；将该SRAM中该多个路由地址的公共前缀存储于三态内容寻址存储器TCAM的TCAM条目中，其中，多个TCAM条目对应一个该SRAM条目，可以解决相关技术SRAM条目资源全部被使用，但是每个SRAM Entry都没有被存满，这样便导致了资源的浪费的问题，通过多个TCAM条目对应一个该SRAM条目，即在一个SRAM条目中存储多个路由树，使得同一个SRAM条目中由于拆树留下的空间可以被用于存储其它路由树，减少了资源浪费。
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公开(公告)号：CN112804130A
公开(公告)日：2021-05-14
申请号：CN202011639325.6
申请日：2020-12-31
申请人： 盛科网络(苏州)有限公司
摘要： 本发明提供了一种报文处理方法及装置、系统、存储介质以及电子设备，上述方法包括：在通过第一虚拟可扩展局域网隧道终端VTEP中的第一交换芯片对目标报文进行虚拟可扩展局域网VXLAN封装的过程中，通过第一交换芯片在目标报文的VXLAN报文头中添加源节点对应的第一终结点分组EPG标识以得到VXLAN报文，目标报文为源节点发送给目的节点的报文；通过第二VTEP接收第一VTEP发送的VXLAN报文；通过第二VTEP中的第二交换芯片对VXLAN报文进行解封装得到第一EPG标识和目标报文；通过第二交换芯片根据目标隔离策略对目标报文进行处理，目标隔离策略为根据第一EPG标识以及目的节点对应的第二EPG标识确定的隔离策略。通过本发明，解决了相关技术中无法实现交换芯片级的VXLAN微分段的技术问题。
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公开(公告)号：CN112714067A
公开(公告)日：2021-04-27
申请号：CN202011525866.6
申请日：2020-12-22
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L12/741 , H04L12/733 , H04L12/715 , H04L29/12 , H04L12/46
摘要： 本发明揭示了一种路由扩展的芯片实现方法、数据报文的芯片处理方法及装置，所述芯片实现方法包括在路由查找结果中增加桥接转发使能字段，桥接转发使能字段用于控制数据报文是否使能FDB转发表项的查找。本发明通过路由扩展技术来使能桥接FDB转发表项查找，解决VXLAN域出口网关同时提供虚拟机访问外网和访问私网服务器的问题，也避免了对Default PBR表项的消耗。
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公开(公告)号：CN112671608A
公开(公告)日：2021-04-16
申请号：CN202011494155.7
申请日：2020-12-17
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L12/26 , H04L12/935
摘要： 本申请提供了一种IPG监测方法、交换设备以及交换系统，其中，IPG监测方法应用于期望发送端满带宽发送报文的场景下，接收端的IPG监测，所述方法包括：满带宽确认步骤，确认当前发送端是否已满带宽传输数据；DIC计算步骤，在确认所述发送端已满带宽传输数据后，基于所述发送端的传输速率和标准IPG，通过逐一检测所述接收端的IPG获取当前DIC的唯一值；以及IPG确认步骤，基于所述唯一值，判断所述接收端后续的IPG是否正确。能够于发送端初始时未满足满带宽发送数据时于报文发送后的中间位置基于IPG计算DIC，并基于当前DIC监测IPG是否正确。
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公开(公告)号：CN112600802A
公开(公告)日：2021-04-02
申请号：CN202011397844.6
申请日：2020-12-04
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L29/06 , H04L12/46 , H04L12/721 , H04L12/723
摘要： 本发明揭示了一种SRv6加密报文、SRv6报文的加解密方法及装置，所述SRv6加密报文包括UDP头部、MACSec报文的安全标记字段和加密后的报文内层信息，UDP头部包括用于标识报文为SRv6加密报文的目的端口号，安全标记字段插入于UDP头部和报文内层信息之间，根据安全标记字段对报文内层信息进行加密。本发明将二层加解密MACsec技术与SRv6报文环境相结合，以达到对SRv6报文内层信息加密的目的，提升传输数据安全性。
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公开(公告)号：CN112565263A
公开(公告)日：2021-03-26
申请号：CN202011413198.8
申请日：2020-12-04
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L29/06 , H04L12/851
摘要： 本发明揭示了一种基于硬管道的加解密方法及装置，方法包括接收报文并划分至不同优先级的硬管道中并将报文送入入方向处理模块对应的硬管道中，入方向处理模块对报文进行查表处理并通过队列调度模块将报文送入出方向处理模块对应的硬管道中，出方向处理模块将相应硬管道中的需要加解密的报文送入加解密模块对应的硬管道中，加解密模块依据优先级对不同硬管道中的报文进行加解密处理并转发至入方向处理模块对应的硬管道中，入方向处理模块将加解密后的报文通过队列调度模块环回至出方向处理模块对应硬管道中，出方向处理模块对不同硬管道中的报文进行转发。本发明能够确保高优先级流量在全流水线优先处理，满足确定性低时延需求。
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公开(公告)号：CN112491749A
公开(公告)日：2021-03-12
申请号：CN202011293997.6
申请日：2020-11-18
申请人： 盛科网络(苏州)有限公司
IPC分类号： H04L12/939 , H04L12/931 , H04L12/933 , H04L12/709 , H04L12/703 , H04L12/711
摘要： 本申请所提供的一种基于ASIC的聚合链路快速收敛方法、转发报文的方法及装置，基于ASIC的聚合链路快速收敛方法，应用于交换设备，所述交换设备的多个链路聚合成一个链路聚合组，形成所述多个链路的物理端口即为所述链路聚合组的成员端口，每一所述成员端口均配置其它所述成员端口之一作为备份端口，所述方法包括：响应于任一所述成员端口出现故障，所述交换设备的交换芯片基于出现故障的所述成员端口的备份端口将所述聚合链路切换至备份链路，其中，所述备份链路由所述备份端口和其它状态正常的所述成员端口建立。如此设置，可以在芯片层面实现聚合链路的快速收敛，以适应电信级的网络通信响应需求。
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公开(公告)号：CN112463415A
公开(公告)日：2021-03-09
申请号：CN202011491078.X
申请日：2020-12-17
申请人： 盛科网络(苏州)有限公司
摘要： 本申请所提供了一种基于随机地址的多端口共享内存管理系统及方法，基于随机地址管理所述共享内存的数据读/写，包括共享内存、多级调度器以及读/写通道控制模块，读/写通道控制模块包括N个读/写请求通道，多级调度器包括第一级调度器、第二级调度器、…、以及第M级调度器，能够响应于任一读/写请求通道的读/写信息请求，调度对应的读/写请求通道的读/写信息；共享内存深度为P，宽度为W，包括X块深度为P/X，宽度为W的子物理内存，能够基于读/写信息于对应的所述子物理内存读/写数据；M、N、X均为整数，读信息至少包括：读有效标志位、读物理内存编号以及读地址，写信息至少包括：写有效标志位、写物理内存编号以及写地址。
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