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    一种单片机系统
    2.
    发明授权
    一种单片机系统 有权

    公开(公告)号：CN117850570B

    公开(公告)日：2024-08-09

    申请号：CN202410036894.3

    申请日：2024-01-09

    申请人： 广东高云半导体科技股份有限公司

    发明人： 刘锴 ,  宋宁 ,  杜金凤

    IPC分类号： G06F1/3234 ,  G06F1/3237

    摘要： 本申请公开一种单片机系统，包括：单片机(MCU)内核、动态功耗控制模块及第一外设模块；MCU内核设置为：判断出执行的指令需要操作第一外设模块时，发送第一通知消息至第一外设模块；第一外设模块包括请求机制单元，设置为：接收到第一通知消息时，生成请求打开消息；发送请求打开消息至动态功耗控制模块；动态功耗控制模块设置为：根据接收到的请求打开消息，打开第一外设模块的时钟门控；其中，第一外设模块为单片机系统内一个以上时钟门控为关闭的外设模块的其中之一。本公开实施例对执行指令需要操作的第一外设模块通过动态功耗控制模块执行打开时钟门控的处理，实现了单片机系统的动态控制，降低了系统功耗。

    具有多个热功率状态的固态设备
    3.
    发明公开
    具有多个热功率状态的固态设备 审中-实审

    公开(公告)号：CN118284865A

    公开(公告)日：2024-07-02

    申请号：CN202380014591.5

    申请日：2023-04-28

    申请人： 西部数据技术公司

    发明人： D·沃斯曼 ,  S·阿基拉瓦特 ,  J·G·哈恩 ,  J·维拉伊科

    IPC分类号： G06F1/20 ,  G06F1/3237 ,  G06F9/50

    摘要： 提供了存储设备的各方面，该存储设备响应于基于针对不同类型的单元(诸如SLC和MLC)的多个热功率状态的温度改变而应用先进热节流。最初，控制器确定存储器的温度满足多个热节流阈值中的热节流阈值。随后，当该温度满足热节流阈值时，控制器转变到多个热功率状态中的热功率状态。控制器应用与热功率状态相关联的热缓解配置。然后，控制器基于热缓解配置来确定存储器的温度已达到热功率状态中的热平衡。因此，在不损害数据完整性的情况下，通过先进热节流提高了存储设备性能。

    数据传输时钟控制电路、方法和处理器
    4.
    发明授权
    数据传输时钟控制电路、方法和处理器 有权

    公开(公告)号：CN112462845B

    公开(公告)日：2024-06-18

    申请号：CN202011340088.3

    申请日：2020-11-25

    申请人： 海光信息技术股份有限公司

    发明人： 王继东 ,  李重阳

    IPC分类号： G06F1/08 ,  G06F1/3237 ,  G06F5/06

    摘要： 本公开提供了一种数据传输时钟控制电路、方法和处理器。根据本公开的数据传输时钟控制电路包括：比较电路，配置成比较第一级流水线中的第一数据段的输入数据与输出数据是否相同以得到第一比较结果，并基于第一比较结果产生第一时钟控制信号，其中，第一数据段承载数据传输总线中的至少部分数据；以及开关电路，配置成利用第一时钟控制信号控制第N级流水线中的第一数据段的数据传输的开关状态，其中，N为大于1的整数。

    一种低功耗休眠唤醒控制电路和多电源域的控制电路
    5.
    发明授权
    一种低功耗休眠唤醒控制电路和多电源域的控制电路 有权

    公开(公告)号：CN112650384B

    公开(公告)日：2024-05-31

    申请号：CN202110006752.9

    申请日：2021-01-05

    申请人： 大唐微电子技术有限公司

    发明人： 王震

    IPC分类号： G06F1/3293 ,  G06F1/3237 ,  G06F1/3234

    摘要： 本申请实施例公开了一种低功耗休眠唤醒控制电路和多电源域的控制电路。所述低功耗休眠唤醒控制电路包括：锁存器(Latch)，D端与休眠控制电路的输出端相连，RN端通过第六反相器与唤醒控制电路的输出端相连；第二与逻辑门(AND_2)的一个输入端与所述锁存器(Latch)的Q端相连，另一个输入端通过第五反相器与所述唤醒控制电路的输出端相连，输出端输出用于控制系统域内部系统电源(LDO_sys)是否休眠的休眠信号。

    电子装置及其操作方法
    7.
    发明授权
    电子装置及其操作方法 有权

    公开(公告)号：CN114077297B

    公开(公告)日：2024-03-15

    申请号：CN202110768635.6

    申请日：2021-07-07

    申请人： 爱思开海力士有限公司

    发明人： 权九益 ,  金敬锡 ,  朴秀益 ,  朱镕浚

    IPC分类号： G06F1/3237 ,  G06F1/324 ,  G06F1/3234

    摘要： 本公开涉及一种电子装置及其操作方法，该电子装置包括：装置接口，提供到主机的接口并且检测链路信息，该链路信息与装置接口在与主机通信时提供的带宽相关联；处理器，联接到装置接口以与主机通信，并被构造为可操作以响应于通过装置接口从主机接收的请求而控制电子装置的操作；以及时钟发生器，被联接以向装置接口和处理器提供待用于操作装置接口和处理器的时钟信号，其中处理器被配置为基于链路信息来调整时钟信号的频率。

    一种通用扩展RISC-V处理器性能的方法
    8.
    发明授权
    一种通用扩展RISC-V处理器性能的方法 有权

    公开(公告)号：CN117312210B

    公开(公告)日：2024-03-12

    申请号：CN202311607380.0

    申请日：2023-11-29

    申请人： 沐曦集成电路(南京)有限公司

    发明人： 许鑫 ,  王爽 ,  朱迎春 ,  黄青云

    IPC分类号： G06F13/38 ,  G06F13/40 ,  G06F13/16 ,  G06F13/18 ,  G06F1/3237 ,  G06F1/3234

    摘要： 本发明提供一种通用扩展RISC‑V处理器性能的方法，属于集成电路领域，包括：RISC‑V处理器发起读写操作，数据总线判断读写操作对应的地址范围是否属于存储器，若是则发起对该存储器的握手；协议转换模块与数据总线信号完成写或读地址握手，并进行协议转换，将写数据或读出的数据放到数据总线上，完成每笔传输的读写操作握手；完成读写操作并根据实际传输情况作出响应；完成所有传输，如无新的传输请求则通过时钟门控模块关闭协议转换模块和存储器的时钟，等待RISC‑V处理器发起新的传输请求后再打开时钟。本发明通过统一处理器总线协议，简化硬件设计，缩短访问路径，无需额外的跨时钟域处理，提升RISC‑V处理器对存储器的访问效率。

    配置和状态寄存器的独立计时
    9.
    发明公开
    配置和状态寄存器的独立计时 审中-实审

    公开(公告)号：CN117561489A

    公开(公告)日：2024-02-13

    申请号：CN202180099462.1

    申请日：2021-06-22

    申请人： 谷歌有限责任公司

    发明人： 纳加拉吉·阿肖克·普蒂

    IPC分类号： G06F1/3237

    摘要： 本文档描述了使能用于配置和状态寄存器(CSR)的独立计时的系统和技术。所描述的系统和技术能够向IP块的CSR集合提供时钟信号，该时钟信号具有比使能IP块的操作的另一时钟信号的时钟速率更慢的整数除法，该IP块的操作可以包括IP块与应用处理器之间的通信。导出时钟速率与时钟信号的时钟速率同步但独立。以这种方式，应用处理器和其他实体能够独立于IP块的计时访问CSR集合。例如，应用处理器能够从CSR集合读取或向CSR集合写入，而不将IP块从自动时钟门控模式唤醒。通过这样做，独立计时的所描述的方面能够减少与CSR集合相关联的功率耗散。