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公开(公告)号：CN209731214U
公开(公告)日：2019-12-03
申请号：CN201920247630.7
申请日：2019-02-27
申请人： 西南科技大学
摘要： 本实用新型涉及一种EG-LDPC译码器及方法，该EG-LDPC译码器包括：控制器、移位运算器、数据存储器组、H矩阵存储器、接收存储器、数据运算器以及结果运算器。移位运算器接入原始数据，形成数据循环矩阵输入到数据存储器；H矩阵存储器中存储H矩阵分向量中1的位置，其输出连接到数据存储器组的地址位；数据存储器组的输出端连接数据运算器的输入端，对接收的数据向量进行异或，数据运算器的输出端接入结果运算器；结果运算器对接收的所有H矩阵分向量的异或结果进行加运算并修正错误bit，其输出端接入到接收存储器。本实用新型的优点在于：减少了存储占用资源；提高了译码器的译码效率。(ESM)同样的发明创造已同日申请发明专利
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公开(公告)号：CN209486658U
公开(公告)日：2019-10-11
申请号：CN201821798640.1
申请日：2018-10-31
申请人： 建荣半导体(深圳)有限公司 , 建荣集成电路科技(珠海)有限公司
发明人： 刘艺迪
摘要： 本实用新型实施例提供了QC-LDPC解码器及存储设备。该QC-LDPC解码器包括：用于根据变量节点的变量信息，计算所述校验节点的校验信息的若干个校验节点处理电路；用于根据所述校验节点返回的校验信息，更新所述变量节点的变量信息的若干个变量节点处理电路；用于以预设的压缩因子，将循环移位矩阵分割为若干个子矩阵并且根据所述子矩阵，令所述循环移位矩阵中两行或以上的校验节点共用一个所述校验节点处理电路的矩阵分割电路；用于根据变量信息判断解码是否成功的校验电路。其将循环移位矩阵缩减为多个子矩阵，对于校验节点处理电路和变量节点处理电路的数量要求大大下降，从而可以在保持解码性能的同时，有效的降低QC-LDPC解码器的成本。(ESM)同样的发明创造已同日申请发明专利
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公开(公告)号：CN219577050U
公开(公告)日：2023-08-22
申请号：CN202320899685.2
申请日：2023-04-20
申请人： 四川创智联恒科技有限公司
发明人： 刘齐
摘要： 本实用新型公开了一种基于全相关半概率计算的LDPC校验节点计算装置，该装置包括输入计算电路和选择输出电路，所述输入计算电路包括多个与门电路、或门电路和计算器，所述与门电路、或门电路和计算器依次连接，输出最小值min的min_bits数据以及近似次小值min2的min2_bits数据，作为选择输出电路的输入，所述选择输出电路包括比较器和选择器，所述比较器接入输入信号dc以及min_bits数据，并输入控制信号至选择器，所述选择器选择输出min_bits数据或min2_bits数据。本实用新型采用近似方式求取绝对值中的次小值，符号位计算方式与常规结构一致，在校验节点dc较大时，资源更优。
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公开(公告)号：CN215990751U
公开(公告)日：2022-03-08
申请号：CN202121519041.3
申请日：2021-07-03
申请人： 南京天际易达通信技术有限公司
发明人： 李志强
IPC分类号： H03M13/11
摘要： 本实用新型涉及编码技术领域，且公开了一种基于LDPC编码器和译码器的安装架构，包括主处理器、信号输入模块、数据处理单元、编码矩阵、获取模块、译码模块、控制模块、译码校验单元、存储模块和生成模块，所述信号输入模块的输出端与主处理器的输入端之间信号连接，所述主处理器的输出端与数据处理单元的输入端之间信号连接，所述数据处理单元的输出端分别与编码矩阵的输入端和获取模块的输入端之间信号连接；本实用新型可以避免了输入性错误对本地程序的影响，且提高了可靠性和实用性，解决了编码器在程序运行的过程中，如果前端输入数据的格式错误，将会使本地程序运行节奏被打乱，不加处理会造成持续性编码错误的问题。
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公开(公告)号：CN212627865U
公开(公告)日：2021-02-26
申请号：CN202021182044.8
申请日：2020-06-23
申请人： 广州博锐电子有限公司
IPC分类号： H03M13/11
摘要： 一种LED解码器调光与输出保护装置，涉及LED解码器的技术领域，其包括调光电路、电流取样电路、分别与所述调光电路和所述电流取样电路连接的单片机以及LED灯带；所述调光电路包括三极管、第一电阻、第二电阻以及MOS管；所述电流取样电路包括第三电阻、第四电阻、自恢复保险以及TVS管；该LED解码器调光与输出保护装置通过采用电流取样电路，以限制LED灯带的总功率，当LED灯带的总功率大于额定功率时，会断开输出，从而保护LED解码器，而LED解码器重启后会重新检测输出电流，防止LED解码器损坏，从而防止电路板或接线座子燃。
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公开(公告)号：CN204906368U
公开(公告)日：2015-12-23
申请号：CN201520504405.9
申请日：2015-07-13
申请人： 普天信息技术有限公司
发明人： 张锋
IPC分类号： H03M13/11
摘要： 本实用新型公开一种QC-LPDC编码装置，属于数字信息传输技术领域，所述QC-LPDC编码装置包括：输入缓存模块、编码模块和输出缓存模块；所述输出缓存模块，包括：第一先入先出FIFO队列以及第二FIFO队列；所述输入缓存模块连接所述编码模块的输入端以及所述输出缓存模块中的第一先入先出FIFO队列；所述编码模块的输出端连接所述输出缓存模块中的第二FIFO队列。本实用新型公开的QC-LPDC编码装置通过在输出缓存模块增加两个FIFO队列，在不增加编码器工作时钟频率的同时，能够提升QC-LDPC编码的吞吐率，降低系统运行的功耗，时延较低。
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公开(公告)号：CN204761417U
公开(公告)日：2015-11-11
申请号：CN201520574867.8
申请日：2015-07-29
申请人： 中工科安科技有限公司 , 文长明
IPC分类号： H03M13/11
摘要： 本实用新型公开了一种伺服电机内置编码器信号处理电路及其信号处理模块。所述电路用于对同一编码器的输入信号Asinα、Bcosα、R进行了位置信息、校验信息的冗余控制并由此生成数字信号；所述数字信号以报文的形式传递给伺服电机驱动器。所述电路包括方波信号转换器、分别表征两个通道的两个信号处理器、仲裁器。Asinα、Bcosα、R通过方波信号转换器转换成方波信号后，分别通过两个信号处理器形成两个待传输信号。两个待传输信号相同时，仲裁器将两个通道中的位置信息叠加到标准报文字段中输出，形成的数据流通过现场总线或实时以太网传递给伺服电机驱动器。本实用新型还公开了将所述电路设计为通用模块的伺服电机内置编码器信号处理模块，可直接在厂区安装，方便生产、运输、使用。
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公开(公告)号：CN203039671U
公开(公告)日：2013-07-03
申请号：CN201220328332.9
申请日：2012-07-06
申请人： 华南理工大学
IPC分类号： H03M13/11
摘要： 本实用新型公开了一种基于线性规划的LDPC译码器，包括输入单元、线性规划器、校验判断器、输出单元以及控制器，输入单元用于对输入数据进行缓冲与同步；线性规划器主要完成线性规划数学模型的建立及求解；校验判断器用于校验约束条件是否满足的判断，并根据判断结果决定数据流的走向；输出单元用于对输出数据进行缓冲与同步；控制器是译码器的信息交互的枢纽，用于控制输入单元、线性规划器、校验判断器、输出单元的工作；本实用新型在传统LDPC线性规划译码方法的基础上，通过引入自适应和改进线性规划的数学方法，提高解码器的译码效率。
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公开(公告)号：CN201750409U
公开(公告)日：2011-02-16
申请号：CN201020170283.1
申请日：2010-04-26
申请人： 杨磊
发明人： 杨磊
IPC分类号： H03M13/11
摘要： 本实用新型涉及一种兼容多码率的LDPC解码装置，该装置包括：可变节点计算模块，包含若干可变节点计算单元；校验节点计算模块，包含若干校验节点计算单元，所述校验节点计算模块具有多层校验输出，每层输出由上层输出连接构成；存储器阵列，包含若干存储器，通过连线网络分别与所述若干可变节点计算单元以及所述若干校验节点计算单元可配置相连。本实用新型的LDPC解码装置能够方便地实现多码率的LDPC解码。
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公开(公告)号：CN201533304U
公开(公告)日：2010-07-21
申请号：CN200920104739.1
申请日：2009-09-07
申请人： 中国电子科技集团公司第五十四研究所
发明人： 石玉景
IPC分类号： H03M13/11
摘要： 本实用新型公开了一种高速部分并行LDPC信道编码器，它涉及通信领域中编码速率高、纠错能力强、占用资源少的高速编码器装置。它由串并变换电路、FIFO缓存器、部分并行编码电路、复接电路、调制变换电路、电源和本振等部分组成。采用部分并行的方式进行编码，与传统的串行编码器相比，具有编码速率高的特点，与传统的并行编码器相比，具有占用资源少，时序稳定的优点，实现了在编码速率和占用资源上很好的控制。本实用新型还具有异步缓存和根据调制方式调整比特输出并行数目的特点，可以很好的实现连续不断编码和简化调制控制，在硬件实现复杂度要求低，通信速率要求越来越高的无线通信和深空通信等通信领域将得到广泛的应用。
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