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    Rail to rail rectifying integrator
    1.
    发明公开
    Rail to rail rectifying integrator 有权
    积分器具有整流功能，并且具有相应的输出电压范围的电源电压

    公开(公告)号：EP1176721A1

    公开(公告)日：2002-01-30

    申请号：EP00830521.1

    申请日：2000-07-24

    申请人： STMicroelectronics S.r.l.

    发明人： Pernigotti, Elena ,  Poma, Alberto ,  Protti, Carlo

    IPC分类号： H03K5/1532 ,  G01R19/04

    CPC分类号： G01R19/04

    摘要： A rectifying integrator of an input signal (VIN) with full output dynamic, relative to a voltage reference (VREF) intermediate in respect to the dynamic of the input signal (VIN), the line of integration of which is composed of an integrator of that portion of the input signal that exceeds the voltage reference (VREF) and of a hold capacitor (C 3a ) coupled in cascade to the integrator, includes a second line of integration, identical to the first line of integration, that integrates that portion of the input signal (VIN) that remains below the voltage reference (VREF), and an adder output stage that generates an output signal (VOUT) equal to the difference between the voltages existing on the hold capacitors (C 3a , C 3b ) of the lines of integration first and second.

    摘要翻译： 与所述输入信号（VIN），它是由做的积分的所有一体化的线的动态满输出动态，相对于基准电压（VREF）中间体在相对于输入信号（VIN）的整流积分 在输入信号的各部分没有超过参考电压（VREF）和级联耦合到积分器的保持电容器（C 3a）中的，包括集成的第二线，相同的整合的第一行，没有集成做了输入的部 该保持低于参考电压（VREF），且在加法器输出级信号（VIN）确实产生等于存在于集成的线的保持电容（C3a的，的C3b）第一电压之间的差输出信号的速率（VOUT） 和第二。