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5 条记录 (耗时 0.012 秒)

    Heuristic processor
    1.
    再颁专利
    Heuristic processor 失效
    启发式处理器

    公开(公告)号：USRE37488E1

    公开(公告)日：2001-12-25

    申请号：US08769119

    申请日：1996-12-18

    申请人： David Sydney Broomhead ,  Robin Jones ,  Terence John Shepherd ,  John Graham McWhirter

    发明人： David Sydney Broomhead ,  Robin Jones ,  Terence John Shepherd ,  John Graham McWhirter

    IPC分类号： G06F1518

    CPC分类号： G06N3/10

    摘要： A heuristic processor incorporates a digital arithmetic unit arranged to compute the squared norm of each member of a training data set with respect to each member of a set of centers, and to transform the squared norms in accordance with a nonlinear function to produce training &phgr; vectors. A systolic array arranged for QR decomposition and least mean squares processing forms combinations of the elements of each &phgr; vector to provide a fit to corresponding training answers. The form of combination is then employed with like-transformed to provide estimates of unknown result. The processor is applicable to provide estimated results for problems which are nonlinear and for which explicit mathematical formalisms are unknown.

    摘要翻译： 启发式处理器包括数字算术单元，其被配置为针对一组中心的每个成员计算训练数据集的每个成员的平方范数，并且根据非线性函数来转换平方范数以产生训练phi向量 。 设置用于QR分解和最小均方处理的收缩阵列形成每个phi矢量的元素的组合，以提供对相应训练答案的拟合。 然后使用类似变换的组合形式来提供未知结果的估计。 处理器适用于为非线性问题提供估计结果，而且明确的数学形式主义是未知的。

    Processor
    2.
    发明申请
    Processor 有权
    处理器

    公开(公告)号：US20130019084A1

    公开(公告)日：2013-01-17

    申请号：US13498458

    申请日：2010-09-28

    申请人： David Arthur Orchard ,  Rebecca Anne Wilson ,  Jonathan Alexander Skoyles Pritchard ,  Martin James Cooper ,  Terence John Shepherd ,  Andrew Charles Lewin ,  Paul Richard Tapster ,  Charlotte Rachel Helen Bennett

    发明人： David Arthur Orchard ,  Rebecca Anne Wilson ,  Jonathan Alexander Skoyles Pritchard ,  Martin James Cooper ,  Terence John Shepherd ,  Andrew Charles Lewin ,  Paul Richard Tapster ,  Charlotte Rachel Helen Bennett

    IPC分类号： G06F9/302 ,  G06F9/305

    CPC分类号： G06K9/74 ,  G06F7/02 ,  G06F2207/025

    摘要： Apparatus (100) is provided which is arranged to accept an input data stream. In some embodiments, the apparatus (100) comprises a sampler arranged to sample the input data stream to provide k samples thereof, wherein each of the samples is n bits long and a string selector arranged to select m binary strings n bits long from at least a chosen subset of all random binary strings of a predetermined length. The apparatus (100) may further comprise a logical operator arranged to perform a logical function for each of the k samples with each of the selected binary strings to provide a vector, a memory arranged to store a matrix of the vectors generated from k samples, and an address generator arranged to generate RAM address segments from the matrix. In embodiments, the apparatus (100) may comprise a processor for, for example, pattern matching; feature detection, image recognition.

    摘要翻译： 提供了被设置为接受输入数据流的装置（100）。 在一些实施例中，装置（100）包括采样器，其被配置为对输入数据流进行采样以提供其k个采样，其中每个采样为n位长，并且串选择器布置成从至少选择n位长的m个二进制串 具有预定长度的所有随机二进制串的选定子集。 所述设备（100）还可以包括逻辑运算符，所述逻辑运算符被布置为对所选择的二进制串中的每一个为k个样本中的每一个执行逻辑函数以提供向量;布置成存储从k个样本生成的向量的矩阵的存储器， 以及布置成从矩阵生成RAM地址段的地址发生器。 在实施例中，设备（100）可以包括用于例如模式匹配的处理器; 特征检测，图像识别。