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    Cache system and cache memory control device controlling cache memory having two access modes
    1.
    发明申请
    Cache system and cache memory control device controlling cache memory having two access modes 审中-公开
    缓存系统和高速缓冲存储器控制装置控制具有两种访问模式的高速缓冲存储器

    公开(公告)号：US20040098540A1

    公开(公告)日：2004-05-20

    申请号：US10610763

    申请日：2003-07-02

    申请人： RENESAS TECHNOLOGY CORP.

    发明人： Teruyuki Itoh ,  Naoto Okumura

    IPC分类号： G06F013/00 ,  G06F012/00

    CPC分类号： G06F12/0855 ,  G06F12/0864 ,  G06F12/0877 ,  G06F2212/1016 ,  G06F2212/1028 ,  Y02D10/13

    摘要： A branch/prefetch judgement portion, in receipt of a branch request signal, sets a cache access mode switch signal to an nullHnull level. Thus, a cache memory operates in the 1-cycle access mode consuming a large amount of power. In receipt of a prefetch request signal, the branch/prefetch judgement portion sets the cache access mode switch signal to an nullLnull level. Thus, the cache memory operates in the 2-cycle access mode consuming less power.

    摘要翻译： 分支/预取判断部分在接收到分支请求信号时将高速缓存访​​问模式切换信号设置为“H”电平。 因此，高速缓存存储器以1周期访问模式工作，消耗大量的功率。 在接收到预取请求信号时，分支/预取判断部分将高速缓存访​​问模式切换信号设置为“L”电平。 因此，高速缓冲存储器以2周期访问模式工作，消耗较少的功率。