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公开(公告)号：CN118278486A
公开(公告)日：2024-07-02
申请号：CN202311816463.0
申请日：2023-12-27
Applicant: 意法半导体股份有限公司 , 意法半导体国际公司
IPC: G06N3/082 , G06N3/0464
Abstract: 一种系统包括主机处理器、存储器、硬件加速器和配置控制器。主机处理器在操作中控制多级处理任务的执行。存储器在操作中存储数据和配置信息。硬件加速器在操作中执行与多级处理任务的级相关联的操作。配置控制器耦合到主机处理器、硬件加速器和存储器。配置控制器例如在有限状态机的控制下执行配置操作的链表。链表由配置操作的定义集合中选择的配置操作组成。执行的配置操作的链表将硬件加速器的多个配置寄存器配置为控制与多级处理任务的级相关联的硬件加速器的操作。配置控制器可以经由高速数据总线从存储器中检索链表。
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