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    解码装置、数据再现装置和解码方法
    13.
    发明公开
    解码装置、数据再现装置和解码方法 失效

    公开(公告)号：CN1264123A

    公开(公告)日：2000-08-23

    申请号：CN00104173.8

    申请日：2000-01-19

    申请人： 索尼公司

    发明人： 三町宣雅 ,  桥本稔 ,  木村宏正

    IPC分类号： G11B20/18 ,  H03M7/00

    CPC分类号： H03M5/145 ,  G11B20/1426 ,  G11B2020/1461

    摘要： 能对作为EFM信号本来不能存在的1T和2T进行校正,减少纠错电路的处理,并改善可播放性的解码装置和数据再现装置。提供包括校正部分和解调电路的EFM块,校正部分检测由PLL不对称校正电路转换成二进制格式的RF信号的边缘以便NRZ转换,使用数字PLL电路中产生的时钟以便同步,检测在同步时产生的1T和2T,根据预定条件把所检测的1T和2T信号校正成0或3T,从RF信号去除1T和2T,和调制已由EFM从其去除1T和2T的RF信号;解调电路用于通过EFM对EFM调制后的信号解调。

    锁相环电路、再现装置和相位锁定方法
    14.
    发明公开
    锁相环电路、再现装置和相位锁定方法 无效

    公开(公告)号：CN1217610A

    公开(公告)日：1999-05-26

    申请号：CN98122610.8

    申请日：1998-11-19

    申请人： 索尼株式会社

    发明人： 中沢徹二

    IPC分类号： H03L7/00 ,  G11B19/28

    CPC分类号： G11B19/247 ,  E05Y2400/30 ,  G11B7/005 ,  G11B20/1426 ,  G11B2020/1461 ,  H03L7/10 ,  H03L7/113

    摘要： 本发明提供锁相环电路、再现装置和相位锁定方法,通过它们可以加宽捕获范围和锁定范围。在锁定锁相环电路之前,参考石英振荡器的参考时钟,对压控振荡器输出时钟进行计数,而且提取在从磁盘和参考时钟再现行程长度有限码之间的误差分量。然后,根据输出时钟的计算值与提取的误差分量的相加结果,构成PLL电路。在锁定锁相环电路之后,检测压控振荡器的输出时钟对从磁盘再现的行程长度有限码的相位误差,而且根据检测的相位误差构成PLL电路。

    相位同步电路
    17.
    发明公开
    相位同步电路 有权

    公开(公告)号：CN101547006A

    公开(公告)日：2009-09-30

    申请号：CN200910128068.7

    申请日：2009-03-23

    申请人： 三洋电机株式会社 ,  三洋半导体株式会社

    发明人： 关根聪枝 ,  荻野直幸

    IPC分类号： H03L7/087 ,  H03L7/099 ,  G11B20/14

    CPC分类号： H03L7/087 ,  G11B20/10009 ,  G11B20/10222 ,  G11B20/10425 ,  G11B20/1403 ,  G11B2020/1461 ,  G11B2220/2537 ,  H03L7/0898 ,  H03L7/113

    摘要： 本发明提供一种相位同步电路，包括：充放电电路，能设定电容器的至少充电电流或放电电流的电流值，根据驱动信号对电容器充放电；振荡电路，输出与电容器的充电电压对应频率的振荡信号；驱动电路，在输入信号与振荡信号的相位差小于规定相位差时，使电容器的充电期间与放电期间一致，在相位差大于规定相位差时，作为驱动信号输出使相位差减少的第一驱动信号；设定电路，被输入并保持设定数据，基于设定数据设定充放电电路的至少充电电流或放电电流的电流值，在输入调节指示信号时，驱动电路作为驱动信号输出使电容器的充电期间与放电期间一致的第二驱动信号，在设定电路中保持根据第二驱动信号充放电的电容器的充电电压达到一定电平的设定数据。