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公开(公告)号：CN107507648B
公开(公告)日：2023-06-09
申请号：CN201710216669.8
申请日：2017-04-05
Applicant: 三星电子株式会社
IPC: G11C29/42
Abstract: 一种操作解码器以及操作包括该解码器的数据存储装置的方法。一种操作具有变量节点和校验节点的解码器的方法，包括从使用所述校验节点中的第一校验节点的所述变量节点接收变量到校验(V2C)消息。对所述V2C消息中具有特定幅值的消息的数量进行计数。基于所述计数值和所述变量节点中的第一变量节点的V2C消息的幅值来确定将被发送到第一变量节点的校验到变量(C2V)消息的幅值。
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Patent Agency Ranking
公开(公告)号：CN109714062A
公开(公告)日：2019-05-03
申请号：CN201811247776.8
申请日：2018-10-24
Applicant: 三星电子株式会社
IPC: H03M13/37
CPC classification number: H03M13/37 , G06F11/085 , G06F11/1012 , G06F13/1673 , H03M13/03
Abstract: 提供了包括主存储器、标志存储器和解码逻辑器件的解码器。标志存储器被配置为存储标志数据，并且解码逻辑器件被配置为执行迭代。此外，解码逻辑器件被配置为：使用第一数据执行第i次操作，其中，i是自然数，对第二数据进行标志编码，第二数据是通过对第一数据执行第i次操作所获得的结果，如果标志编码成功，则将通过对第二数据执行标志编码所获得的结果作为第一标志数据存储在标志存储器中，并且如果标志编码失败，则将与第二数据的第一标志数据不同的预定第二标志数据存储在标志存储器中。
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公开(公告)号：CN109714062B
公开(公告)日：2024-05-14
申请号：CN201811247776.8
申请日：2018-10-24
Applicant: 三星电子株式会社
IPC: H03M13/37
Abstract: 提供了包括主存储器、标志存储器和解码逻辑器件的解码器。标志存储器被配置为存储标志数据，并且解码逻辑器件被配置为执行迭代。此外，解码逻辑器件被配置为：使用第一数据执行第i次操作，其中，i是自然数，对第二数据进行标志编码，第二数据是通过对第一数据执行第i次操作所获得的结果，如果标志编码成功，则将通过对第二数据执行标志编码所获得的结果作为第一标志数据存储在标志存储器中，并且如果标志编码失败，则将与第二数据的第一标志数据不同的预定第二标志数据存储在标志存储器中。
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公开(公告)号：CN107507648A
公开(公告)日：2017-12-22
申请号：CN201710216669.8
申请日：2017-04-05
Applicant: 三星电子株式会社
IPC: G11C29/42
CPC classification number: H03M13/3927 , H03M13/1117 , G11C29/42
Abstract: 一种操作解码器以及操作包括该解码器的数据存储装置的方法。一种操作具有变量节点和校验节点的解码器的方法，包括从使用所述校验节点中的第一校验节点的所述变量节点接收变量到校验(V2C)消息。对所述V2C消息中具有特定幅值的消息的数量进行计数。基于所述计数值和所述变量节点中的第一变量节点的V2C消息的幅值来确定将被发送到第一变量节点的校验到变量(C2V)消息的幅值。
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公开(公告)号：CN107634764B
公开(公告)日：2022-05-13
申请号：CN201710590347.X
申请日：2017-07-19
Applicant: 三星电子株式会社
IPC: H03M13/11
Abstract: 本申请提供一种解码器和包括该解码器的存储控制器。该解码器包括：通道映射器，其配置为基于硬判决信息和软判决信息生成多个通道接收值；强错误检测器，其配置为使用多个校验节点消息和通道接收值确定强错误是否发生，并且根据确定结果校正通道接收值以产生经校正的通道接收值；变量节点单元，其配置为使用校验节点消息和经校正的通道接收值产生多个变量节点消息；以及校验节点单元，其配置为使用变量节点消息产生校验节点消息。变量节点单元包括多个变量节点，并且校验节点单元包括多个校验节点。
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公开(公告)号：CN107634764A
公开(公告)日：2018-01-26
申请号：CN201710590347.X
申请日：2017-07-19
Applicant: 三星电子株式会社
IPC: H03M13/11
CPC classification number: G06F11/1068 , G06F11/1012 , G11C29/52 , H03M13/1111 , H03M13/3723 , H03M13/6325
Abstract: 本申请提供一种解码器和包括该解码器的存储控制器。该解码器包括：通道映射器，其配置为基于硬判决信息和软判决信息生成多个通道接收值；强错误检测器，其配置为使用多个校验节点消息和通道接收值确定强错误是否发生，并且根据确定结果校正通道接收值以产生经校正的通道接收值；变量节点单元，其配置为使用校验节点消息和经校正的通道接收值产生多个变量节点消息；以及校验节点单元，其配置为使用变量节点消息产生校验节点消息。变量节点单元包括多个变量节点，并且校验节点单元包括多个校验节点。
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