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公开(公告)号:CN101546998B
公开(公告)日:2011-04-27
申请号:CN200910030786.0
申请日:2009-04-15
申请人: 东南大学
IPC分类号: H03K17/687
摘要: 一种高精度栅源跟随采样开关电路涉及利用栅源跟随技术的采样开关,特别是用于采样保持电路的一种高精度栅源跟随采样开关设计方法及其开关电路:通过增加驱动电路,避免了SHA的运放直接驱动栅压导通开关电路中的电容,从而通过提高存储电压电容容值,就可以提高采样开关的栅端和源端的电压,减小MOS开关的导通电阻,可有效降低采样开关管栅极的寄生电容,从而提高采样开关管的栅源提升电压。
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公开(公告)号:CN101546998A
公开(公告)日:2009-09-30
申请号:CN200910030786.0
申请日:2009-04-15
申请人: 东南大学
IPC分类号: H03K17/687
摘要: 一种高精度栅源跟随采样开关电路涉及利用栅源跟随技术的采样开关,特别是用于采样保持电路的一种高精度栅源跟随采样开关设计方法及其开关电路:通过增加驱动电路,避免了SHA的运放直接驱动栅压导通开关电路中的电容,从而通过提高存储电压电容容值,就可以提高采样开关的栅端和源端的电压,减小MOS开关的导通电阻,可有效降低采样开关管栅极的寄生电容,从而提高采样开关管的栅源提升电压。
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公开(公告)号:CN101794159B
公开(公告)日:2012-05-23
申请号:CN201010120181.3
申请日:2010-03-08
申请人: 东南大学
IPC分类号: G05F3/20
摘要: 一种高电源电压抑制比的带隙基准电压源包括启动电路(1),正负温度系数电流产生电路(2),运放(3)及基准电压产生电路(4);启动电路(1),正负温度系数电流产生电路(2),运放(3)及基准电压产生电路(4)的直流电输入端分别连接直流电源Vcc,启动电路(1)的输出端接正负温度系数电流产生电路(2)的第一输入端,正负温度系数电流产生电路(2)的第一输出端与运放(3)的第一输入端相连,正负温度系数电流产生电路(2)的第二输出端与运放(3)的第二输入端相连,正负温度系数电流产生电路(2)的第三输出端与基准电压产生电路(4)的第一输入端相连接,运放(3)的第一输出端接正负温度系数电流产生电路(2)的第二输入端。
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公开(公告)号:CN101794159A
公开(公告)日:2010-08-04
申请号:CN201010120181.3
申请日:2010-03-08
申请人: 东南大学
IPC分类号: G05F3/20
摘要: 一种高电源电压抑制比的带隙基准电压源包括启动电路(1),正负温度系数电流产生电路(2),运放(3)及基准电压产生电路(4);启动电路(1),正负温度系数电流产生电路(2),运放(3)及基准电压产生电路(4)的直流电输入端分别连接直流电源Vcc,启动电路(1)的输出端接正负温度系数电流产生电路(2)的第一输入端,正负温度系数电流产生电路(2)的第一输出端与运放(3)的第一输入端相连,正负温度系数电流产生电路(2)的第二输出端与运放(3)的第二输入端相连,正负温度系数电流产生电路(2)的第三输出端与基准电压产生电路(4)的第一输入端相连接,运放(3)的第一输出端接正负温度系数电流产生电路(2)的第二输入端。
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公开(公告)号:CN101399540B
公开(公告)日:2010-06-23
申请号:CN200810155835.9
申请日:2008-10-10
申请人: 东南大学
IPC分类号: H03K23/66
摘要: 一种50%占空比的高速宽范围多模可编程分频器,包括由相互级联的基本分频单元和用于拓展分频比范围的一系列或门所组成的主分频级,还包括由一DFF触发器单元构成的2分频级,主分频级中第一级基本分频单元为2/3/4分频单元,其余为2/3分频单元,主分频级中第二级基本分频单元的模式控制信号输出端输入DFF触发器单元的触发信号端,DFF触发器单元的Q端输出分频器的最后输出fout。本发明电路结构简单,功耗低,输出信号具有低抖动特性,效果好,控制输出信号占空比至50%,偶数分频时,输出占空比为50%;奇数分频时,最差情况下输出占空比为44.4%,随着分频比的增大,输出占空比越接近50%。
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公开(公告)号:CN101567692B
公开(公告)日:2011-03-23
申请号:CN200910030063.0
申请日:2009-03-30
申请人: 东南大学
IPC分类号: H03M1/06
摘要: 并行的高速动态元件匹配方法主要是降低了动态元件匹配算法的建立时间和硬件的复杂度,尤其适合需要高线性度的高速DAC的应用。并行转换模块(21)的输入是一个多位的串行或并行的二进制序列(Bin),经过并行转换模块(21)使得按每位的权重从高到低并行输出,即输出XnXn-1…X1,其中Xn为输入信号的最高位;并行转换模块(21)的二进制输出连到位译码单元(22),根据二进制输入信号的位权重,对每一位分别进行译码,二进制输入的其中一位Xi被译码为2i-1个Xi,1≤i≤n;伪随机序列产生模块(24)提供开关阵列(23)的控制信号,位译码单元(22)的输出编码连接到由伪随机序列控制的开关阵列模块(23),从而实现部分随机的选择输出编码,达到动态元件匹配。
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公开(公告)号:CN101567692A
公开(公告)日:2009-10-28
申请号:CN200910030063.0
申请日:2009-03-30
申请人: 东南大学
IPC分类号: H03M1/06
摘要: 并行的高速动态元件匹配方法主要是降低了动态元件匹配算法的建立时间和硬件的复杂度,尤其适合需要高线性度的高速DAC的应用。并行转换模块(21)的输入是一个多位的串行或并行的二进制序列(Bin),经过并行转换模块(21)使得按每位的权重从高到低并行输出,即输出XnXn-1…X1,其中Xn为输入信号的最高位;并行转换模块(21)的二进制输出连到位译码单元(22),根据二进制输入信号的位权重,对每一位分别进行译码,二进制输入的其中一位Xi被译码为2i-1个Xi,1≤i≤n;伪随机序列产生模块(24)提供开关阵列(23)的控制信号,位译码单元(22)的输出编码连接到由伪随机序列控制的开关阵列模块(23),从而实现部分随机的选择输出编码,达到动态元件匹配。
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公开(公告)号:CN101399540A
公开(公告)日:2009-04-01
申请号:CN200810155835.9
申请日:2008-10-10
申请人: 东南大学
IPC分类号: H03K23/66
摘要: 一种50%占空比的高速宽范围多模可编程分频器,包括由相互级联的基本分频单元和用于拓展分频比范围的一系列或门所组成的主分频级,还包括由一DFF触发器单元构成的2分频级,主分频级中第一级基本分频单元为2/3/4分频单元,其余为2/3分频单元,主分频级中第二级基本分频单元的模式控制信号输出端输入DFF触发器单元的触发信号端,DFF触发器单元的Q端输出分频器的最后输出fout。本发明电路结构简单,功耗低,输出信号具有低抖动特性,效果好,控制输出信号占空比至50%,偶数分频时,输出占空比为50%;奇数分频时,最差情况下输出占空比为44.4%,随着分频比的增大,输出占空比越接近50%。
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