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公开(公告)号：CN102788950B
公开(公告)日：2014-10-01
申请号：CN201210214949.2
申请日：2012-06-27
申请人： 北京大学深圳研究生院
IPC分类号： G06F17/50
摘要： 本申请公开了一种周期精确转换器及其集成电路验证方法和系统，本申请中周期精确转换器将非周期精确的功能参考模型产生的执行结果进行周期标注、填充和排序,得到周期精确的结果。将周期精确转换器的执行结果与周期精确的设计实现输出的执行结果进行对比，这样可以实现很好的错误定位以缩短对周期精确的设计实现的验证时间。
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公开(公告)号：CN102054109B
公开(公告)日：2014-03-19
申请号：CN201010622446.X
申请日：2010-12-31
申请人： 北京大学深圳研究生院
IPC分类号： G06F17/50
摘要： 本发明公开了一种集成电路下层硬件映射方法及装置，通过对描述集成电路算方法的计算机语言程序进行分析，并将其映射为描述集成电路算法的数据控制流图，再转换为相应的算子时空图，并对数据控制流图进行时序约束，从而根据时序标注对算子时空图进行聚类压缩，再生成集成电路下层硬件电路逻辑描述，从而创造了一种从计算机语言到集成电路下层硬件电路逻辑描述的映射工具，标准化地实现了集成电路从C或MATLAB等语言生成下层硬件的过程，实现起来方便快捷。本发明公开的数据控制流生成方法及装置通过对计算机语言程序分析得到其相应的数据相关性、数据可并行性和相应控制信息等，从而生成相应的数据控制流图，帮助硬件工程师进行硬件设计。
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公开(公告)号：CN102123286B
公开(公告)日：2013-05-01
申请号：CN201010619891.0
申请日：2010-12-31
申请人： 北京大学深圳研究生院
IPC分类号： H04N7/50
摘要： 本发明公开了一种视频编码器的网络提取层NAL模块，包括：用于控制数据输出的数据选择功能块、用于将数据选择功能块输出码流进行拼接的码流拼接功能块、用于将码流拼接功能块输出码流拆分的拆分功能块、用于判断是否需要插入字节并根据判断结果进行处理的插入功能块、以及用于将插入功能块输出结果拼接的码流组合功能块。本发明可提高硬件设计的效率。
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公开(公告)号：CN102185760A
公开(公告)日：2011-09-14
申请号：CN201110091144.9
申请日：2011-04-12
申请人： 北京大学深圳研究生院
摘要： 本发明公开了一种单芯片异步通信接口。本发明的单芯片异步通信接口包括时用于提供时钟信号的时钟模块；用于同外部网络进行异步握手通信，并产生控制信号控制数据的输入，以及经过处理后的数据的输出，同时控制时钟模块的启停的输入输出控制器；以及用于根据输入输出控制器的控制信号对输入的数据流进行分发，处理和同步，并将处理后的数据输出至外部网络的同步块。本发明的单芯片异步通信接口通过同步块在时钟的驱动下，根据输入输出控制器的控制信号完成对输入的外部网络数据的同步和处理，并将处理后的数据输出至外部网络，从而满足了异步通信网络之间的数据同步和传输，进而实现网络中不同IP核之间的互连。
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公开(公告)号：CN102054107A
公开(公告)日：2011-05-11
申请号：CN201010619832.3
申请日：2010-12-31
申请人： 北京大学深圳研究生院
IPC分类号： G06F17/50
摘要： 本发明公开了一种集成电路下层硬件映射方法及装置，通过对描述集成电路算方法的计算机语言程序进行分析，并将其映射为数据控制流图，再转换为算子时空图，并对该数据控制流图进行时序约束，从而根据时序标注对算子时空图进行聚类压缩，再生成集成电路下层硬件电路逻辑描述，从而创造了一种从计算机语言到集成电路下层硬件电路的映射工具，标准化地实现了集成电路从C或MATLAB等语言生成下层硬件的过程，实现起来方便快捷。本发明公开的算子时空图生成方法及装置通过根据数据控制流中数据流的数据相关性将其展开，并调用算子将数据控制流图转换为算子时空图，根据本方法得到的电路，不仅版图规整性加强，并且能够实现低功耗的优化设计。
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公开(公告)号：CN102788950A
公开(公告)日：2012-11-21
申请号：CN201210214949.2
申请日：2012-06-27
申请人： 北京大学深圳研究生院
IPC分类号： G01R31/28
摘要： 本申请公开了一种周期精确转换器及其集成电路验证方法和系统，本申请中周期精确转换器将非周期精确的功能参考模型产生的执行结果进行周期标注、填充和排序,得到周期精确的结果。将周期精确转换器的执行结果与周期精确的设计实现输出的执行结果进行对比，这样可以实现很好的错误定位以缩短对周期精确的设计实现的验证时间。
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公开(公告)号：CN102123286A
公开(公告)日：2011-07-13
申请号：CN201010619891.0
申请日：2010-12-31
申请人： 北京大学深圳研究生院
IPC分类号： H04N7/50
摘要： 本发明公开了一种视频编码器的网络提取层NAL模块，包括：用于控制数据输出的数据选择功能块、用于将数据选择功能块输出码流进行拼接的码流拼接功能块、用于将码流拼接功能块输出码流拆分的拆分功能块、用于判断是否需要插入字节并根据判断结果进行处理的插入功能块、以及用于将插入功能块输出结果拼接的码流组合功能块。本发明可提高硬件设计的效率。
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公开(公告)号：CN102156655B
公开(公告)日：2014-04-02
申请号：CN201110115605.1
申请日：2011-05-05
申请人： 北京大学深圳研究生院
IPC分类号： G06F9/45
摘要： 本发明公开了一种高级语言代码产生器及高级语言代码生成方法，通过将输入的EDA设计工具的语法支持情况描述信息和验证或测试策略分别转换为相应的语法配置表和控制约束表，再根据该语法配置表和控制约束表，调用相应的语法库构建语法树，再将该语法树转换为对应的可执行高级语言代码。由于构建的语法树满足语法配置表和控制约束表，保证了生成的高级语言代码的可执行性，并提高了代码的相关性，使得能够更自然地模拟实际算法代码，从而为保证各种EDA设计工具对各种代码描述的转换的正确性提供了优质的测试用例，且该测试用例可执行性良好，进而减轻了人工编写测试代码的压力。
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公开(公告)号：CN103675463A
公开(公告)日：2014-03-26
申请号：CN201210192886.5
申请日：2012-09-12
申请人： 北京大学深圳研究生院
IPC分类号： G01R27/26
摘要： 本发明涉及一种自适应量程及精度的液体介电常数检测测量系统。所述介电常数测量系统由(1)待测电容检测装置；(2)单片机和(3)LCD显示器组成。所述单片机通过控制待测电容检测装置内的开关电路，首先通过待测电容检测装置内的电容初检电路、整流稳压电路、低精度模数转换器及相应计算公式获得待测电容的估计值，利用该估计值控制锁相环输出合适精度的采样时钟；然后改变待测电容检测装置中开关电路的状态，通过RC充放电支路和比较器电路获得待测电容充电脉冲，用采样时钟进行采样获得充电时间并通过计算获得待测电容的精确值；最后根据测量电极的结构及测量获得的电容值计算得到对应液体的介电常数并在LCD显示器中显示。
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