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公开(公告)号：CN106372505B
公开(公告)日：2018-12-28
申请号：CN201610705866.1
申请日：2016-08-23
申请人： 北京航空航天大学
IPC分类号： G06F21/56
摘要： 一种针对嵌入式系统代码攻击的快速恢复方法，步骤如下：1，源程序生成目标代码；2，目标代码程序基本块；3，程序基本块作为预提取的特征参数；4，将特征参数写入存储单元；5，复位系统；6，记录当前程序基本块地址并清零；7，执行当前程序基本块；8，动态计算程序基本块特征参数，并；9，若比对一致，则备份并跳下一程序基本块执行步骤6；执行步骤10；10，若异常数小于恢复粒度调节阈值，则恢复常次加1，并跳当前程序基本块地址，执行步骤7；执行步骤5；通过以上步骤，本发明能对嵌入式系统代码攻击有效检测，对检测到的代码攻击实现快速恢复。
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公开(公告)号：CN106372505A
公开(公告)日：2017-02-01
申请号：CN201610705866.1
申请日：2016-08-23
申请人： 北京航空航天大学
IPC分类号： G06F21/56
CPC分类号： G06F21/563 , G06F21/568
摘要： 一种针对嵌入式系统代码攻击的快速恢复方法，步骤如下：1，源程序生成目标代码；2，目标代码程序基本块；3，程序基本块作为预提取的特征参数；4，将特征参数写入存储单元；5，复位系统；6，记录当前程序基本块地址并清零；7，执行当前程序基本块；8，动态计算程序基本块特征参数，并；9，若比对一致，则备份并跳下一程序基本块执行步骤6；执行步骤10；10，若异常数小于恢复粒度调节阈值，则恢复常次加1，并跳当前程序基本块地址，执行步骤7；执行步骤5；通过以上步骤，本发明能对嵌入式系统代码攻击有效检测，对检测到的代码攻击实现快速恢复。
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公开(公告)号：CN106203099B
公开(公告)日：2019-02-05
申请号：CN201610597187.7
申请日：2016-07-26
申请人： 北京航空航天大学
IPC分类号： G06F21/55
摘要： 一种硬件支持嵌入式系统程序指令标记的保护方法，具体步骤如下：1，读入指令基本块文件；2，确定安全指令长度；3，如果指令的长度小于安全指令长度，则步骤4，否则步骤5并记录拼接次数为0；4，用指令起止地址组合成干扰信息；5，计算拼接后的指令的散列值；6，对应的指令起止地址，拼接次数和静态散列值作为指令标记；7，处理器运行时在指令标记中搜索出拼接次数和静态散列值；8，将指令起止地址根据拼接次数进行拼接；9，用杂凑算法的硬件化电路计算拼接后的指令的散列值，并与静态散列值比较；10，相同则指令完整未被篡改，不同则有改变；通过以上步骤，完成了对指令标记的保护，解决了由于指令标记暴露所引发的安全问题。
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公开(公告)号：CN106198658A
公开(公告)日：2016-12-07
申请号：CN201610547557.6
申请日：2016-07-12
申请人： 北京航空航天大学
IPC分类号： G01N27/26
CPC分类号： G01N27/26
摘要： 本发明一种脑卒中预警的基因电路模型，它是由联合检测电路模块和反馈电路模块组成；该联合检测电路模块的输出是反馈电路模块的输入，反馈电路模块的输出又通过内部的反馈支路作用于联合检测电路模块的输出，亦即：反馈电路模块是联合检测电路模块的下一级电路；本发明所述的基因电路模型，其结构的通用性强，不仅能够通过简单有效的联合检测电路模块实现对脑卒中的快速监测，并且引入反馈电路模块降低环境等不确定因素带来的干扰，使系统对脑卒中的预警更准确可靠。
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公开(公告)号：CN106198658B
公开(公告)日：2019-02-05
申请号：CN201610547557.6
申请日：2016-07-12
申请人： 北京航空航天大学
IPC分类号： G01N27/26
摘要： 本发明一种脑卒中预警的基因电路模型，它是由联合检测电路模块和反馈电路模块组成；该联合检测电路模块的输出是反馈电路模块的输入，反馈电路模块的输出又通过内部的反馈支路作用于联合检测电路模块的输出，亦即：反馈电路模块是联合检测电路模块的下一级电路；本发明所述的基因电路模型，其结构的通用性强，不仅能够通过简单有效的联合检测电路模块实现对脑卒中的快速监测，并且引入反馈电路模块降低环境等不确定因素带来的干扰，使系统对脑卒中的预警更准确可靠。
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公开(公告)号：CN106295322A
公开(公告)日：2017-01-04
申请号：CN201610597170.1
申请日：2016-07-26
申请人： 北京航空航天大学
IPC分类号： G06F21/52
CPC分类号： G06F21/52
摘要： 本发明提供一种针对缓冲区溢出攻击的硬件保护模型，它直接和处理器相连，监控程序的执行过程，它由四部分组成：包括串行外设接口模块，即SPI模块，处理器接口模块，内存控制模块，安全标记模块；内存控制模块为核心模块，其他模块以所述内存控制模块为中心进行连接，SPI模块为内存控制模块提供数据下载接口，处理器接口模块为内存控制模块提供处理器的接口，安全标记模块为内存控制模块中所存储的数据进行加密处理；本发明安全性强于一般的软件保护，同时减小了硬件资源的开销，不占用系统的内存资源，执行效率高，具有良好的移植性，只要修改几个关键参数，就能适应不同架构的处理器上。
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公开(公告)号：CN106295322B
公开(公告)日：2018-12-18
申请号：CN201610597170.1
申请日：2016-07-26
申请人： 北京航空航天大学
IPC分类号： G06F21/52
摘要： 本发明提供一种针对缓冲区溢出攻击的硬件保护装置，它直接和处理器相连，监控程序的执行过程，它由四部分组成：包括串行外设接口模块，即SPI模块，处理器接口模块，内存控制模块，安全标记模块；内存控制模块为核心模块，其他模块以所述内存控制模块为中心进行连接，SPI模块为内存控制模块提供数据下载接口，处理器接口模块为内存控制模块提供处理器的接口，安全标记模块为内存控制模块中所存储的数据进行加密处理；本发明安全性强于一般的软件保护，同时减小了硬件资源的开销，不占用系统的内存资源，执行效率高，具有良好的移植性，只要修改几个关键参数，就能适应不同架构的处理器上。
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公开(公告)号：CN106291530B
公开(公告)日：2018-12-18
申请号：CN201610597185.8
申请日：2016-07-26
申请人： 北京航空航天大学
摘要： 本发明提供一种基于最近邻法的概率数据关联优化方法，具体步骤如下：一、参数设置：设传感器每个时刻接收到量测值的数量为N，门限值为γ，常数M；二、残差向量及其统计距离的计算；三、统计落入跟踪门内量测值数量，记为mk；四、事件定义；五、有效量测值的选择；六、新状态方程的计算；七、判断跟踪是否结束；通过以上步骤，实现了一种基于最近邻法的概率数据关联优化方法，可以减少错误关联发生的概率和数据关联的计算量，从而有效的提高数据关联的正确率和速度，解决了目标跟踪过程中数据关联资源消耗大和错误关联的实际问题。
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公开(公告)号：CN106291530A
公开(公告)日：2017-01-04
申请号：CN201610597185.8
申请日：2016-07-26
申请人： 北京航空航天大学
摘要： 本发明提供一种基于最近邻法的概率数据关联优化方法，具体步骤如下：一、参数设置：设传感器每个时刻接收到量测值的数量为N，门限值为γ，常数M；二、残差向量及其统计距离的计算；三、统计落入跟踪门内量测值数量，记为mk；四、事件定义；五、有效量测值的选择；六、新状态方程的计算；七、判断跟踪是否结束；通过以上步骤，实现了一种基于最近邻法的概率数据关联优化方法，可以减少错误关联发生的概率和数据关联的计算量，从而有效的提高数据关联的正确率和速度，解决了目标跟踪过程中数据关联资源消耗大和错误关联的实际问题。
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公开(公告)号：CN106203099A
公开(公告)日：2016-12-07
申请号：CN201610597187.7
申请日：2016-07-26
申请人： 北京航空航天大学
IPC分类号： G06F21/55
CPC分类号： G06F21/556
摘要： 一种硬件支持嵌入式系统程序指令标记的保护方法，具体步骤如下：1，读入指令基本块文件；2，确定安全指令长度；3，如果指令的长度小于安全指令长度，则步骤4，否则步骤5并记录拼接次数为0；4，用指令起止地址组合成干扰信息；5，计算拼接后的指令的散列值；6，对应的指令起止地址，拼接次数和静态散列值作为指令标记；7，处理器运行时在指令标记中搜索出拼接次数和静态散列值；8，将指令起止地址根据拼接次数进行拼接；9，用杂凑算法的硬件化电路计算拼接后的指令的散列值，并与静态散列值比较；10，相同则指令完整未被篡改，不同则有改变；通过以上步骤，完成了对指令标记的保护，解决了由于指令标记暴露所引发的安全问题。
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