一种低密度奇偶校验码矩阵的设计方法

    公开(公告)号:CN101262230A

    公开(公告)日:2008-09-10

    申请号:CN200810036556.0

    申请日:2008-04-24

    Applicant: 复旦大学

    Abstract: 本发明属于通信技术领域,具体为一种低密度奇偶校验矩阵的设计方法。本发明以存储器分配、避免存储器读写冲突和简化编码器为约束来设计基于层调度算法译码的H校验矩阵,并且对校验矩阵进行行列变换和寻找最大的平均环以提升性能。这种矩阵当采用上述基于层调度的Min-Sum算法来译码可以同时满足高性能和低复杂度的硬件实现的需求。采用本发明方法构造出来的矩阵可以实现低复杂度和高吞吐率的LDPC解码电路。

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