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公开(公告)号：CN103891281A
公开(公告)日：2014-06-25
申请号：CN201280050981.X
申请日：2012-09-14
申请人： 高通股份有限公司
发明人： 周博 , 古鲁纳特·拉马斯瓦米 , 卡西克·维拉 , 陈培松 , 穆罕默德·蔡德·科班 , 杜俊晨 , 苏海勒·亚利尔
IPC分类号： H04N19/13 , H04N19/194 , H04N19/426 , H04N19/96
摘要： 作为对视频数据的视频编码或解码操作的部分，视频译码器对所述视频数据的当前视频单元执行译码操作。作为对所述当前视频单元执行所述译码操作的部分，所述视频译码器确定相邻于所述当前视频单元的一个或一个以上视频单元的可用性。为了确定相邻于所述当前视频单元的视频单元的可用性，所述视频译码器基于相邻于所述当前视频单元的母代视频单元的视频单元的可用性而识别查找表中的条目。所述所识别条目指示相邻于所述当前视频单元的所述视频单元的可用性。所述视频译码器随后基于相邻于所述当前视频单元的所述视频单元是否可用而对所述当前视频单元执行译码操作。
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公开(公告)号：CN106415484B
公开(公告)日：2019-02-01
申请号：CN201580026297.1
申请日：2015-04-30
申请人： 高通股份有限公司
摘要： 本发明提供一种方法，其包含在处理器处执行专用算术编码指令。所述专用算术编码指令接受包含第一区间、第一偏移及第一状态的多个输入且基于所述多个输入产生一或多个输出。所述方法还包含基于所述专用算术编码指令的所述一或多个输出存储第二状态、重新对准所述第一区间以产生第二区间，及重新对准所述第一偏移以产生第二偏移。
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公开(公告)号：CN103891281B
公开(公告)日：2018-07-27
申请号：CN201280050981.X
申请日：2012-09-14
申请人： 高通股份有限公司
发明人： 周博 , 古鲁纳特·拉马斯瓦米 , 卡西克·维拉 , 陈培松 , 穆罕默德·蔡德·科班 , 杜俊晨 , 苏海勒·亚利尔
IPC分类号： H04N19/13 , H04N19/194 , H04N19/426 , H04N19/96
摘要： 作为对视频数据的视频编码或解码操作的部分，视频译码器对所述视频数据的当前视频单元执行译码操作。作为对所述当前视频单元执行所述译码操作的部分，所述视频译码器确定相邻于所述当前视频单元的一个或一个以上视频单元的可用性。为了确定相邻于所述当前视频单元的视频单元的可用性，所述视频译码器基于相邻于所述当前视频单元的母代视频单元的视频单元的可用性而识别查找表中的条目。所述所识别条目指示相邻于所述当前视频单元的所述视频单元的可用性。所述视频译码器随后基于相邻于所述当前视频单元的所述视频单元是否可用而对所述当前视频单元执行译码操作。
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公开(公告)号：CN106415484A
公开(公告)日：2017-02-15
申请号：CN201580026297.1
申请日：2015-04-30
申请人： 高通股份有限公司
CPC分类号： H03M7/4018 , G06F9/30018 , G06F9/30025 , G06F9/3895 , H04N19/13 , H04N19/42 , H04N19/91
摘要： 本发明提供一种方法，其包含在处理器处执行专用算术编码指令。所述专用算术编码指令接受包含第一区间、第一偏移及第一状态的多个输入且基于所述多个输入产生一或多个输出。所述方法还包含基于所述专用算术编码指令的所述一或多个输出存储第二状态、重新对准所述第一区间以产生第二区间，及重新对准所述第一偏移以产生第二偏移。
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公开(公告)号：CN103518222A
公开(公告)日：2014-01-15
申请号：CN201280022622.3
申请日：2012-03-28
申请人： 高通股份有限公司
IPC分类号： G06T5/00
CPC分类号： G06T5/005 , G06T2207/10021
摘要： 实施方案包含用于将参考图像或视频转换为3D图像或视频的方法和系统。描述两步转换，其以逐像素为基础实现扭曲和孔填充。在一个实施方案中，将多个第一共线像素位置处的参考图像的多个像素值连续映射到目的地图像的相应多个第二像素位置。在所述映射中的两者之间，可识别和填充所述第二像素位置中的两者之间的孔的位置。
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公开(公告)号：CN103518222B
公开(公告)日：2017-05-10
申请号：CN201280022622.3
申请日：2012-03-28
申请人： 高通股份有限公司
IPC分类号： G06T5/00
CPC分类号： G06T5/005 , G06T2207/10021
摘要： 实施方案包含用于将参考图像或视频转换为3D图像或视频的方法和系统。描述两步转换，其以逐像素为基础实现扭曲和孔填充。在一个实施方案中，将多个第一共线像素位置处的参考图像的多个像素值连续映射到目的地图像的相应多个第二像素位置。在所述映射中的两者之间，可识别和填充所述第二像素位置中的两者之间的孔的位置。
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公开(公告)号：CN104041050A
公开(公告)日：2014-09-10
申请号：CN201380005126.1
申请日：2013-01-20
申请人： 高通股份有限公司
CPC分类号： H04N19/436 , H04N19/423 , H04N19/44 , H04N19/82
摘要： 一种用于在多线程处理器中执行纹理解码的方法包括在多个硬件线程中实质上同时解码VP8帧的至少两个宏块。每一硬件线程每次解码一个宏块。所述方法还可包括将来自所述VP8帧的所述至少两个宏块的一宏块指派给所述多线程处理器的一硬件线程。
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公开(公告)号：CN101223788B
公开(公告)日：2010-12-22
申请号：CN200680026218.8
申请日：2006-05-25
申请人： 高通股份有限公司
CPC分类号： H04N19/18 , G06F7/4873 , G06F7/49963 , G06F7/535 , G06F2101/12 , G06F2207/5356 , H04N19/42 , H04N19/593 , H04N19/61
摘要： 本发明描述一种用于在编码装置中执行浮点运算的定点计算(A//B)的方法，其中A//B表示A除以B并舍入到最近整数的整数除法。所述方法可包括：从具有作为指数B的反函数产生的条目的查找表(LUT)中选择条目，其中B界定包含与编码标准相关联的每个DC标量值和每个量化参数的值范围；以及基于值A、B1和B2根据所述编码标准计算用于编码的A//B，其中B1和B2包括所述LUT的所述选定条目的高和低部分。所述技术可简化视频编码器的数字信号处理器(DSP)实施方案，且尤其可用于MPEG-4编码器和可能的其它编码器。
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