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    Maintenance channel for modulator, highly interconnected computer systems
    1.
    发明授权
    Maintenance channel for modulator, highly interconnected computer systems 失效
    用于模块化，高度互联的计算机系统的维护通道

    公开(公告)号：US5692123A

    公开(公告)日：1997-11-25

    申请号：US350648

    申请日：1994-12-07

    申请人： Peter G. Logghe

    发明人： Peter G. Logghe

    IPC分类号： G06F15/16 ,  G06F11/00 ,  G06F11/273 ,  G06F15/173 ,  G06F15/177

    CPC分类号： G06F15/17343 ,  G06F11/0709 ,  G06F11/0763 ,  G06F11/2033 ,  G06F11/2736

    摘要： A maintenance channel for modular computer system reset, configuration, partitioning, and error communication. The maintenance channel includes a sanity code channel to ensure module functionality. The maintenance channel configures the computer system and issues commands to modules using a command channel. Error detection and diagnostics are performed using an error channel. The maintenance channel provides independent processing groups within one computer system, and allows for partial powerdown or isolation of portions of the system without affecting operations in the active portions of the computer system.

    摘要翻译： 模块化计算机系统复位，配置，分区和错误通信的维护通道。 维护通道包括确保模块功能的理性代码通道。 维护通道配置计算机系统，并使用命令通道向模块发出命令。 使用错误通道执行错误检测和诊断。 维护通道在一个计算机系统内提供独立的处理组，并允许系统的部分断电或隔离，而不影响计算机系统的有效部分中的操作。

    Adaptive congestion control mechanism for modular computer networks
    2.
    发明授权
    Adaptive congestion control mechanism for modular computer networks 失效
    模块化计算机网络的自适应拥塞控制机制

    公开(公告)号：US5958017A

    公开(公告)日：1999-09-28

    申请号：US935667

    申请日：1997-09-23

    申请人： Steven L. Scott ,  Richard D. Pribnow ,  Peter G. Logghe ,  Daniel L. Kunkel ,  Gerald A. Schwoerer

    发明人： Steven L. Scott ,  Richard D. Pribnow ,  Peter G. Logghe ,  Daniel L. Kunkel ,  Gerald A. Schwoerer

    IPC分类号： G06F15/17 ,  H04L12/56 ,  H04Q11/04 ,  G06F15/16

    CPC分类号： H04L47/26 ,  G06F15/17 ,  H04L47/10 ,  H04L47/12 ,  H04L47/29 ,  H04L49/90 ,  H04Q11/0478 ,  H04L2012/5635

    摘要： A congestion control mechanism for a node of a modular computer network system. The mechanism includes registers for maintaining the number of undelivered requests and unanswered requests for the node and registers for the maximum number of such undelivered requests and unanswered requests. The mechanism regulates congestion on the network by throttling back or ratcheting up the allowed number of undelivered requests and unanswered requests based upon the level of busy and non-busy results of such requests and answers. Congestion is also alleviated by the implementation of a set of large and small send and receive buffers. These buffers are configurably partitioned among virtual I/O channels. Each request virtual I/O channel may utilitize congestion control.

    摘要翻译： 一种用于模块化计算机网络系统的节点的拥塞控制机制。 该机制包括用于维护未传递请求数量和未被应答的节点请求的寄存器，并为最大数量的未递送请求和未应答请求注册。 该机制基于这种请求和答案的忙碌和非忙碌结果的程度来调节网络上的拥塞，通过调节或者解除允许的未传送请求数量和未应答请求。 通过实现一组大小的发送和接收缓冲区也可以减轻拥塞。 这些缓冲区可以在虚拟I / O通道之间配置分配。 每个请求虚拟I / O通道可能会实现拥塞控制。

    Memory interconnect network having separate routing networks for inputs and outputs using switches with FIFO queues and message steering bits
    4.
    发明授权
    Memory interconnect network having separate routing networks for inputs and outputs using switches with FIFO queues and message steering bits 失效
    存储器互连网络具有用于具有FIFO队列和消息导向位的交换机的用于输入和输出的分离的路由网络

    公开(公告)号：US5623698A

    公开(公告)日：1997-04-22

    申请号：US55814

    申请日：1993-04-30

    申请人： Bricky A. Stephenson ,  Peter G. Logghe

    发明人： Bricky A. Stephenson ,  Peter G. Logghe

    IPC分类号： G06F15/167 ,  G06F15/173 ,  G06F13/00

    CPC分类号： G06F15/17393

    摘要： A processor to memory interconnect network can be used to construct both small and large scale multiprocessing systems. The interconnect network includes network modules and memory modules. The network and memory modules are constructed of a series of n.times.m switches, each of which route n inputs to m outputs. The switches are designed such that message contention in the interconnect network is reduced. The switches, and thus the memory and network modules are highly modular, thus allowing virtually any scale multiprocessing system to be constructed utilizing the same components.

    摘要翻译： 处理器到存储器互连网络可用于构建小型和大型多处理系统。 互连网络包括网络模块和存储器模块。 网络和存储器模块由一系列nxm开关构成，每个开关将n个输入端路由到m个输出。 交换机被设计成使得互连网络中的消息争用减少。 因此，交换机，因此存储器和网络模块是高度模块化的，因此允许使用相同组件来构建几乎任何规模的多处理系统。