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    무선 통신 시스템에서 다중 FPGA를 운영하기 위한 장치 및 방법
    3.
    发明申请
    무선 통신 시스템에서 다중 FPGA를 운영하기 위한 장치 및 방법 审中-公开

    公开(公告)号：WO2021040196A1

    公开(公告)日：2021-03-04

    申请号：PCT/KR2020/007109

    申请日：2020-06-02

    Applicant: 삼성전자 주식회사

    Inventor： 배진우 ,  최현주

    IPC: G06F13/16 ,  G06F7/76 ,  G06F12/02

    Abstract: 본 개시는 LTE(Long Term Evolution)와 같은 4G(4th generation) 통신 시스템 이후 보다 높은 데이터 전송률을 지원하기 위한 5G(5th generation) 또는 pre-5G 통신 시스템에 관련된 것이다. 본 개시의 다양한 실시 예들에 따르면, 무선 통신 시스템에서 기지국의 장치에 있어서, 마스터 FPGA(field programmable gate array); 마스터 FPGA의 제어를 받는 복수의 슬레이브 FPGA들; 및 마스터 FPGA 및 복수의 슬레이브 FPGA들과 연결된 어드레스 마스커를 포함하며, 어드레스 마스커는, 마스터 FPGA에 의하여 각각의 복수의 슬레이브 FPGA들에게 할당된 서로 다른 어드레스 비트들을 수신하고, 서로 다른 어드레스 비트들에 대하여 특정 위치의 비트 값들을 동일한 값으로 마스킹하며, 각각의 복수의 슬레이브 FPGA들에게 대응하는 마스킹된 어드레스 비트들을 송신하도록 구성된 장치가 제공된다.

    PERMUTATION-BASED CONTENT ENCRYPTION WITH MANIFESTS IN A CONTENT CENTRIC NETWORK
    4.
    发明申请
    PERMUTATION-BASED CONTENT ENCRYPTION WITH MANIFESTS IN A CONTENT CENTRIC NETWORK 审中-公开
    内容中心网络中基于排序的内容加密方法

    公开(公告)号：WO2017223000A1

    公开(公告)日：2017-12-28

    申请号：PCT/US2017/038185

    申请日：2017-06-19

    Applicant: CISCO TECHNOLOGY, INC.

    Inventor： WOOD, Christopher A.

    IPC: G06F7/76 ,  H04L9/06 ,  H04L9/14

    CPC classification number: H04L63/0428 ,  G06F7/766 ,  H04L9/06 ,  H04L9/0618 ,  H04L9/14 ,  H04L2209/34 ,  H04L2209/60 ,  H04L2209/64

    Abstract: One embodiment provides a system that facilitates encryption of manifest content based on permutation. During operation, the system partitions, by a computer system, a collection of data into a first set of content objects, wherein a content object is a chunk comprised of a plurality of bytes. The system performs a first permutation function on the first set of content objects to obtain a first set of permuted content objects. The system creates a manifest based on the permuted content objects, wherein a manifest is a content object which indicates a second set of content objects, wherein a respective content object of the second set is a data object or another manifest. The system encodes the first permutation function and the permuted content objects in the manifest, thereby facilitating an authorized entity that receives the manifest to reassemble the manifest contents based on the permutation function.

    Abstract translation: 一个实施例提供了一种有助于基于置换对清单内容进行加密的系统。 在操作期间，系统通过计算机系统将数据集合分割成第一组内容对象，其中内容对象是由多个字节组成的组块。 系统对第一组内容对象执行第一置换功能以获得第一组置换内容对象。 系统基于置换的内容对象创建清单，其中清单是指示第二组内容对象的内容对象，其中第二组的相应内容对象是数据对象或另一清单。 系统对清单中的第一置换函数和置换后的内容对象进行编码，从而便于接收清单的授权实体根据置换函数重新组装清单内容。

    DISTRIBUTED DATA SHUFFLING
    5.
    发明申请
    DISTRIBUTED DATA SHUFFLING 审中-公开
    分布式数据清洗

    公开(公告)号：WO2017087001A1

    公开(公告)日：2017-05-26

    申请号：PCT/US2015/061964

    申请日：2015-11-20

    Applicant: HEWLETT PACKARD ENTERPRISE DEVELOPMENT LP

    Inventor： NARASIMHAN, Sriram ,  BUI, Tuan Dinh ,  LI, Jun ,  VOLOS, Haris

    IPC: G06F7/76 ,  G06F15/173

    CPC classification number: G06F7/76 ,  G06F15/173 ,  G06F15/17318

    Abstract: Examples herein involve a distributed shuffle data system. Shuffle data producers of in-memory shuffle systems of the distributed shuffle data system to perform a map operation on shuffle data and provide location information of the mapped shuffle data to a shuffle coordinator of the shuffle data system. Shuffle data consumers receive the shuffle data location information and retrieve the shuffle data via direct memory access from the shared memories of the in-memory shuffle systems using the shuffle data location information.

    Abstract translation: 这里的示例涉及分布式洗牌数据系统。 混洗分布式混洗数据系统的内存中混洗系统的数据生成器，对混洗数据执行映射操作，并将映射混洗数据的位置信息提供给混洗数据系统的混洗协调器。 混洗数据消费者接收混洗数据位置信息，并使用混洗数据位置信息通过直接存储器访问从内存中混洗系统的共享存储器中检索混洗数据。

    СПОСОБ ЛИНЕЙНОГО ПРЕОБРАЗОВАНИЯ (ВАРИАНТЫ)
    6.
    发明申请
    СПОСОБ ЛИНЕЙНОГО ПРЕОБРАЗОВАНИЯ (ВАРИАНТЫ) 审中-公开
    线性变换法（VARIANTS）

    公开(公告)号：WO2017023195A1

    公开(公告)日：2017-02-09

    申请号：PCT/RU2016/050024

    申请日：2016-07-26

    Applicant: ОТКРЫТОЕ АКЦИОНЕРНОЕ ОБЩЕСТВО "ИНФОРМАЦИОННЫЕ ТЕХНОЛОГИИ И КОММУНИКАЦИОННЫЕ СИСТЕМЫ"

    Inventor： БОРИСЕНКО, Николай Павлович ,  УРИВСКИЙ, Алексей Викторович

    IPC: H04L9/06 ,  G06F7/76

    CPC classification number: H04L9/0631 ,  G06F7/76 ,  G06F9/30101 ,  H04L9/06 ,  H04L2209/12

    Abstract: Предполагаемое изобретение относится к области вычислительной техники и криптографии и, в частности, к способам реализации линейных преобразований, работающих с заданной скоростью и требующих минимальный расход памяти, для последующего применения в устройствах защиты данных криптографически- ми методами. Техническим результатом является обеспечение возможности выбора взаи- мосвязанных характеристик (быстродействие и объем необходимой памяти) для конкретной вычислительной системы при реализации линейного преобразования большой размерности. Применение предложенного способа позволяет уменьшить количество рас- ходуемой памяти при заданной разрядности применяемых процессоров. Для этого на основе заданного линейного преобразования строят модифици- рованный линейный регистр сдвига типа Галуа или типа Фибоначчи по правилам приведенным в описываемом способе, а его применение позволяет получить описанный результат.

    Abstract translation: 所提出的发明涉及计算和密码学的领域，更具体地涉及执行线性变换的方法，其以设定的速度运行并且需要最小的存储器消耗，用于随后用于数据的密码保护的设备中。 技术结果是在执行大规模线性变换时选择特定计算机系统的相关特性（响应速度和所需的存储器容量）的可能性。 使用所提出的方法使得可以减少在给定处理器容量下消耗的存储器量。 为此，根据所述方法中规定的规则，基于给定的线性变换构造修正的伽罗瓦或斐波纳契线性移位寄存器，并且其使用使得可以实现所述的结果。

    PERFORMING ARITHMETIC OPERATIONS USING BOTH LARGE AND SMALL FLOATING POINT VALUES
    8.
    发明申请
    PERFORMING ARITHMETIC OPERATIONS USING BOTH LARGE AND SMALL FLOATING POINT VALUES 审中-公开
    使用两个大的和小的浮动点值执行算术运算

    公开(公告)号：WO2013088648A1

    公开(公告)日：2013-06-20

    申请号：PCT/JP2012/007479

    申请日：2012-11-21

    Applicant: INTERNATIONAL BUSINESS MACHINES CORPORATION ,  IBM JAPAN, LTD.

    Inventor： STUECHELI, Jeffrey A. ,  RETTER, Eric Eugene ,  RAJAMANI, Karthick ,  MEALEY, Bruce ,  CARTER, John Bruce

    IPC: G06F7/76

    CPC classification number: G06F7/483 ,  G06F2207/382

    Abstract: Mechanisms are provided for performing a floating point arithmetic operation in a data processing system. A plurality of floating point operands of the floating point arithmetic operation are received and bits in a mantissa of at least one floating point operand of the plurality of floating point operands are shifted. One or more bits of the mantissa that are shifted outside a range of bits of the mantissa of at least one floating point operand are stored and a vector value is generated based on the stored one or more bits of the mantissa that are shifted outside of the range of bits of the mantissa of the at least one floating point operand. A resultant value is generated for the floating point arithmetic operation based on the vector value and the plurality of floating point operands.

    Abstract translation: 提供了用于在数据处理系统中执行浮点算术运算的机构。 接收浮点算术运算的多个浮点操作数，并移位多个浮点操作数的至少一个浮点运算数的尾数中的位。 存储在至少一个浮点操作数的尾数的位的范围之外移动的尾数的一个或多个比特，并且基于所存储的一个或多个尾数位被生成向量值， 至少一个浮点操作数的尾数的位的范围。 基于向量值和多个浮点操作数，生成用于浮点运算的结果值。

    シャッフルパターン生成回路、プロセッサ、シャッフルパターン生成方法、命令
    9.
    发明申请
    シャッフルパターン生成回路、プロセッサ、シャッフルパターン生成方法、命令 审中-公开
    小型图案生成电路，处理器，SHUFFLE图案生成方法和指令

    公开(公告)号：WO2013057872A1

    公开(公告)日：2013-04-25

    申请号：PCT/JP2012/005819

    申请日：2012-09-13

    Applicant: パナソニック株式会社 ,  上田 恭子 ,  馬場 大介

    Inventor： 上田　恭子 ,  馬場　大介

    IPC: G06F9/315 ,  G06F7/76 ,  G06F9/30

    CPC classification number: G06F9/30032 ,  G06F7/766 ,  G06F9/30018

    Abstract: 　シフト複製部は、入力された４個（ビット幅は８ビット）のインデックス列（７０２）に基づいて、各インデックスを１ビット左ビットシフトし、各インデックスを２個ずつに複製したインデックス列（９０２）を出力する。そして、加算器は、インデックス列（９０２）に左端から順に１、０、１、０、１、０、１、０の値を加算したシャッフルパターン（７０３）を出力する。

    Abstract translation: 移位复制单元根据已经输入的四（比特宽度为8位）的索引的索引线（702），执行各索引的一位左位移位，并输出获得的索引行（902） 通过对每个索引进行两对二的重复。 然后，加法器输出通过从左端到索引线（902）的顺序相加1,0,0,1,0,1,0,1,0的值而获得的混洗模式（703）。

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