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公开(公告)号：CN103675470A
公开(公告)日：2014-03-26
申请号：CN201310557056.2
申请日：2013-11-11
Applicant: 北京控制工程研究所
IPC: G01R27/28
Abstract: 本发明公开了一种N×M维电阻网络测量装置，包括恒流源、仪表放大电路、电压采集电路和四个多路模拟开关；每N个电阻形成一个电阻网络，共形成M个电阻网络；每个电阻网络中的每个电阻的一端通过导线互连并形成连接点；所述连接点通过一根电缆与第三多路模拟开关的一路相连；所述连接点通过另一根电缆与第四多路模拟开关的一路相连；每个电阻网络中的每一个电阻的另一端通过两根电缆分别与第一多路模拟开关的一路、第二多路模拟开关的一路相连；恒流源、第二多路模拟开关和第三多路模拟开关形成电流源通路；第一多路模拟开关、第四多路模拟开关和仪表放大电路形成电压测试通路；通过控制四个多路模拟开关来实现N×M维电阻中的每个电阻的测试。
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公开(公告)号：CN119418739A
公开(公告)日：2025-02-11
申请号：CN202411462092.5
申请日：2024-10-18
Applicant: 北京控制工程研究所
IPC: G11C11/406 , G11C16/10
Abstract: 本发明提供了一种DRAM数据安全策略管理方法和装置，该方法包括：获取目标DRAM的最大刷新周期和处理器的硬件上电复位时间；根据所接收到的任务需求，确定目标DRAM的刷新方式和读写任务时间；根据刷新方式和任务需求，确定自刷新所用时间；根据最大刷新周期、自刷新所用时间、硬件上电复位时间和读写任务时间，确定处理器发生复位时的自刷新最晚完成时间。本方案提供了DRAM的可靠自刷新方法，在发生硬件复位时仍能完成DRAM的自刷新，保障了数据安全。
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公开(公告)号：CN103473154B
公开(公告)日：2015-08-19
申请号：CN201310372744.1
申请日：2013-08-23
Applicant: 北京控制工程研究所
IPC: G06F11/16
Abstract: 本发明公开了一种三机热备份计算机的当班机确定系统，包括主A机当班电路、从A机当班电路、A机当班判断电路，主B机当班电路、从B机当班电路、B机当班判断电路，主C机当班电路、从C机当班电路和C机当班判断电路；当A机当班控制信号为A机当班时，主从B机当班电路输出的判断信号为B机不当班；主从C机当班电路输出的判断信号为C机不当班；当A机当班控制信号、B机当班控制信号均为不当班时，主从C机当班电路输出的判断信号为C机当班。本发明可以容忍单份容错电路故障，确保有且仅有一机当班，提高了系统的可靠性。
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公开(公告)号：CN103473154A
公开(公告)日：2013-12-25
申请号：CN201310372744.1
申请日：2013-08-23
Applicant: 北京控制工程研究所
IPC: G06F11/16
Abstract: 本发明公开了一种三机热备份计算机的当班机确定系统，包括主A机当班电路、从A机当班电路、A机当班判断电路，主B机当班电路、从B机当班电路、B机当班判断电路，主C机当班电路、从C机当班电路和C机当班判断电路；当A机当班控制信号为A机当班时，主从B机当班电路输出的判断信号为B机不当班；主从C机当班电路输出的判断信号为C机不当班；当A机当班控制信号、B机当班控制信号均为不当班时，主从C机当班电路输出的判断信号为C机当班。本发明可以容忍单份容错电路故障，确保有且仅有一机当班，提高了系统的可靠性。
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Patent Agency Ranking
公开(公告)号：CN106528466A
公开(公告)日：2017-03-22
申请号：CN201610907762.9
申请日：2016-10-18
Applicant: 北京控制工程研究所
CPC classification number: G06F13/225 , G06F13/1684
Abstract: 一种星载计算机内部处理器单元和IO单元之间的数据交换系统及方法，设计了一个具有自主执行IO访问指令能力的控制器，CPU可以直接访问IO控制器也可以通过一个高速存储器和IO控制器实现数据交互。处理器可将需要IO控制器执行的指令预存至高速存储器中，然后由IO控制器自动读取存储器指令并执行相应操作，操作完毕后等待处理器的下一步指令，本发明效果显著，规避了慢速IO对处理器运行速度的影响，充分发挥处理器性能；取消了产品内部单板之间的自定义三总线设计，有利于单板的标准化设计；避免应用软件频繁的IO访问操作，有利于软件编程实现。
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公开(公告)号：CN103095275B
公开(公告)日：2016-03-02
申请号：CN201210505084.5
申请日：2012-11-30
Applicant: 北京控制工程研究所
IPC: H03K19/003
Abstract: 本发明公开了一种高可靠大功率驱动电路，用于对多个不同的负载分别进行驱动，包括：控制计算，译码输出电路、驱动单元、串并变换电路，控制计算机针对被驱动的负载产生负载驱动指令；译码输出电路对负载驱动指令进行译码，获得对应于每个负载编号的驱动信号强度和驱动时间；串并变换电路将负载驱动强度和驱动时间信号串并变换后输出到所述驱动单元；驱动单元包括多路负载驱动输出口；每个负载驱动输出口与一个负载相连，并根据相连的负载编号输出与驱动信号强度相对应的驱动信号，在达到驱动时间后，所述负载驱动输出口结束驱动信号的输出。同时本发明还提供了一种高可靠大功率驱动方法。本发明可实现对多个不同负载的大功率不同时间长度的驱动。
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公开(公告)号：CN104572213A
公开(公告)日：2015-04-29
申请号：CN201510036911.4
申请日：2015-01-23
Applicant: 北京控制工程研究所
IPC: G06F9/445
Abstract: 本发明涉及一种星载控制计算机的重构方法，该方法的步骤包括：(1)、对计算机单元的FPGA进行系统划分；(2)、地面控制中心计算机单元的FPGA配置文件；(3)、地面控制中心发送所述FPGA配置文件到数管分系统；(4)、数管分系统将所述FPGA配置文件发送到整星总线上；(5)、计算机单元在当班工作状态下进行重构操作；该方法采用SRAM型FPGA替换原有星载计算机的中央处理器，并在原有星载计算机上设计重构控制电路和重构配置数据存储器与该SRAM型FPGA的配置接口连接，该SRAM型FPGA划分为可重构区和固定区，可以实现星载控制计算机完成在轨重构，使得星载计算机在轨期间能够在地面的控制下，使用上行注入的配置文件实时改变功能。
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公开(公告)号：CN104461764A
公开(公告)日：2015-03-25
申请号：CN201410782611.6
申请日：2014-12-16
Applicant: 北京控制工程研究所
IPC: G06F11/10
Abstract: 本发明提供一种内置CRC校验码的FPGA配置文件生成方法，该方法包括如下步骤：以EDA工具生成的FPGA配置文件为基础，按照特征值读取配置文件中所包含的FPGA配置信息，并按帧计算其对应的CRC校验码；在配置文件中搜索空白区域；将计算得到的配置帧CRC校验码写入搜索得到的空白区即可完成内置CRC校验码的FPGA配置文件生成，本发明能充分利用原始FPGA配置文件中的空闲资源，在不带来额外软硬件开销的基础下实现FPGA校验信息和配置信息的同时同地存储，并且计算过程不依赖于特定的FPGA芯片物理结构，便于硬件资源有限的平台实现FPGA配置信息回读校验达成系统容错目的，具有广泛的应用前景。
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公开(公告)号：CN103869720A
公开(公告)日：2014-06-18
申请号：CN201410119759.1
申请日：2014-03-27
Applicant: 北京控制工程研究所
IPC: G05B19/04
Abstract: 一种卫星推进驱动线路电源管理系统，包括推进分系统控制器、第一控制信号驱动线路、第二控制信号驱动线路、整星一次电源、第一磁保持继电器、第二磁保持继电器、星务分系统、星箭分离开关和推进驱动线路。通过推进分系统控制器和星务分系统共同对推进驱动线路电源进行管理；两个磁保持继电器并联，星务分系统发出4个独立控制指令对磁保持继电器进行控制；星箭分离开关仅通过控制信号；推进分系统控制器输出的控制信号需在星箭分离开关信号有效时才能输出。实现卫星推进驱动线路电源管理的需求，提高了系统的安全性、可靠性以及使用时的自主性。
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