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公开(公告)号：CN101577851B
公开(公告)日：2011-04-20
申请号：CN200910033125.3
申请日：2009-06-12
Applicant: 东南大学
Abstract: 本发明提出一种提高立体声分离度的方法，该方法通过在立体声解码电路中增加一个相位补偿模块，从而降低导频信号和接收到的立体声信号之间的相位误差，提高了立体声的分离度。这里的相位补偿模块是由一个内部结构对称的相位误差计算电路组成的，该电路计算出要补偿相位误差所需要的补偿因子，然后利用该补偿因子来补偿解码后的立体声信号，使得立体声的分离度达到最优。
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公开(公告)号：CN101801057A
公开(公告)日：2010-08-11
申请号：CN201010109808.5
申请日：2010-02-10
Applicant: 东南大学
CPC classification number: Y02D70/30
Abstract: 本发明涉及一种无线传感器网络簇间快速通信方法，包括：簇头之间组成链式的传输通道，在每次通信的开始源簇头预先通过发送很短的预约发送包(RP)并沿着簇头组成的多跳链路快速传递到汇聚节点，当RP经过每个中间簇头时，中间簇头在RP中对应的字段中填写本次需要传输的数据包数目。汇聚节点收到RP后回复一个预约确认包(CP)并沿着逆向路径传输回发起请求的源簇头，沿途接收CP的簇头根据自身需要发送数据包的数目合理调度睡眠和通信过程。最后簇头之间形成多跳传输通道，采用类似多级流水线方式将数据快速传递到汇聚节点，本发明能有效提高簇间通信的效率，较大程度降低传输延迟和能耗。
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公开(公告)号：CN101656514A
公开(公告)日：2010-02-24
申请号：CN200910035181.0
申请日：2009-09-07
Applicant: 东南大学
Abstract: 本发明公开了一种基于匹配共享、增益可控的并联型射频功率放大器，适用于蓝牙等短距离通信系统，包括：输入匹配级I，根据中间级II并联差分结构电路单元组合的变化，动态调整匹配电路，实现良好共轭匹配；中间级II，多组不同宽长比的差分结构电路单元在数字控制信号作用下，可以实现任意组合，达到了输出功率可编程；输出匹配级III，采用具有容性中和技术的巴伦电路结构；动态电压偏置电路IV，为中间级II的每个差分结构电路单元提供单独电压偏置电路。本发明还公开了其实现方法。本发明简化了输入和输出匹配电路，大大减小了芯片占用面积，采用数字控制方式，可以实现功率输出的精确控制，易于和其它系统模块集成，增强了应用的广泛性。
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公开(公告)号：CN101640533A
公开(公告)日：2010-02-03
申请号：CN200910184797.4
申请日：2009-08-14
Applicant: 东南大学
IPC: H03L7/08
Abstract: 一种全数字锁相环的快速锁定方法，用于对设有包括鉴相鉴频器，时间数字转换器，数字滤波器，数控振荡器和分频器构成的全数字锁相环在短时间内锁定频率，其特征在于：通过设计的算法找到控制数控振荡器频率的一个控制字，受该控制字控制的数控振荡器输出的时钟经过分频后得到分频时钟，该分频时钟频率与参考时钟频率相近，然后基于鉴相鉴频器鉴出的参考时钟和分频时钟之间的相位差，来控制数控振荡器进行锁定；该全数字锁相环设有快速频率捕获和锁相两个环路，两个环路交替工作，首先由快速频率捕获环路完成频率捕获，然后再由锁相环路完成精确锁定。
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公开(公告)号：CN100561905C
公开(公告)日：2009-11-18
申请号：CN200610039304.4
申请日：2006-04-05
Applicant: 东南大学
IPC: H04L7/027
Abstract: 本发明提供一种数字时钟恢复装置，包含插值滤波器1、数控振荡器2、时钟误差检测与环路滤波电路3及判决器4。插值滤波器1根据数控振荡器2提供的插值距离U和数据有效信号EN，将正交幅度调制基带信号插值调整为正交幅度调制信号，时钟误差检测与环路滤波电路3根据插值滤波器1输出的正交幅度调制信号和正交幅度调制信号经判决器4后的判决值，输出步长控制信号W给数控振荡器2，数控振荡器2根据振荡步长控制信号W周期性的给出插值距离U和数据有效信号EN。其中时钟误差检测与环路滤波电路3只使用了两个乘法器，节约了芯片资源，降低了成本。
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Patent Agency Ranking
公开(公告)号：CN101252366A
公开(公告)日：2008-08-27
申请号：CN200810019861.9
申请日：2008-03-18
Applicant: 东南大学 , 无锡硅动力微电子股份有限公司
Abstract: 零中频无线接收机直流偏差消除装置主要包括前馈放大模块Atot(41)、求和模块(42)、第二放大器Av(24)、跨导放大模块Gm(31)；求和模块(42)的正输入端接射频输入信号(X)，求和模块(42)的负输入端接跨导放大模块Gm(31)的输出端，求和模块(42)将输入的两路信号求和后输出到前馈放大模块Atot(41)的输入端，前馈放大模块Atot(41)的输出端输出消除了直流偏差的射频输出信号(Y)，同时前馈放大模块Atot(41)的输出端还与第二放大器Av(24)的输入端相接，第二放大器Av(24)的输出端接跨导放大模块Gm(31)的输入端。它可以有效消除零中频接收机中混频器输出信号的直流偏差信号，避免信噪比的恶化及后级放大器的饱和，保证零中频接收机的有效运作。
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公开(公告)号：CN101039116A
公开(公告)日：2007-09-19
申请号：CN200710020546.3
申请日：2007-03-12
Applicant: 东南大学
IPC: H03K23/64
Abstract: 高速双模16/17预分频器电路，属于高速频率合成器以及高频收发技术领域。该预分频器电路由三个正沿触发器、一个两输入或门、一个两输入与非门、一个三输入与非门和两个负沿触发器组成。其中，三个正沿触发器、两输入或门和两输入与非门构成的除4/5同步分频单元采用上升沿触发，两个负沿触发器构成的除4异步分频单元用下降沿触发，反馈控制逻辑单元采用三输入与非门。该预分频器电路消除了现有技术中，17分频时反馈路径对预分频器速度的影响，减少了反馈路径的延迟，从而避开产生反馈状态对同步4/5分频速度的影响，提高了预分频器的速度，解决了频率合成器的速度瓶颈问题，良好地实现预分频器的16/17的高速分频。
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公开(公告)号：CN101030783A
公开(公告)日：2007-09-05
申请号：CN200710019234.0
申请日：2007-01-05
Applicant: 东南大学
Abstract: 用于流水线型模数转换器的占空比校准电路适用于需要进行占空比校准的流水线型模数转换器电路，该电路中输入缓冲级(10)的第一输入端(A)接输入信号(CKin)，输入缓冲级(10)的第二输入端(B)接输出调整级(30)输出信号(CKd)；输入缓冲级(10)第一输出端(C)的输出信号(CKout.1)接占空比检测级(20)的输入端(E)，输入缓冲级(10)第二输出端(D)的输出信号(CKout.2)接输出调整级(30)的第二输入端(H)；占空比检测级(20)输出端(F)的输出信号(Vctr)接输出调整级(30)的第一输入端(G)；输入缓冲级(10)合成新的时钟；占空比检测级(20)将时钟占空比信息转换为电压信息，输出调整级(30)利用占空比检测级(20)的输出控制电压来调整输出信号的占空比，最后通过整形电路输出。
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公开(公告)号：CN1825793A
公开(公告)日：2006-08-30
申请号：CN200610039304.4
申请日：2006-04-05
Applicant: 东南大学
IPC: H04L7/027
Abstract: 本发明提供一种数字时钟恢复装置，包含插值滤波器1、数控振荡器2、时钟误差检测与环路滤波电路3及判决器4。插值滤波器1根据数控振荡器2提供的插值距离U和数据有效信号EN，将正交幅度调制基带信号插值调整为正交幅度调制信号，时钟误差检测与环路滤波电路3根据插值滤波器1输出的正交幅度调制信号和正交幅度调制信号经判决器4后的判决值，输出步长控制信号W给数控振荡器2，数控振荡器2根据振荡步长控制信号W周期性的给出插值距离U和数据有效信号EN。其中时钟误差检测与环路滤波电路3只使用了两个乘法器，节约了芯片资源，降低了成本。
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公开(公告)号：CN110782001B
公开(公告)日：2024-04-09
申请号：CN201910858423.X
申请日：2019-09-11
Applicant: 东南大学
IPC: G06N3/0464 , G06N3/063
Abstract: 本发明公开了一种基于组卷积神经网络使用共享卷积核的改进方法，在一般的分组卷积中每个组都占用了与其他组不同的卷积核，这对硬件实现上带来许多不变。针对这个问题，提出了共享卷积核组卷积(KSGC)的概念，即将输入的通道平均分成多个组，并且对每个组分别进行卷积操作，特别之处在于，这个输入通道中的所有组都使用的是同一个卷积核进行卷积，在此基础上，还将组与组之间有信息交流的组卷积的卷积核改为共享的进行测试。这种共享卷积核组网络，使用了更少的参数，提高了卷积神经网络的计算效率，进一步解决了神经网络参数复杂度过高的问题，在硬件上也减少了逻辑资源消耗。
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