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公开(公告)号：CN105183557B
公开(公告)日：2018-11-20
申请号：CN201510528562.8
申请日：2015-08-26
申请人： 东南大学
摘要： 本发明公开了一种基于硬件的可配置的数据压缩系统，包括字典维护模块、数据请求模块、数据压缩模块以及数据输出模块，本发明公开的可配置的硬件数据压缩系统，使用可编程逻辑器件(FPGA)来实现数据压缩功能，附加相关与PC机通信的模块来实现该数据压缩系统，通过采用LZ77无损压缩算法，并根据该算法设计合理的硬件电路结构，从而有效地提高数据压缩处理的效率。能根据不同的压缩级别调整LZ77压缩过程中对于压缩率和压缩速率的偏好程度，进一步可将数据压缩的结果进行不同编码以形成不同格式的压缩文件，达到硬件与软件的兼容。
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公开(公告)号：CN105207678B
公开(公告)日：2018-10-26
申请号：CN201510632922.9
申请日：2015-09-29
申请人： 东南大学
IPC分类号： H03M7/30
摘要： 本发明公开了一种改进型LZ4压缩算法的硬件实现系统，提供了超过目前现有的LZ系列无损压缩算法的处理速度，非常适合于高带宽数据压缩场合。本发明的一种改进型LZ4压缩算法的实现方法采用全范围逐字散列的方法，改进了原始LZ4算法中，对匹配字符串内部不进行散列表录入的缺陷。本发明还公开了实现该算法的一种硬件实现系统，利用该硬件电路实现改进型LZ4压缩算法，可以发挥出该压缩算法的最大性能。压缩速度超过目前现有的LZ系列无损压缩算法，为在高带宽数据处理过程中使用LZ压缩算法提供了可能。
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公开(公告)号：CN108267508A
公开(公告)日：2018-07-10
申请号：CN201711444187.4
申请日：2017-12-27
申请人： 东南大学
摘要： 本发明公开了一种基于Android设备的多通道超声探伤系统，属于无损检测技术领域，包括：数据采集外设，用于多通道超声探伤数据采集工作，将采集到的数据发送至Android设备和接受Android设备所发送的控制命令；Android设备，用于接受数据采集外设上传的数据，与用户实时交互，向数据采集外设发送控制命令和与服务器端交互；数据采集外设与Android设备通过USB OTG协议连接；服务器端，用于存储Android设备上传的数据和向Android设备提供历史数据下载。这一系统结构设计有效降低了仪器的整体成本，增强了仪器的数据处理和存储能力，优化了波形或图形的显示界面，优化了仪器与用户的交互方式，同时可以将采集到的本机数据通过Android设备上传至服务器作长时间保存用于数据的反复查看和大数据分析。
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公开(公告)号：CN107733655A
公开(公告)日：2018-02-23
申请号：CN201710953025.7
申请日：2017-10-13
申请人： 东南大学
摘要： 本发明公开了一种基于多项式重构的APUF安全认证方法，该方法包括注册和认证两个阶段。在注册阶段，服务器随机产生大量激励和一个随机数k，APUF产生相应的响应作为横坐标。在以CRC编码后k为系数的多项式中找出相对应的真实点，并加入大量的杂凑点形成点集V。将激励、点集V以及哈希后的多项式系数hash(k)保存在服务器端。在认证阶段，用户手中PUF电路产生响应并随机化，在点集V中查询相对应的真实点用于构造多项式，得到多项式系数。hash()与hash(k)进行对比认证，相同则认证成功。本发明APUF响应随机化处理以及杂凑点的加入，可以抗机器学习攻击保证数据安全可靠。
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公开(公告)号：CN107257278A
公开(公告)日：2017-10-17
申请号：CN201710395590.6
申请日：2017-05-27
申请人： 东南大学
IPC分类号： H04L9/00
摘要： 本发明提供一种硬件可实现的快速和安全的Logistic混沌加解密方法，所述方法包括加密过程和解密过程，加密过程和解密过程相同，不破坏原有的应用体系。和以往的Logistic混沌加解密方法相比，该方法将Logistic混沌映射进行离散化操作，使其适用于硬件电路，不需要对该系统的密钥再进行扩展位宽和四舍五入操作，提升了电路处理的性能。同时该混沌加解密方法还结合线性反馈移位寄存器，提升了该加密算法的性能，使得加密数据安全性更高。该加密方法尤其适合安全系数要求比较高，速度要求比较快的场合。
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公开(公告)号：CN104331145B
公开(公告)日：2017-07-07
申请号：CN201410572217.X
申请日：2014-10-23
申请人： 东南大学成贤学院
IPC分类号： G06F1/32
摘要： 本发明公开了一种降低DDR3内存写操作功耗实现方法，该方法包括：DDR3内存里增加一个命令缓冲重组逻辑概念的提出；缓冲重组逻辑将写命令重组，将读命令直接给DDR3；把同一行的BL8写操作两个组合在一起，增加连续写数据传输时间；在DDR3内存中增加一个门控时钟，在突发长度为8的写过程中，关闭时钟，降低DDR3的功耗；DDR3内存采样写数据DQ是依据周期性的输入数据选取信号DQS；最后一个写数据采样结束以后开启DDR3的时钟，DDR3恢复正常模式。本发明提出了一种降低DDR3内存写操作功耗的实现方法，该方法可应用于目前以DDR3为主流的内存中，特别对低功耗要求高的移动设备内存中。通过这个方法，可以有效的降低DDR3写操作的功耗。
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公开(公告)号：CN106020771A
公开(公告)日：2016-10-12
申请号：CN201610373538.6
申请日：2016-05-31
申请人： 东南大学
IPC分类号： G06F7/58
CPC分类号： G06F7/582
摘要： 本发明提供一种基于PUF的伪随机序列发生器，包括：基于PUF的熵提取模块、实例化模块、重播种模块和伪随机序列发生模块。本发明首先通过PUF方式产生一个真随机数，作为熵输入，再根据需要产生的伪随机序列的特性选择不同的PUF实现方法产生伪随机序列。当序列的位数不能满足要求时，本发明会通过生成重播种变量V’和重播种常量C’继续进行迭代运算，直至生成的伪随机序列的位数达到要求。本发明所公开的基于PUF的伪随机序列发生器充分利用了PUF不可克隆的特性，通过提取真随机数作为种子，再利用哈希算法的不可逆性产生伪随机序列。相比现有的伪随机序列发生器，本发明产生的伪随机序列成本开销低，而随机性和安全性更有保证。
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公开(公告)号：CN103297062B
公开(公告)日：2016-08-31
申请号：CN201310028091.5
申请日：2013-01-24
申请人： 东南大学
IPC分类号： H03M13/15
摘要： 本发明公开一种基于李氏制约竞争计数编码的4线?16线译码电路，包括4个非门和16个四输入与门，4位李氏制约竞争计数编码输入分别为A0、A1、A2和A3，各分别对应于一个非门，输出端分别为Y0、Y1、Y2、Y3、Y4……Y15，分别对应一个与门；本发明所设计的基于李氏制约竞争计数编码的4线?16线译码电路以李氏制约竞争计数编码为基础，作为译码输出的Y0?Y15有规律可循，并且此种译码电路具有特征序列，能够提高信号传输的可靠性，同时还降低了译码的误码率。
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公开(公告)号：CN103297064B
公开(公告)日：2016-08-03
申请号：CN201310028311.4
申请日：2013-01-24
申请人： 东南大学
IPC分类号： H03M13/15
摘要： 本发明公开了一种基于李氏制约竞争计数编码的显示译码电路，包括控制电路和译码电路，所述控制电路具有编码输入端、灯测试输入端、灭零输入端和灭灯输入/灭零输出端，其中，灯测试输入端用于测试被驱动数码显示管是否能正常工作，灭零输入端用于消除不希望出现的0，灭灯输入端用于熄灭数码显示管，灭零输出端显示本应显示的0是否被熄灭；本发明所设计的基于李氏制约竞争计数编码的显示译码电路能够提高数据的可靠性，并可实现灯测试功能、灭零功能、灭灯功能及灭零指示功能。
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公开(公告)号：CN105721161A
公开(公告)日：2016-06-29
申请号：CN201610061043.X
申请日：2016-01-28
申请人： 东南大学
IPC分类号： H04L9/32
CPC分类号： H04L9/3242 , H04L9/3239
摘要： 本发明公开了一种基于总线的H2?MAC消息认证IP核硬件装置，属于网络数据安全领域，该消息认证装置包括：解析模块、MD5密钥模块、padding模块、SHA?1密钥模块、初始摘要寄存器、中间摘要寄存器、H2?MAC控制模块、MD5运算模块、SHA?1运算模块、后封装模块。本发明采用硬件方式实现消息认证，相对软件方式，认证速度更快；同时基于总线方式进行IP核认证，在总线上挂载多个IP核，使得认证速度进一步提高。本发明采用H2?MAC认证机制，在认证时相比HMAC少一次对认证密钥的查询，简化了硬件设计和查询流程。
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