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公开(公告)号:CN101809555B
公开(公告)日:2013-10-30
申请号:CN200880108334.3
申请日:2008-08-22
申请人: 高通股份有限公司
IPC分类号: G06F13/38
摘要: 本文描述了适合于各种应用的基于分组的处理系统,例如用于无线通信系统中的基站或终端。基于分组的处理系统可以包括多个处理模块和至少一个传输模块。处理模块可以通过公共分组接口向彼此发送分组,并且异步地进行操作。传输模块可以转发由处理模块发送的分组,并且相对于处理模块异步地进行操作。每一个处理模块都可以包括网络接口、至少一个缓冲器、分组解析器、分组构造器和至少一个处理单元。每一个处理模块支持至少一个服务单元。每一个分组可以包括报头和有效载荷。报头包括针对发送该分组的源服务单元的源服务地址和针对接收该分组的接收方服务单元的目的服务地址。
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公开(公告)号:CN103325385A
公开(公告)日:2013-09-25
申请号:CN201210080132.0
申请日:2012-03-23
申请人: 杜比实验室特许公司
IPC分类号: G10L25/78
CPC分类号: H04L49/90 , G10L19/167 , G10L25/78 , H04L65/1066 , H04M3/569
摘要: 描述了语音通信方法和设备、操作抖动缓冲器的方法和设备。顺序获得音频块。音频块中的每个音频块包括一个或更多个音频帧。对音频块进行语音活动检测。响应于针对音频块中的当前音频块做出发声起始的判决,取得所获得的音频块的序列的子序列。子序列紧临在所述当前音频块之前。子序列具有预定长度。针对子序列中的每个音频块做出了非语音的判决。将当前音频块和子序列中的音频块发送给接收方。子序列中的音频块被标识为再处理的音频块。响应于针对当前音频块做出非语音的判决,缓冲存储当前音频块。
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公开(公告)号:CN101689169B
公开(公告)日:2013-08-21
申请号:CN200880022562.9
申请日:2008-06-22
申请人: 微软公司
IPC分类号: G06F15/16
CPC分类号: G06F13/102 , G06F9/4411 , H04L49/90 , H04L67/28 , H04L67/34 , H04L69/40
摘要: 提供了使用驱动程序模型与同外部硬件装置相关联的设备驱动程序进行通信来在计算机网络中从分布式操作系统界面管理外部硬件装置的实施例。在一个实施例中,可在基于web的分布式操作系统界面中接收对管理计算机网络中的外部硬件装置的请求。可选择驱动程序模型,其被配置成与用于管理外部硬件装置的配置设置的设备驱动程序接口。驱动程序模型可被用于从该界面管理外部硬件装置配置设置。这些设置可包括管理域名改变、防火墙设置、代理设置等。在另一实施例中,驱动程序模型可被用于在从分布式操作系统界面发起的网络配置操作期间管理外部硬件装置设置。
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公开(公告)号:CN103227755A
公开(公告)日:2013-07-31
申请号:CN201210337676.0
申请日:2012-09-06
申请人: 阿尔特拉公司
IPC分类号: H04L12/861
CPC分类号: G06F13/385 , G06F2213/3808 , H04L49/90
摘要: 本发明涉及使用推测技术的处理器到基于消息的网络的接口。其提供了用于耦合至处理器的、被用于允许处理器向硬件单元发送消息的消息网络接口单元(消息接口单元)的方法和系统。还提供了用于耦合到处理器的、被用于允许处理器从硬件单元接收消息的消息接口单元的方法和系统。这里所描述的消息网络接口单元可以允许实施数据密集的实时应用,其需要大体上低的消息响应延时以及大体上高的消息吞吐量。
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公开(公告)号:CN103119899A
公开(公告)日:2013-05-22
申请号:CN201180045332.6
申请日:2011-08-04
申请人: 苹果公司
发明人: C·加泽拉
IPC分类号: H04L12/801 , H04L12/813
摘要: 本发明涉及减少数据传输开销的方法和设备。在一个实施例中,第一设备推迟打开数据连接,而不是立即传送第一数据;使任何随后到达的数据与第一数据一起排队,并一起传送。通过在必须建立连接之前,延迟连接建立,并且在一些情况下,完全消除空闲模式操作,来优化连接开销。还公开了调整传输行为以使一个或多个期望的结果达以最大化的随机实施例。例如,一个这样的实施例在打开数据连接之前,使数据排队随机确定的一段时间。随机确定的时间间隔平衡有效服务接连到达的数据的可能性和总性能。还公开了接收和利用设备用户和/或接收器(例如,基站)反馈的机制。
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公开(公告)号:CN101258719B
公开(公告)日:2012-12-12
申请号:CN200680026207.X
申请日:2006-07-17
申请人: 黑曜石研究有限公司
发明人: 詹森·加里·贡特普 , 大卫·托马斯·索斯韦尔 , 克里斯多佛·耶斯克
CPC分类号: H04L12/4633 , H04L47/10 , H04L47/39 , H04L49/90 , H04L67/08 , H04L2212/00
摘要: 本发明涉及一种用于延长InfiniBand网络的实时到达的装置的系统。方法和装置可以将InfiniBand网络连接到长距离连接(例如,WAN),同时保持完整的10Gbit InfiniBand速度,并且保留由InfiniBand结构(IBTA)指定的语义。该系统包括InfiniBand接口、管理模块、分组路由、封装/去封装、大容量缓冲存储器和WAN接口、逻辑和电路。本发明适用于有效地使用单个传输流在很大的距离上移动大量数据。
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公开(公告)号:CN101472171B
公开(公告)日:2012-11-21
申请号:CN200910001632.9
申请日:2003-09-19
申请人: GVBB控股股份有限公司
发明人: 田渕敦之
IPC分类号: H04N21/2343 , H04N21/2368 , H04N21/4143 , H04N21/426 , H04N21/43 , H04N21/434 , H04N21/436 , H04N21/4363 , H04N21/4402 , H04N21/462 , H04N9/64 , G11B27/034
CPC分类号: H04L51/28 , G01S1/026 , G01S5/021 , G01S5/06 , G06F1/1626 , G06F1/1639 , G06F3/0481 , G06F12/109 , G06F21/305 , G06F21/6209 , G06F21/74 , G06F21/88 , G06F2221/2105 , G06F2221/2115 , G11B20/10009 , G11B20/10425 , G11B20/22 , G11B27/034 , H03L7/091 , H04B1/707 , H04B7/18582 , H04B7/2628 , H04B7/2687 , H04B10/25754 , H04J3/0655 , H04J3/0658 , H04J13/0077 , H04J13/16 , H04L1/0002 , H04L1/0015 , H04L1/0066 , H04L1/0068 , H04L1/1685 , H04L1/1841 , H04L1/187 , H04L9/085 , H04L9/304 , H04L12/40117 , H04L12/417 , H04L12/462 , H04L12/4641 , H04L25/03038 , H04L25/4902 , H04L25/4904 , H04L25/497 , H04L27/156 , H04L29/06 , H04L29/06027 , H04L29/12471 , H04L41/06 , H04L41/5009 , H04L41/5035 , H04L41/5087 , H04L43/0829 , H04L43/50 , H04L45/04 , H04L45/22 , H04L45/24 , H04L47/10 , H04L47/11 , H04L47/12 , H04L47/14 , H04L47/15 , H04L47/193 , H04L47/2416 , H04L47/27 , H04L47/283 , H04L47/34 , H04L47/70 , H04L47/72 , H04L47/745 , H04L47/765 , H04L47/822 , H04L47/824 , H04L49/90 , H04L49/9094 , H04L51/04 , H04L51/38 , H04L61/2553 , H04L65/1006 , H04L65/1016 , H04L65/1043 , H04L65/4061 , H04L65/4092 , H04L65/605 , H04L65/607 , H04L67/1002 , H04L67/1034 , H04L69/14 , H04L69/16 , H04L69/161 , H04L69/163 , H04L69/166 , H04L69/18 , H04L69/40 , H04L2012/40215 , H04L2012/40273 , H04M1/723 , H04M1/72519 , H04M1/72533 , H04M3/007 , H04M3/16 , H04M3/42221 , H04M7/0057 , H04M7/1295 , H04M11/06 , H04N1/00957 , H04N1/031 , H04N1/0318 , H04N1/1934 , H04N1/1935 , H04N1/32106 , H04N1/40 , H04N5/04 , H04N5/073 , H04N5/126 , H04N5/2251 , H04N5/2257 , H04N5/23248 , H04N5/23254 , H04N5/23258 , H04N5/23267 , H04N5/2327 , H04N5/23277 , H04N5/38 , H04N5/4401 , H04N5/4448 , H04N5/445 , H04N5/45 , H04N5/46 , H04N5/64 , H04N5/642 , H04N5/66 , H04N5/76 , H04N5/775 , H04N5/85 , H04N5/907 , H04N7/0112 , H04N7/0122 , H04N7/163 , H04N7/17327 , H04N9/3129 , H04N9/641 , H04N9/642 , H04N9/7925 , H04N9/8042 , H04N19/109 , H04N19/139 , H04N19/51 , H04N19/517 , H04N19/527 , H04N19/625 , H04N19/70 , H04N19/91 , H04N21/234318 , H04N21/2368 , H04N21/2543 , H04N21/4143 , H04N21/4181 , H04N21/42653 , H04N21/4307 , H04N21/433 , H04N21/4341 , H04N21/43622 , H04N21/43632 , H04N21/440218 , H04N21/4621 , H04N21/4623 , H04N21/47211 , H04N21/6175 , H04N21/6187 , H04N21/6582 , H04N2201/0094 , H04N2201/02493 , H04N2201/03112 , H04N2201/03133 , H04N2201/03141 , H04N2201/03145 , H04N2201/03187 , H04N2201/3212 , H04N2201/3222 , H04N2201/3274 , H04Q3/0025 , H04Q3/60 , H04Q2213/1302 , H04Q2213/13039 , H04Q2213/1304 , H04Q2213/13076 , H04Q2213/13095 , H04Q2213/13109 , H04Q2213/13298 , H04Q2213/13349 , H04R1/028 , H04S7/301 , H04W4/10 , H04W4/12 , H04W4/14 , H04W8/245 , H04W8/26 , H04W8/265 , H04W24/00 , H04W28/00 , H04W28/18 , H04W28/26 , H04W36/02 , H04W40/00 , H04W40/02 , H04W48/08 , H04W52/0225 , H04W52/0248 , H04W52/0274 , H04W52/30 , H04W56/00 , H04W64/00 , H04W68/00 , H04W72/042 , H04W72/1252 , H04W72/1268 , H04W74/008 , H04W74/0816 , H04W74/0833 , H04W76/10 , H04W76/12 , H04W76/18 , H04W76/30 , H04W76/34 , H04W76/45 , H04W80/00 , H04W84/042 , H04W84/08 , H04W84/12 , H04W88/06 , H04W88/085 , H04W88/16 , H04W92/02 , H04W92/12 , Y02D70/1222 , Y02D70/30 , Y02D70/40 , Y02D70/446 , Y02D70/449 , Y02D70/46 , Y10S370/906 , Y10S370/907 , Y10S707/99943
摘要: 本发明提供一种在将从信息处理装置输出的数据实时地转换为不同格式的数据时,通过使数据的传送和转换的数据的输出同步,从而防止产生运动图像数据中的丢帧或帧重复等图像的缺陷的数据转换系统。数据转换系统是IEEE1394总线上的第一节点和第二节点中的任何一个成为循环主机,与循环主机输出的循环开始分组同步,进行从第一节点向第二节点的第一数据传送,同时在第二节点中,与从外部输入的基准信号同步输出从第一数据转换的第二数据的数据转换系统,该系统包括外部同步信号接收部,设在第一节点以及第二节点的至少一方中,接收从外部输入的基准信号;以及同步调整部,使循环主机输出的循环开始分组的频率与由外部同步信号接收部接收到的基准信号同步。
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公开(公告)号:CN102779517A
公开(公告)日:2012-11-14
申请号:CN201210236624.4
申请日:2005-08-30
申请人: 高通股份有限公司
CPC分类号: H04L12/66 , G10L19/005 , H04J3/0632 , H04L29/06027 , H04L47/10 , H04L47/2416 , H04L47/28 , H04L47/29 , H04L47/30 , H04L49/90 , H04L49/9094 , H04L65/80
摘要: 本发明公开了一种用于分组交换通信的语音IP传输(VoIP)的自适应去抖动缓冲器。本发明所提供的去抖动缓冲器方法和设备避免了下溢的再现,同时平衡了端对端延迟。在一个实例中,去抖动缓冲器在每个话音突峰的开头被重新计算。在另一实例中,话音突峰分组在接收到所有剩余的分组后被压缩。
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公开(公告)号:CN101232450B
公开(公告)日:2012-09-05
申请号:CN200810008851.5
申请日:2008-01-25
申请人: 英飞凌科技股份公司
发明人: R·图特
CPC分类号: H04L49/9052 , H04L49/90 , H04L49/9042 , H04L49/9073
摘要: 数据分组处理设备。公开了一种用于数据分组处理的设备。在一个实施例中,设备包括在芯片上实现的处理器、可由处理器访问的芯片上内部分段存储器、芯片外外部分段存储器以及在内部分段存储器和外部分段存储器之间的数据传送通道。外部分段存储器包括第一和第二存储器分段,其中第一和第二存储器分段的大小不同。
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公开(公告)号:CN101048813B
公开(公告)日:2012-08-29
申请号:CN200580036630.3
申请日:2005-08-30
申请人: 高通股份有限公司
CPC分类号: H04L12/66 , G10L19/005 , H04J3/0632 , H04L29/06027 , H04L47/10 , H04L47/2416 , H04L47/28 , H04L47/29 , H04L47/30 , H04L49/90 , H04L49/9094 , H04L65/80
摘要: 本发明公开了一种用于分组交换通信的语音IP传输(VoIP)的自适应去抖动缓冲器。本发明所提供的去抖动缓冲器方法和设备避免了下溢的再现,同时平衡了端对端延迟。在一个实例中,去抖动缓冲器在每个话音突峰的开头被重新计算。在另一实例中,话音突峰分组在接收到所有剩余的分组后被压缩。
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