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公开(公告)号：CN112147880B
公开(公告)日：2022-08-05
申请号：CN202010867911.X
申请日：2020-08-26
Applicant: 山东航天电子技术研究所
IPC: G05B9/03
Abstract: 本发明公开一种遥控指令选择控制方法，在一种遥控指令选择控制系统中实现，该系统包括电连接的遥控模块和计算机模块，遥控模块包括遥控‑主份和遥控‑备份，遥控‑主份和遥控‑备份工作在热备份模式下，同时接收地面遥控指令，经过遥控指令选择控制后，将一份遥控指令送至后级电路的计算机模块，其中计算机模块包括计算机‑主份与计算机‑备份，计算机‑主份与计算机‑备份工作在冷备份模式；本发明以机械开关为核心实现遥控指令选择控制，由两只继电器触点串并联，遥控主份电路与备份电路采用同一个控制信号，此控制信号仅存在遥控主份电路输出状态与遥控备份电路输出状态，有效避免了两份遥控指令均不能输出或者同时输出至后级电路的风险。
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公开(公告)号：CN110989715A
公开(公告)日：2020-04-10
申请号：CN201911174128.9
申请日：2019-11-26
Applicant: 山东航天电子技术研究所
IPC: G05D23/19
Abstract: 本发明公开了一种高稳定度恒流源产生电路及测温电路，其中高稳定度恒流源产生电路包括误差叠加部分、反馈控制部分、恒流输出部分和误差生成部分，误差叠加部分、反馈控制部分和恒流输出部分依次相连，误差生成部分的输入端与恒流输出部分连接，误差生成部分的输出端与误差叠加部分的输入端连接，本发明的高稳定度恒流源产生电路，具有高稳定度的有益效果，且电路结构简单。
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公开(公告)号：CN109783415B
公开(公告)日：2022-05-27
申请号：CN201811408908.0
申请日：2018-11-23
Applicant: 山东航天电子技术研究所
Abstract: 本发明公开了一种修正处理器BM3803读时序的装置，采用系统时钟CLK的上升沿驱动锁存器54AC374，对片选信号IOSN和地址线ADDR进行前沿截取，得到IOSN2和ADDR2，采用54AC32对片选信号IOSN2进行后沿截取，得到IOSN3，IOSN3和ADDR2最终参与译码，使得修正后的片选信号IOSN3已完全被地址线ADDR2包络，当使用译码器进行I/O片选信号扩展时，可有效避免译码器误输出。
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公开(公告)号：CN110989715B
公开(公告)日：2022-03-25
申请号：CN201911174128.9
申请日：2019-11-26
Applicant: 山东航天电子技术研究所
IPC: G05D23/19
Abstract: 本发明公开了一种高稳定度恒流源产生电路及测温电路，其中高稳定度恒流源产生电路包括误差叠加部分、反馈控制部分、恒流输出部分和误差生成部分，误差叠加部分、反馈控制部分和恒流输出部分依次相连，误差生成部分的输入端与恒流输出部分连接，误差生成部分的输出端与误差叠加部分的输入端连接，本发明的高稳定度恒流源产生电路，具有高稳定度的有益效果，且电路结构简单。
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公开(公告)号：CN112147880A
公开(公告)日：2020-12-29
申请号：CN202010867911.X
申请日：2020-08-26
Applicant: 山东航天电子技术研究所
IPC: G05B9/03
Abstract: 本发明公开一种遥控指令选择控制方法，在一种遥控指令选择控制系统中实现，该系统包括电连接的遥控模块和计算机模块，遥控模块包括遥控‑主份和遥控‑备份，遥控‑主份和遥控‑备份工作在热备份模式下，同时接收地面遥控指令，经过遥控指令选择控制后，将一份遥控指令送至后级电路的计算机模块，其中计算机模块包括计算机‑主份与计算机‑备份，计算机‑主份与计算机‑备份工作在冷备份模式；本发明以机械开关为核心实现遥控指令选择控制，由两只继电器触点串并联，遥控主份电路与备份电路采用同一个控制信号，此控制信号仅存在遥控主份电路输出状态与遥控备份电路输出状态，有效避免了两份遥控指令均不能输出或者同时输出至后级电路的风险。
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Patent Agency Ranking
公开(公告)号：CN109783415A
公开(公告)日：2019-05-21
申请号：CN201811408908.0
申请日：2018-11-23
Applicant: 山东航天电子技术研究所
Abstract: 本发明公开了一种修正处理器BM3803读时序的装置，采用系统时钟CLK的上升沿驱动锁存器54AC374，对片选信号IOSN和地址线ADDR进行前沿截取，得到IOSN2和ADDR2，采用54AC32对片选信号IOSN2进行后沿截取，得到IOSN3，IOSN3和ADDR2最终参与译码，使得修正后的片选信号IOSN3已完全被地址线ADDR2包络，当使用译码器进行I/O片选信号扩展时，可有效避免译码器误输出。
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公开(公告)号：CN109741781A
公开(公告)日：2019-05-10
申请号：CN201811407648.5
申请日：2018-11-23
Applicant: 山东航天电子技术研究所
IPC: G11C29/44 , H03K19/003
Abstract: 本发明公开了一种基于三模冗余的多基片存储器的数据写入读出方法，将三模冗余与多基片存储器结合，利用多基片存储器的特性，在三模冗余的写操作中加入移位操作，使单个基片中存储拼接数据的不同片段；然后在三模冗余的读操作中加入移位操作，移位方向与写操作相反，以恢复拼接数据；当其中的部分基片出错时，由于单个基片中存储拼接数据的不同片段，不会导致同一个数据片段都出错，因此可通过三模冗余技术解决多基片存储器中某一基片故障导致的整个存储器失效的问题，有效提高目标数据的安全性和可靠性。
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公开(公告)号：CN116049052A
公开(公告)日：2023-05-02
申请号：CN202211544186.8
申请日：2022-12-03
Applicant: 山东航天电子技术研究所
Abstract: 本发明涉及集成电路设计领域，具体涉及一种使并行总线处理器单步访问CAN总线控制器SJA1000的装置。该装置设置在并行总线处理器与SJA1000之间，为处理器单步访问SJA1000的桥接电路；处理器的原时序IO片选信号接SJA1000的ALE引脚。本发明还包括时序调理模块、分时选通模块和驱动控制模块。本发明采用硬件匹配时序的方法，利用并行总线处理器的时序特点，实现并行总线处理器一次读写操作即可完成对SJA1000的访问，提高对CAN总线的访问效率。
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公开(公告)号：CN115292047A
公开(公告)日：2022-11-04
申请号：CN202210967284.6
申请日：2022-08-12
Applicant: 山东航天电子技术研究所
Abstract: 本发明提供一种基于异构SIP的具有自刷新功能的SRAM型FPGA重构系统及工作方法，包括：异构SIP芯片、程序存储器NOR FLASH、总线接口芯片；所述异构SIP芯片中集成有CPU、SRAM型FPGA以及数据存储器DDR，所述CPU用于对所述SRAM型FPGA进行刷新，以及用于接收星地通讯接口上传的重构指令和重构数据，并对所述SRAM型FPGA进行重构，所述SRAM型FPGA用于在轨功能重构，数据存储器DDR用于写入FPGA的配置比特流；所述程序存储器NOR FLASH用于存储CPU程序和FPGA的配置比特流；所述总线接口芯片用于将星地通讯接口上传的重构数据传输至CPU。本发明不需要额外增加外部器件即可完成SIP中SRAM型FPGA的刷新与重构，不仅减少了空间单粒子对FPGA工作的影响，满足空间可靠应用需求，而且大幅降低了成本，减少了体积、重量与功耗。
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公开(公告)号：CN119440911A
公开(公告)日：2025-02-14
申请号：CN202411359568.2
申请日：2024-09-27
Applicant: 山东航天电子技术研究所
IPC: G06F11/14
Abstract: 本发明属于处理器抗辐射加固技术领域，具体涉及一种基于星载SiP的双核处理器抗单粒子翻转防护方法。该方法利用双核处理器的冗余资源，通过初始化同步、程序执行同步检测、检查点更新和中断处理以及错误处理与回卷恢复等步骤，实现错误检测和恢复。具体包括：两个核以相同状态执行同一程序，每运行N次设置检查点；写内存命令时同步计算签名并通过消息队列交换；独立判断签名一致性，不一致则进行错误处理；到达检查点时更新状态和检查点文件；错误发生时，通过多级回卷恢复机制进行系统恢复。该方法提高了星载SiP微系统在空间辐射环境下的可靠性。
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